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<!DOCTYPE html> <html class="client-nojs" lang="de" dir="ltr"> <head> <meta charset="UTF-8"> <title>Static random-access memory – Wikipedia</title> <script>(function(){var className="client-js";var cookie=document.cookie.match(/(?:^|; )dewikimwclientpreferences=([^;]+)/);if(cookie){cookie[1].split('%2C').forEach(function(pref){className=className.replace(new RegExp('(^| )'+pref.replace(/-clientpref-\w+$|[^\w-]+/g,'')+'-clientpref-\\w+( |$)'),'$1'+pref+'$2');});}document.documentElement.className=className;}());RLCONF={"wgBreakFrames":false,"wgSeparatorTransformTable":[",\t.",".\t,"],"wgDigitTransformTable":["",""],"wgDefaultDateFormat":"dmy","wgMonthNames":["","Januar","Februar","März","April","Mai","Juni","Juli","August","September","Oktober","November","Dezember"],"wgRequestId":"72ec6411-b229-48ef-a173-0959d44292db","wgCanonicalNamespace":"","wgCanonicalSpecialPageName":false,"wgNamespaceNumber":0,"wgPageName":"Static_random-access_memory","wgTitle":"Static random-access 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Enzyklopädie</div> <div id="contentSub"><div id="mw-content-subtitle"></div></div> <div id="contentSub2"></div> <div id="jump-to-nav"></div> <a class="mw-jump-link" href="#mw-head">Zur Navigation springen</a> <a class="mw-jump-link" href="#searchInput">Zur Suche springen</a> <div id="mw-content-text" class="mw-body-content"><div class="mw-content-ltr mw-parser-output" lang="de" dir="ltr"><figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/Datei:Hynix_HY62V8100B_SRAM-7313.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/6/68/Hynix_HY62V8100B_SRAM-7313.jpg/220px-Hynix_HY62V8100B_SRAM-7313.jpg" decoding="async" width="220" height="165" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/6/68/Hynix_HY62V8100B_SRAM-7313.jpg/330px-Hynix_HY62V8100B_SRAM-7313.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/6/68/Hynix_HY62V8100B_SRAM-7313.jpg/440px-Hynix_HY62V8100B_SRAM-7313.jpg 2x" data-file-width="3448" data-file-height="2586" /></a><figcaption>Ein SRAM von <a href="/wiki/SK_Hynix" title="SK Hynix">Hynix</a></figcaption></figure> <p><span lang="en"><b>Static random-access memory</b></span> (deutsch: <i>statisches <a href="/wiki/Random-Access_Memory" title="Random-Access Memory">RAM</a></i>, Abkürzung: SRAM) bezeichnet einen <a href="/wiki/Elektronik" title="Elektronik">elektronischen</a> <a href="/wiki/Speicherbaustein" title="Speicherbaustein">Speicherbaustein</a>. Zusammen mit dem <a href="/wiki/Dynamic_Random_Access_Memory" title="Dynamic Random Access Memory">dynamischen RAM</a> (DRAM) bildet es die Gruppe der <a href="/wiki/Fl%C3%BCchtiger_Speicher" class="mw-redirect" title="Flüchtiger Speicher">flüchtigen</a> (volatil; engl. <span lang="en"><i>volatile</i></span>) Speicher, das heißt, die gespeicherte Information geht bei Abschaltung der Betriebsspannung verloren. Im Gegensatz zu DRAM benötigt der SRAM kein periodisches (dynamisches) <i>Auffrischen</i> (engl. <span lang="en"><i>refresh</i></span>) zur Vermeidung von Datenverlust in jeder Datenzelle, sondern behält seine Dateninformation, solange die Betriebsspannung anliegt. </p> <div id="toc" class="toc" role="navigation" aria-labelledby="mw-toc-heading"><input type="checkbox" role="button" id="toctogglecheckbox" class="toctogglecheckbox" style="display:none" /><div class="toctitle" lang="de" dir="ltr"><h2 id="mw-toc-heading">Inhaltsverzeichnis</h2><span class="toctogglespan"><label class="toctogglelabel" for="toctogglecheckbox"></label></span></div> <ul> <li class="toclevel-1 tocsection-1"><a href="#Geschichte"><span class="tocnumber">1</span> <span class="toctext">Geschichte</span></a></li> <li class="toclevel-1 tocsection-2"><a href="#Eigenschaften_und_Aufbau"><span class="tocnumber">2</span> <span class="toctext">Eigenschaften und Aufbau</span></a></li> <li class="toclevel-1 tocsection-3"><a href="#Funktionsweise"><span class="tocnumber">3</span> <span class="toctext">Funktionsweise</span></a> <ul> <li class="toclevel-2 tocsection-4"><a href="#Standby"><span class="tocnumber">3.1</span> <span class="toctext">Standby</span></a></li> <li class="toclevel-2 tocsection-5"><a href="#Lesezugriff"><span class="tocnumber">3.2</span> <span class="toctext">Lesezugriff</span></a></li> <li class="toclevel-2 tocsection-6"><a href="#Schreibzugriff"><span class="tocnumber">3.3</span> <span class="toctext">Schreibzugriff</span></a></li> </ul> </li> <li class="toclevel-1 tocsection-7"><a href="#Schnittstellen"><span class="tocnumber">4</span> <span class="toctext">Schnittstellen</span></a></li> <li class="toclevel-1 tocsection-8"><a href="#Anwendungen"><span class="tocnumber">5</span> <span class="toctext">Anwendungen</span></a></li> <li class="toclevel-1 tocsection-9"><a href="#Literatur"><span class="tocnumber">6</span> <span class="toctext">Literatur</span></a></li> <li class="toclevel-1 tocsection-10"><a href="#Einzelnachweise"><span class="tocnumber">7</span> <span class="toctext">Einzelnachweise</span></a></li> </ul> </div> <div class="mw-heading mw-heading2"><h2 id="Geschichte">Geschichte</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=1" title="Abschnitt bearbeiten: Geschichte" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=1" title="Quellcode des Abschnitts bearbeiten: Geschichte"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Im Jahre 1963 entwarf der bei <a href="/wiki/Fairchild_Semiconductor" title="Fairchild Semiconductor">Fairchild Semiconductor</a> tätige Elektroingenieur Robert Norman das Prinzip einer Speicherzelle in <a href="/wiki/Bipolartransistor" title="Bipolartransistor">bipolarer</a> <a href="/wiki/Planartechnik" title="Planartechnik">Planartechnik</a> und meldete dies zum Patent an.<sup id="cite_ref-1" class="reference"><a href="#cite_note-1"><span class="cite-bracket">[</span>1<span class="cite-bracket">]</span></a></sup> Ein Jahr später entwickelte John Schmidt, ebenfalls bei Fairchild Semiconductor, einen SRAM-Baustein mit 64 Bit Speicherkapazität in <a href="/wiki/PMOS" title="PMOS">P-Kanal-MOS</a>-Technik, die in Speichermodulen mit 1024 Bit in Rechnern der Firma <a href="/wiki/Burroughs_Corporation" title="Burroughs Corporation">Burroughs</a> zum Einsatz kamen.<sup id="cite_ref-CHM-1970_2-0" class="reference"><a href="#cite_note-CHM-1970-2"><span class="cite-bracket">[</span>2<span class="cite-bracket">]</span></a></sup> </p><p>Nach der Gründung der Firma <a href="/wiki/Intel" title="Intel">Intel</a> durch zwei ehemalige Fairchild-Mitarbeiter im Jahre 1968 wurde im April 1969 mit dem Intel 3101 als erstes Produkt ein SRAM-Speicherbaustein mit 64 Bit Speicherkapazität in bipolarer Schottky-Technik vorgestellt.<sup id="cite_ref-Intel-1976_3-0" class="reference"><a href="#cite_note-Intel-1976-3"><span class="cite-bracket">[</span>3<span class="cite-bracket">]</span></a></sup><sup class="reference">:2–87</sup> Drei Monate darauf erschien der in P-MOS Technik gebaute Intel 1101 mit 256 Bit Speicherkapazität<sup id="cite_ref-Intel-1976_3-1" class="reference"><a href="#cite_note-Intel-1976-3"><span class="cite-bracket">[</span>3<span class="cite-bracket">]</span></a></sup><sup class="reference">:2–4</sup>, der Stromverbrauch pro Bit konnte auf ein Viertel reduziert werden.<sup id="cite_ref-Intel-1976_3-2" class="reference"><a href="#cite_note-Intel-1976-3"><span class="cite-bracket">[</span>3<span class="cite-bracket">]</span></a></sup><sup class="reference">:2–2f</sup> </p><p>Die SRAM-Speicherbausteine versprachen einen großen Kostenvorteil gegenüber der bis dahin als <a href="/wiki/Arbeitsspeicher" title="Arbeitsspeicher">Hauptspeicher</a> genutzten <a href="/wiki/Kernspeicher" title="Kernspeicher">Kernspeichertechnik</a>.<sup id="cite_ref-CHM-1970_2-1" class="reference"><a href="#cite_note-CHM-1970-2"><span class="cite-bracket">[</span>2<span class="cite-bracket">]</span></a></sup> Für den Einsatz als Hauptspeicher stand aber bereits im Oktober 1970 mit dem ersten <a href="/wiki/Dynamic_Random_Access_Memory" title="Dynamic Random Access Memory">DRAM</a>-Speicher, dem Intel-1103, eine schnellere und günstigere Alternative mit wesentlich geringerem Stromverbrauch<sup id="cite_ref-Intel-1976_3-3" class="reference"><a href="#cite_note-Intel-1976-3"><span class="cite-bracket">[</span>3<span class="cite-bracket">]</span></a></sup><sup class="reference">:2–2</sup> zur Verfügung. Der Intel 1103 DRAM benötigte drei Transistoren pro Speicherzelle, während im Intel 1101 SRAM sechs Transistoren pro Speicherzelle nötig waren. </p> <div class="mw-heading mw-heading2"><h2 id="Eigenschaften_und_Aufbau">Eigenschaften und Aufbau</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=2" title="Abschnitt bearbeiten: Eigenschaften und Aufbau" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=2" title="Quellcode des Abschnitts bearbeiten: Eigenschaften und Aufbau"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Die Informationen werden durch Zustandsänderung einer bistabilen Kippstufe in Form eines <a href="/wiki/Flipflop" title="Flipflop">Flipflops</a> pro Bit gespeichert. Das erlaubt es zwar, die Speicherzelle schnell auszulesen, aber im Vergleich zu dynamischen Speicherzellen ist die Speicherzelle verhältnismäßig groß und daher die Speicherkapazität des gesamten Chips entsprechend kleiner. Im statischen Betrieb (Halten der Information) ist der Leistungsbedarf einer Zelle sehr klein. </p> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/Datei:6t-SRAM-cell.png" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/7/77/6t-SRAM-cell.png/220px-6t-SRAM-cell.png" decoding="async" width="220" height="187" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/7/77/6t-SRAM-cell.png/330px-6t-SRAM-cell.png 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/7/77/6t-SRAM-cell.png/440px-6t-SRAM-cell.png 2x" data-file-width="925" data-file-height="788" /></a><figcaption><i>6-Transistor-Zelle</i> in <a href="/wiki/Complementary_metal-oxide-semiconductor" title="Complementary metal-oxide-semiconductor">CMOS</a>-Technik</figcaption></figure> <p>SRAMs werden heutzutage meist als <i>6-Transistor-Zelle</i> (6T-SRAM-Zelle) in <a href="/wiki/Complementary_metal-oxide-semiconductor" title="Complementary metal-oxide-semiconductor">CMOS</a>-Technik hergestellt. Der Aufbau einer Kippstufe mit <a href="/wiki/Elektrischer_Widerstand" title="Elektrischer Widerstand">Widerständen</a> als Lastelementen (sogenannte 4T-SRAM-Zelle) wird nicht mehr eingesetzt; statt der Lastwiderstände werden heute p-Kanal-MOS-Transistoren verwendet. Mit weiteren zwei Transistoren zur Ankopplung an die Spalten- bzw. Zeilen-Auswahlleitungen ergibt sich die besagte 6-Transistor-Zelle wie im Bild anbei. Wegen dieses komplizierteren Aufbaus verbraucht eine SRAM-Zelle im Vergleich zu einer <a href="/wiki/Dynamic_Random_Access_Memory" title="Dynamic Random Access Memory">DRAM</a>-Zelle deutlich mehr Chipfläche (über 140 <a href="/wiki/Minimale_Strukturgr%C3%B6%C3%9Fe" class="mw-redirect" title="Minimale Strukturgröße">F²</a>).<sup id="cite_ref-4" class="reference"><a href="#cite_note-4"><span class="cite-bracket">[</span>4<span class="cite-bracket">]</span></a></sup><sup id="cite_ref-5" class="reference"><a href="#cite_note-5"><span class="cite-bracket">[</span>5<span class="cite-bracket">]</span></a></sup> Prinzipiell wird also jedes Bit in der SRAM-Zelle in vier Transistoren gespeichert, die zwei gegeneinander verschaltete <a href="/wiki/Nicht-Gatter" title="Nicht-Gatter">Inverter</a> bilden. Diese Speicherzelle hat zwei stabile Zustände, die 0 und 1 darstellen. Die beiden zusätzlichen Zugriffstransistoren werden benutzt, um den Zugriff auf die Speicherzelle während Lese- und Schreibzugriff zu steuern. </p><p>Neben dem 4T- und 6T-SRAM-Design gibt es noch zahlreiche alternative Varianten, die mithilfe weiterer Transistoren zusätzliche Funktionen (zum Beispiel separater Leseport) oder besondere Eigenschaften (zum Beispiel geringere Leckströme, geringere Leistungsaufnahme beim Schreiben, höhere Stabilität<sup id="cite_ref-6" class="reference"><a href="#cite_note-6"><span class="cite-bracket">[</span>6<span class="cite-bracket">]</span></a></sup>) realisieren sollen. Die hierfür genutzten Bezeichnungen 5T-, 7T-, 8T-, 9T-, 10T- oder 12T-SRAM-Zelle sind jedoch nicht auf ein spezielles Design beschränkt, vgl.<sup id="cite_ref-7" class="reference"><a href="#cite_note-7"><span class="cite-bracket">[</span>7<span class="cite-bracket">]</span></a></sup> </p> <div class="mw-heading mw-heading2"><h2 id="Funktionsweise">Funktionsweise</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=3" title="Abschnitt bearbeiten: Funktionsweise" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=3" title="Quellcode des Abschnitts bearbeiten: Funktionsweise"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Eine SRAM-Zelle besitzt drei unterschiedliche Zustände. Diese sind: Standby (warten auf Zugriff), Lesezugriff (Speicherzustand wurde angefordert) und Schreibzugriff (Speicherzustand wird überschrieben). Diese Zustände funktionieren wie folgt: </p> <div class="mw-heading mw-heading3"><h3 id="Standby">Standby</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=4" title="Abschnitt bearbeiten: Standby" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=4" title="Quellcode des Abschnitts bearbeiten: Standby"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Wenn die Wordline nicht geschaltet ist, trennen die Zugriffstransistoren die Speicherzelle von den Bitlines. Die beiden gegenverschalteten Inverter (Transistoren M1-M4) verstärken ihren aktuellen Zustand jeweils gegenseitig (solange die Betriebsspannung anliegt). </p> <div class="mw-heading mw-heading3"><h3 id="Lesezugriff">Lesezugriff</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=5" title="Abschnitt bearbeiten: Lesezugriff" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=5" title="Quellcode des Abschnitts bearbeiten: Lesezugriff"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Wir nehmen an, dass der Speicherzustand bei Q auf logisch 1 gesetzt ist. Der Lesezugriff startet dann mit dem Aufladen der beiden Bitlines auf die Hälfte der Betriebsspannung, gefolgt von dem Schalten der Wordline, um beide Zugriffstransistoren durchzuschalten. Als zweiten Schritt werden dann die jeweiligen Werte von Q und <span style="text-decoration:overline;">Q</span> auf die Bitlines übertragen, d. h. BL bleibt aufgeladen und <span style="text-decoration:overline;">BL</span> wird über M1 und M5 zu einer logischen 0 entladen (M1 ist aktiviert, weil Q auf eine logische 1 gesetzt ist). BL wird durch M4 und M6 über die Versorgungsspannung auf der logischen 1 geladen. Wenn der Speicherzustand vorher 0 gewesen wäre, wäre das Verhalten entsprechend entgegengesetzt. Der Unterschied zwischen BL und <span style="text-decoration:overline;">BL</span> kann dann durch einen Leseverstärker ausgelesen werden. </p> <div class="mw-heading mw-heading3"><h3 id="Schreibzugriff">Schreibzugriff</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=6" title="Abschnitt bearbeiten: Schreibzugriff" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=6" title="Quellcode des Abschnitts bearbeiten: Schreibzugriff"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Der Schreibzugriff beginnt damit, dass der zu schreibende Wert auf die Bitlines gelegt wird. Wenn wir also eine 0 schreiben wollen, wird BL auf 0 und <span style="text-decoration:overline;">BL</span> auf 1 gesetzt. Beim Schreiben einer 1 werden die beiden Werte vertauscht. In der Folge wird dann die Wordline geschaltet, so dass der Wert in die Speicherzelle geschrieben wird. Dies funktioniert, weil die relativ schwachen Transistoren, die die Inverter bilden, durch die relativ starken Bitlines überschrieben werden können. Eine entsprechende Größenauslegung der Transistoren ist bei der Herstellung notwendig, damit das Überschreiben einwandfrei funktioniert. </p> <div class="mw-heading mw-heading2"><h2 id="Schnittstellen">Schnittstellen</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=7" title="Abschnitt bearbeiten: Schnittstellen" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=7" title="Quellcode des Abschnitts bearbeiten: Schnittstellen"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>SRAMs werden mit unterschiedlichen Schnittstellen angeboten. Als diskretes Bauelement, primär für den direkten Anschluss an <a href="/wiki/Mikrocontroller" title="Mikrocontroller">Mikrocontrollern</a>, kommen parallele asynchrone Busschnittstellen zur Anwendung. Merkmal ist, dass der Zugriff auf den Speicher ohne <a href="/wiki/Taktsignal" title="Taktsignal">Taktsignal</a> erfolgt. Die Zugriffszeit pro Speicherzelle richtet sich nach der <a href="/wiki/Latenzzeit_(Technik)" class="mw-redirect" title="Latenzzeit (Technik)">Laufzeit</a> und liegt im Bereich von 5 ns bis zu knapp 100 ns. Darüber hinaus gibt es synchrone SRAMs, bei welchen der Zugriff synchron zu einem Taktsignal erfolgt. Im Regelfall ist der Durchsatz von synchronen SRAMs höher als bei asynchronen SRAMs, da bei synchronen Schnittstellen die Möglichkeit besteht, mittels einer <a href="/wiki/Pipeline_(Prozessor)" title="Pipeline (Prozessor)">Pipeline</a> die Adressen zu den Daten definiert zeitlich zu versetzen. Dies bringt vor allem bei sequenziellen Speicherzugriffen Geschwindigkeitsvorteile. Ein Beispiel von synchronen SRAMs sind die sogenannten „ZBT-SRAMs“ (engl. <span lang="en"><i>zero-bus-turnaround SRAM</i></span>), welche bei schnellen <a href="/wiki/Grafikspeicher" title="Grafikspeicher">Grafikspeichern</a> Anwendung finden.<sup id="cite_ref-8" class="reference"><a href="#cite_note-8"><span class="cite-bracket">[</span>8<span class="cite-bracket">]</span></a></sup> Für den Einsatz in Kombination mit DDR- und „Quad“-Speicher gibt es auch SRAMs, die entsprechend mehr Daten auf beiden Flanken des Taktsignals übertragen; hierbei werden Größen bis 144 <a href="/wiki/Bin%C3%A4rpr%C3%A4fix" title="Binärpräfix">Mibit</a> (in der Organisation 8 Mi×18) bei einer Taktfrequenz von 1066 MHz erreicht. </p> <div class="mw-heading mw-heading2"><h2 id="Anwendungen">Anwendungen</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=8" title="Abschnitt bearbeiten: Anwendungen" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=8" title="Quellcode des Abschnitts bearbeiten: Anwendungen"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>SRAMs finden als schneller Speicher mit vergleichsweise kleiner Datenkapazität überall dort Anwendung, wo der Dateninhalt schnell im Zugriff sein muss, wie beispielsweise in <a href="/wiki/Prozessor" title="Prozessor">Prozessoren</a> als <a href="/wiki/Cache" title="Cache">Cache</a> und auf <a href="/wiki/Digitalsignal" title="Digitalsignal">digitalen</a> oder <a href="/wiki/Mixed-Signal" title="Mixed-Signal">Mixed-Signal</a>-<a href="/wiki/Integrierter_Schaltkreis" title="Integrierter Schaltkreis">ICs</a> wie <a href="/wiki/Field_Programmable_Gate_Array" title="Field Programmable Gate Array">FPGAs</a> als lokaler Speicher auf dem Chip. </p><p>Etwa in den 1980er Jahren benötigten die <a href="/wiki/Mikroprozessor" title="Mikroprozessor">Mikroprozessoren</a> SRAMs als externen Arbeitsspeicher, da sie keinen integrierten Arbeitsspeicher hatten. Die typischen Bausteine waren <a href="/wiki/5101" title="5101">5101</a> (noch zu vier Bit organisiert, <a href="/wiki/Nibble" title="Nibble">Nibble</a> genannt), <a href="/wiki/6116" title="6116">6116</a> und <a href="/wiki/6264" title="6264">6264</a>. </p><p>Weiterhin wird SRAM in Geräten eingesetzt, bei denen der Dateninhalt ohne dauerhafte Stromversorgung bis zu einigen Jahren gesichert werden soll. Da der Stromverbrauch im statischen Zustand (keine Speicherzugriffe) im Bereich einiger <a href="/wiki/Ampere" title="Ampere">nA</a> liegt, genügt eine kleine Pufferbatterie (u. U. auch ein Kondensator), um die nötige Versorgungsspannung bereitzustellen, beispielsweise beim <a href="/wiki/CMOS-RAM" title="CMOS-RAM">CMOS-RAM</a> zur Speicherung von BIOS-Einstellungen in handelsüblichen PCs. In diesem Anwendungsbereich stellt das SRAM in Kombination mit einer meist in Form einer <a href="/wiki/Lithiumbatterie" title="Lithiumbatterie">Lithiumbatterie</a> ausgeführten Pufferbatterie eine spezielle Form von <a href="/wiki/NVRAM" title="NVRAM">NVRAM</a> (engl. <span lang="en"><i>non-volatile random-access memory</i></span>, nicht-flüchtiger RAM) dar. Die Batterie kann in das Chipgehäuse des Speicherbausteins integriert sein.<sup id="cite_ref-9" class="reference"><a href="#cite_note-9"><span class="cite-bracket">[</span>9<span class="cite-bracket">]</span></a></sup> </p> <div class="mw-heading mw-heading2"><h2 id="Literatur">Literatur</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=9" title="Abschnitt bearbeiten: Literatur" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=9" title="Quellcode des Abschnitts bearbeiten: Literatur"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <ul><li>Ulrich Tietze, Christoph Schenk: <cite style="font-style:italic">Halbleiter-Schaltungstechnik</cite>. 12. Auflage. Springer, Berlin 2002, <a href="/wiki/Spezial:ISBN-Suche/3540428496" class="internal mw-magiclink-isbn">ISBN 3-540-42849-6</a>, <i>Statische RAMs</i>, <span style="white-space:nowrap">S.<span style="display:inline-block;width:.2em"> </span>713<span style="display:inline-block;width:.2em"> </span>ff</span>.<span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Abookitem&rfr_id=info:sid/de.wikipedia.org:Static+random-access+memory&rft.atitle=Statische+RAMs&rft.au=Ulrich+Tietze%2C+Christoph+Schenk&rft.btitle=Halbleiter-Schaltungstechnik&rft.date=2002&rft.edition=12&rft.genre=bookitem&rft.isbn=3540428496&rft.pages=713+ff&rft.place=Berlin&rft.pub=Springer" style="display:none"> </span></li> <li>Jörg Schulze: <cite style="font-style:italic">Konzepte siliziumbasierter MOS-Bauelemente</cite>. Springer, Berlin 2005, <a href="/wiki/Spezial:ISBN-Suche/3540234373" class="internal mw-magiclink-isbn">ISBN 3-540-23437-3</a>, <span style="white-space:nowrap">S.<span style="display:inline-block;width:.2em"> </span>66–67, 297–314</span>.<span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Abook&rfr_id=info:sid/de.wikipedia.org:Static+random-access+memory&rft.au=J%C3%B6rg+Schulze&rft.btitle=Konzepte+siliziumbasierter+MOS-Bauelemente&rft.date=2005&rft.genre=book&rft.isbn=3540234373&rft.pages=66-67%2C+297-314&rft.place=Berlin&rft.pub=Springer" style="display:none"> </span></li></ul> <div class="mw-heading mw-heading2"><h2 id="Einzelnachweise">Einzelnachweise</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Static_random-access_memory&veaction=edit&section=10" title="Abschnitt bearbeiten: Einzelnachweise" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Static_random-access_memory&action=edit&section=10" title="Quellcode des Abschnitts bearbeiten: Einzelnachweise"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <ol class="references"> <li id="cite_note-1"><span class="mw-cite-backlink"><a href="#cite_ref-1">↑</a></span> <span class="reference-text"><span class="cite">Patent  <a rel="nofollow" class="external text" href="https://worldwide.espacenet.com/publicationDetails/biblio?locale=de_EP&CC=US&NR=3562721A&FT=D&KC=A">US3562721A</a>: <i>Solid State Switching and Memory Apparatus.</i> Angemeldet am <span style="white-space:nowrap;">5. März 1963</span>, veröffentlicht am <span style="white-space:nowrap;">9. Februar 1971</span>, Anmelder: Fairchild Camera and Instrument Corporation, Erfinder: Robert H. Norman.</span><span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Apatent&rft_id=US3562721A&rft.applcc=US&rft.title=Solid+State+Switching+and+Memory+Apparatus&rft.inventor=Robert+H.+Norman&rft.assignee=Fairchild+Camera+and+Instrument+Corporation&rft.appldate=1963-03-05&rft.pubdate=1971-02-09">‌</span></span> </li> <li id="cite_note-CHM-1970-2"><span class="mw-cite-backlink">↑ <sup><a href="#cite_ref-CHM-1970_2-0">a</a></sup> <sup><a href="#cite_ref-CHM-1970_2-1">b</a></sup></span> <span class="reference-text"><span class="cite"><a rel="nofollow" class="external text" href="https://www.computerhistory.org/siliconengine/mos-dynamic-ram-competes-with-magnetic-core-memory-on-price/"><i>1970: MOS Dynamic RAM Competes with Magnetic Core Memory on Price.</i></a> (pdf) Computer History Museum,<span class="Abrufdatum"> abgerufen am 12. November 2023</span> (englisch).</span><span style="display: none;" class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Adc&rfr_id=info%3Asid%2Fde.wikipedia.org%3AStatic+random-access+memory&rft.title=1970%3A+MOS+Dynamic+RAM+Competes+with+Magnetic+Core+Memory+on+Price&rft.description=1970%3A+MOS+Dynamic+RAM+Competes+with+Magnetic+Core+Memory+on+Price&rft.identifier=https%3A%2F%2Fwww.computerhistory.org%2Fsiliconengine%2Fmos-dynamic-ram-competes-with-magnetic-core-memory-on-price%2F&rft.publisher=Computer+History+Museum&rft.language=en"> </span></span> </li> <li id="cite_note-Intel-1976-3"><span class="mw-cite-backlink">↑ <sup><a href="#cite_ref-Intel-1976_3-0">a</a></sup> <sup><a href="#cite_ref-Intel-1976_3-1">b</a></sup> <sup><a href="#cite_ref-Intel-1976_3-2">c</a></sup> <sup><a href="#cite_ref-Intel-1976_3-3">d</a></sup></span> <span class="reference-text"><span class="cite"><a rel="nofollow" class="external text" href="http://bitsavers.informatik.uni-stuttgart.de/components/intel/_dataBooks/1976_Intel_Data_Catalog.pdf"><i>intel data catalog 1976.</i></a> (pdf)<span class="Abrufdatum"> Abgerufen am 12. November 2023</span> (englisch).</span><span style="display: none;" class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Adc&rfr_id=info%3Asid%2Fde.wikipedia.org%3AStatic+random-access+memory&rft.title=intel+data+catalog+1976&rft.description=intel+data+catalog+1976&rft.identifier=http%3A%2F%2Fbitsavers.informatik.uni-stuttgart.de%2Fcomponents%2Fintel%2F_dataBooks%2F1976_Intel_Data_Catalog.pdf&rft.language=en"> </span></span> </li> <li id="cite_note-4"><span class="mw-cite-backlink"><a href="#cite_ref-4">↑</a></span> <span class="reference-text"><style data-mw-deduplicate="TemplateStyles:r246413598">.mw-parser-output .webarchiv-memento{color:var(--color-base,#202122)!important}</style><a rel="nofollow" class="external text" href="https://web.archive.org/web/20100326112759/http://www.itrs.net/Links/2007ITRS/2007_Chapters/2007_ERD.pdf">The International Technology Roadmap for Semiconductors 2007 – Emerging Research Devices</a> (<a href="/wiki/Web-Archivierung#Begrifflichkeiten" title="Web-Archivierung"><span class="webarchiv-memento">Memento</span></a> vom 26. März 2010 im <i><a href="/wiki/Internet_Archive" title="Internet Archive">Internet Archive</a></i>), Seite 7 (engl., PDF; 1,1 MB)</span> </li> <li id="cite_note-5"><span class="mw-cite-backlink"><a href="#cite_ref-5">↑</a></span> <span class="reference-text"><link rel="mw-deduplicated-inline-style" href="mw-data:TemplateStyles:r246413598"><a rel="nofollow" class="external text" href="https://web.archive.org/web/20090306164237/http://www.itrs.net/Links/2007ITRS/2007_Chapters/2007_SystemDrivers.pdf">The International Technology Roadmap for Semiconductors 2007 – System Drivers</a> (<a href="/wiki/Web-Archivierung#Begrifflichkeiten" title="Web-Archivierung"><span class="webarchiv-memento">Memento</span></a> vom 6. März 2009 im <i><a href="/wiki/Internet_Archive" title="Internet Archive">Internet Archive</a></i>) (engl., PDF; 603 kB)</span> </li> <li id="cite_note-6"><span class="mw-cite-backlink"><a href="#cite_ref-6">↑</a></span> <span class="reference-text">L. Chang u. a.: <cite style="font-style:italic">Stable SRAM cell design for the 32 nm node and beyond</cite>. In: <cite style="font-style:italic">2005 Symposium on VLSI Technology, 2005. Digest of Technical Papers</cite>. 2005, <span style="white-space:nowrap">S.<span style="display:inline-block;width:.2em"> </span>128–129</span>, <a href="/wiki/Digital_Object_Identifier" title="Digital Object Identifier">doi</a>:<span class="uri-handle" style="white-space:nowrap"><a rel="nofollow" class="external text" href="https://doi.org/10.1109/.2005.1469239">10.1109/.2005.1469239</a></span> (<a rel="nofollow" class="external text" href="http://chips.ece.iisc.ernet.in/images/8/81/2005_VLSI_Symp_Chang_32nm_SRAM.pdf">PDF</a>).<span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Abook&rfr_id=info:sid/de.wikipedia.org:Static+random-access+memory&rft.atitle=Stable+SRAM+cell+design+for+the+32+nm+node+and+beyond&rft.au=L.+Chang+u.+a.&rft.btitle=2005+Symposium+on+VLSI+Technology%2C+2005.+Digest+of+Technical+Papers&rft.date=2005&rft.doi=10.1109%2F.2005.1469239&rft.genre=book&rft.pages=128-129" style="display:none"> </span></span> </li> <li id="cite_note-7"><span class="mw-cite-backlink"><a href="#cite_ref-7">↑</a></span> <span class="reference-text"><span class="cite">Forrest Brewer: <a rel="nofollow" class="external text" href="http://bears.ece.ucsb.edu/class/ece224a/Lecture12sram.pdf"><i>Array Structured Memories.</i></a> (PDF; 2,3 MB) In: <i>VLSI Project Design, ECE 224A – Spring 2011.</i><span class="Abrufdatum"> Abgerufen am 1. April 2013</span> (Vortragsfolien).</span><span style="display: none;" class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Adc&rfr_id=info%3Asid%2Fde.wikipedia.org%3AStatic+random-access+memory&rft.title=Array+Structured+Memories&rft.description=Array+Structured+Memories&rft.identifier=http%3A%2F%2Fbears.ece.ucsb.edu%2Fclass%2Fece224a%2FLecture12sram.pdf&rft.creator=Forrest+Brewer&rft.date="> </span></span> </li> <li id="cite_note-8"><span class="mw-cite-backlink"><a href="#cite_ref-8">↑</a></span> <span class="reference-text"><span class="cite"><a rel="nofollow" class="external text" href="https://www.renesas.com/eu/en/products/memory-logic/srams/zero-bus-turnaround-zbt/71t75602-25v-512k-x-36-zbt-synchronous-25v-io-pipeline-sram"><i>71T75602 – 2.5V 512K X 36 ZBT Synchronous 2.5V I/O PipeLine SRAM.</i></a> Renesas,<span class="Abrufdatum"> abgerufen am 9. Januar 2022</span> (englisch, Datenblatt eines synchronen ZBT-SRAMs mit 512 Ki × 36).</span><span style="display: none;" class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Adc&rfr_id=info%3Asid%2Fde.wikipedia.org%3AStatic+random-access+memory&rft.title=71T75602+%E2%80%93+2.5V+512K+X+36+ZBT+Synchronous+2.5V+I%2FO+PipeLine+SRAM&rft.description=71T75602+%E2%80%93+2.5V+512K+X+36+ZBT+Synchronous+2.5V+I%2FO+PipeLine+SRAM&rft.identifier=https%3A%2F%2Fwww.renesas.com%2Feu%2Fen%2Fproducts%2Fmemory-logic%2Fsrams%2Fzero-bus-turnaround-zbt%2F71t75602-25v-512k-x-36-zbt-synchronous-25v-io-pipeline-sram&rft.publisher=Renesas&rft.language=en"> </span></span> </li> <li id="cite_note-9"><span class="mw-cite-backlink"><a href="#cite_ref-9">↑</a></span> <span class="reference-text"><link rel="mw-deduplicated-inline-style" href="mw-data:TemplateStyles:r246413598"><a rel="nofollow" class="external text" href="https://web.archive.org/web/20100101025740/http://datasheets.maxim-ic.com/en/ds/DS2030W.pdf">Datenblatt</a> (<a href="/wiki/Web-Archivierung#Begrifflichkeiten" title="Web-Archivierung"><span class="webarchiv-memento">Memento</span></a> vom 1. Januar 2010 im <i><a href="/wiki/Internet_Archive" title="Internet Archive">Internet Archive</a></i>) (PDF; 178 kB) eines NV-SRAM. (DS2030 mit 32 Ki × 8 mit integrierter Pufferbatterie) (englisch)</span> </li> </ol> <style data-mw-deduplicate="TemplateStyles:r248673343">.mw-parser-output div.NavFrame{border-width:1px;border-style:solid;border-left-color:var(--dewiki-rahmenfarbe1);border-right-color:var(--dewiki-rahmenfarbe1);border-top-color:var(--dewiki-rahmenfarbe1);border-bottom-color:var(--dewiki-rahmenfarbe1);clear:both;font-size:95%;margin-top:1.5em;min-height:0;padding:2px;text-align:center}.mw-parser-output div.NavPic{float:left;padding:2px}.mw-parser-output div.NavHead{background-color:var(--dewiki-hintergrundfarbe5);font-weight:bold}.mw-parser-output div.NavFrame:after{clear:both;content:"";display:block}.mw-parser-output div.NavFrame+div.NavFrame,.mw-parser-output div.NavFrame+link+div.NavFrame,.mw-parser-output div.NavFrame+style+div.NavFrame{margin-top:-1px}.mw-parser-output .NavToggle{float:right;font-size:x-small}@media screen{html.skin-theme-clientpref-night .mw-parser-output .NavPic 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title="Programmierbare logische Schaltung">Programmierbare Logik</a></div><div class="NavContent" style="clear:left;"> <table class="wikitable erw-nav-zebra" style="width:100%;margin:0;text-align:left;font-size:95%;margin-top:.1em;margin-bottom:.0em;"> <tbody><tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 2px solid #FFF;padding: 0 1em;"><b>Konzepte</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/wiki/Anwendungsspezifische_integrierte_Schaltung" title="Anwendungsspezifische integrierte Schaltung">ASIC</a> • <a href="/wiki/System-on-a-Chip" title="System-on-a-Chip">SoC</a> • <a href="/wiki/Field_Programmable_Gate_Array" title="Field Programmable Gate Array">FPGA</a> (<a href="/wiki/Configurable_Logic_Block" title="Configurable Logic Block">CLB</a>) • <a href="/wiki/Complex_Programmable_Logic_Device" title="Complex Programmable Logic Device">CPLD</a> • <a href="/wiki/Erasable_Programmable_Logic_Device" title="Erasable Programmable Logic Device">EPLD</a> • <a href="/wiki/Programmierbare_logische_Anordnung" title="Programmierbare logische Anordnung">PLA</a> • <a href="/wiki/Programmable_Array_Logic" title="Programmable Array Logic">PAL</a> • <a href="/wiki/Programmable_Array_Logic" title="Programmable Array Logic">GAL</a> • <a href="/wiki/PSoC" title="PSoC">PSoC</a> • <a href="/wiki/Reconfigurable_Computing" title="Reconfigurable Computing">Reconfigurable Computing</a> (<a href="/wiki/Xputer" title="Xputer">Xputer</a>) • <a href="/w/index.php?title=Soft_microprocessor&action=edit&redlink=1" class="new" title="Soft microprocessor (Seite nicht vorhanden)">Soft microprocessor</a> • <a href="/w/index.php?title=Circuit_underutilization&action=edit&redlink=1" class="new" title="Circuit underutilization (Seite nicht vorhanden)">Circuit underutilization</a> • <a href="/w/index.php?title=High-level_synthesis&action=edit&redlink=1" class="new" title="High-level synthesis (Seite nicht vorhanden)">High-level synthesis</a> • <a href="/wiki/Hardwarebeschleunigung" title="Hardwarebeschleunigung">Hardwarebeschleunigung</a> </p> </td></tr> <tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 2px solid #FFF;padding: 0 1em;"><b>Programmiertechnik</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/wiki/Gate-Array" title="Gate-Array">Masken-programmiert</a> • <a href="/wiki/Antifuse-Technologie" title="Antifuse-Technologie">Antifuse</a> • <a href="/wiki/Erasable_Programmable_Read-Only_Memory" title="Erasable Programmable Read-Only Memory">EPROM</a> • <a href="/wiki/Electrically_Erasable_Programmable_Read-Only_Memory" title="Electrically Erasable Programmable Read-Only Memory">E²PROM</a> • <a href="/wiki/Flash-Speicher" title="Flash-Speicher">Flash</a> • <a class="mw-selflink selflink">SRAM</a> </p> </td></tr> <tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 2px solid #FFF;padding: 0 1em;"><b><a href="/wiki/Hardwarebeschreibungssprache" title="Hardwarebeschreibungssprache">Programmiersprachen</a></b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/wiki/Verilog" title="Verilog">Verilog</a> (<a href="/w/index.php?title=Verilog-A&action=edit&redlink=1" class="new" title="Verilog-A (Seite nicht vorhanden)">A</a>, <a href="/w/index.php?title=Verilog-AMS&action=edit&redlink=1" class="new" title="Verilog-AMS (Seite nicht vorhanden)">AMS</a>) • <a href="/wiki/Very_High_Speed_Integrated_Circuit_Hardware_Description_Language" title="Very High Speed Integrated Circuit Hardware Description Language">VHDL</a> (<a href="/wiki/Very_High_Speed_Integrated_Circuit_Hardware_Description_Language" title="Very High Speed Integrated Circuit Hardware Description Language">AMS</a>, <a href="/w/index.php?title=VHDL-VITAL&action=edit&redlink=1" class="new" title="VHDL-VITAL (Seite nicht vorhanden)">VITAL</a>) • <a href="/wiki/SystemVerilog" title="SystemVerilog">SystemVerilog</a> (<a href="/w/index.php?title=SystemVerilog_DPI&action=edit&redlink=1" class="new" title="SystemVerilog DPI (Seite nicht vorhanden)">DPI</a>) • <a href="/wiki/SystemC" title="SystemC">SystemC</a> • <a href="/w/index.php?title=Altera_Hardware_Description_Language&action=edit&redlink=1" class="new" title="Altera Hardware Description Language (Seite nicht vorhanden)">AHDL</a> • <a href="/w/index.php?title=Handel-C&action=edit&redlink=1" class="new" title="Handel-C (Seite nicht vorhanden)">Handel-C</a> • <a href="/wiki/Property_Specification_Language" title="Property Specification Language">PSL</a> • <a href="/w/index.php?title=Unified_Power_Format&action=edit&redlink=1" class="new" title="Unified Power Format (Seite nicht vorhanden)">UPF</a> • <a href="/wiki/PALASM" title="PALASM">PALASM</a> • <a href="/wiki/Advanced_Boolean_Equation_Language" title="Advanced Boolean Equation Language">ABEL</a> • <a href="/w/index.php?title=CUPL_(Programmiersprache)&action=edit&redlink=1" class="new" title="CUPL (Programmiersprache) (Seite nicht vorhanden)">CUPL</a> • <a href="/w/index.php?title=OpenVera&action=edit&redlink=1" class="new" title="OpenVera (Seite nicht vorhanden)">OpenVera</a> • <a href="/w/index.php?title=C_to_HDL&action=edit&redlink=1" class="new" title="C to HDL (Seite nicht vorhanden)">C to HDL</a> • <a href="/w/index.php?title=Flow_to_HDL&action=edit&redlink=1" class="new" title="Flow to HDL (Seite nicht vorhanden)">Flow to HDL</a> • <a href="/w/index.php?title=MyHDL&action=edit&redlink=1" class="new" title="MyHDL (Seite nicht vorhanden)">MyHDL</a> • <a href="/wiki/Just_Another_Hardware_Definition_Language" title="Just Another Hardware Definition Language">JHDL</a> • <a href="/w/index.php?title=ELLA_(programming_language)&action=edit&redlink=1" class="new" title="ELLA (programming language) (Seite nicht vorhanden)">ELLA</a> </p> </td></tr> <tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 2px solid #FFF;padding: 0 1em;"><b>Hersteller</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/w/index.php?title=Accellera&action=edit&redlink=1" class="new" title="Accellera (Seite nicht vorhanden)">Accellera</a> • <a href="/w/index.php?title=Achronix&action=edit&redlink=1" class="new" title="Achronix (Seite nicht vorhanden)">Achronix</a> • <a href="/wiki/Altera" title="Altera">Altera</a> (<a href="/wiki/Intel" title="Intel">Intel</a>) • <a href="/wiki/AMD" title="AMD">AMD</a> (<a href="/wiki/Xilinx" title="Xilinx">Xilinx</a>) • <a href="/w/index.php?title=Aldec&action=edit&redlink=1" class="new" title="Aldec (Seite nicht vorhanden)">Aldec</a> • <a href="/wiki/Bitmain" title="Bitmain">Bitmain</a> • <a href="/wiki/Cadence_Design_Systems" title="Cadence Design Systems">Cadence</a> • <a href="/w/index.php?title=Duolog&action=edit&redlink=1" class="new" title="Duolog (Seite nicht vorhanden)">Duolog</a> • <a href="/w/index.php?title=Forte_Design_Systems&action=edit&redlink=1" class="new" title="Forte Design Systems (Seite nicht vorhanden)">Forte</a> • <a href="/wiki/Infineon" title="Infineon">Infineon</a> (<a href="/wiki/Cypress_Semiconductor_Corporation" title="Cypress Semiconductor Corporation">Cypress</a>) • <a href="/wiki/Lattice_Semiconductor_Corporation" title="Lattice Semiconductor Corporation">Lattice</a> • <a href="/wiki/Mentor_Graphics" title="Mentor Graphics">Mentor Graphics</a> • <a href="/wiki/Microchip_Technology" title="Microchip Technology">Microchip Technology</a> • <a href="/wiki/Signetics" title="Signetics">Signetics</a> • <a href="/wiki/Synopsys" title="Synopsys">Synopsys</a> (<a href="/w/index.php?title=Magma_Design_Automation&action=edit&redlink=1" class="new" title="Magma Design Automation (Seite nicht vorhanden)">Magma</a>, <a href="/w/index.php?title=Virage_Logic&action=edit&redlink=1" class="new" title="Virage Logic (Seite nicht vorhanden)">Virage Logic</a>) • <a href="/wiki/Texas_Instruments" title="Texas Instruments">Texas Instruments</a> • <a href="/w/index.php?title=Tabula_(company)&action=edit&redlink=1" class="new" title="Tabula (company) (Seite nicht vorhanden)">Tabula</a> • </p> </td></tr> <tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 1px solid #FFF;padding: 0 1em;"><b>Produkte</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0;"> <div class="Broken-NavContent"> <table class="wikitable erw-nav-zebra" style="width:100%;margin:0;text-align:left;border-collapse:collapse;"> <tbody><tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 2px solid #FFF;padding: 0 1em;"><b>Hardware</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/wiki/Stratix" class="mw-redirect" title="Stratix">Stratix</a> • <a href="/wiki/Altera#Produkte" title="Altera">Agilex</a> • <a href="/wiki/Altera#Produkte" title="Altera">Cyclone</a> • <a href="/wiki/Altera#Produkte" title="Altera">Arria</a> • <a href="/wiki/Altera#Produkte" title="Altera">Max</a> • <a href="/w/index.php?title=Kintex&action=edit&redlink=1" class="new" title="Kintex (Seite nicht vorhanden)">Kintex</a> • <a href="/w/index.php?title=Zynq&action=edit&redlink=1" class="new" title="Zynq (Seite nicht vorhanden)">Zynq</a> • <a href="/w/index.php?title=Virtex_(FPGA)&action=edit&redlink=1" class="new" title="Virtex (FPGA) (Seite nicht vorhanden)">Virtex</a> • <a href="/w/index.php?title=ICE_(FPGA)&action=edit&redlink=1" class="new" title="ICE (FPGA) (Seite nicht vorhanden)">iCE</a> </p> </td></tr> <tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 2px solid #FFF;padding: 0 1em;"><b>Software</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/wiki/Altera#Quartus" title="Altera">Intel Quartus Prime</a> • <a href="/w/index.php?title=Xilinx_ISE&action=edit&redlink=1" class="new" title="Xilinx ISE (Seite nicht vorhanden)">Xilinx ISE</a> • <a href="/w/index.php?title=Xilinx_Vivado&action=edit&redlink=1" class="new" title="Xilinx Vivado (Seite nicht vorhanden)">Xilinx Vivado</a> • <a href="/w/index.php?title=ModelSim&action=edit&redlink=1" class="new" title="ModelSim (Seite nicht vorhanden)">ModelSim</a> • <a href="/w/index.php?title=Verilog-to-Routing&action=edit&redlink=1" class="new" title="Verilog-to-Routing (Seite nicht vorhanden)">VTR</a> </p> </td></tr> <tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 1px solid #FFF;padding: 0 1em;"><b>IP</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <div class="Broken-NavContent"> <table class="wikitable erw-nav-zebra" style="width:100%;margin:0;text-align:left;border-collapse:collapse;"> <tbody><tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 2px solid #FFF;padding: 0 1em;"><b>Proprietär</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/w/index.php?title=Argonaut_RISC_Core&action=edit&redlink=1" class="new" title="Argonaut RISC Core (Seite nicht vorhanden)">ARC</a> • <a href="/wiki/ARM_Cortex-M" class="mw-redirect" title="ARM Cortex-M">ARM Cortex-M</a> • <a href="/wiki/PowerPC" title="PowerPC">PowerPC</a> • <a href="/wiki/LEON" title="LEON">LEON</a> • <a href="/wiki/Lattice_Semiconductor_Corporation" title="Lattice Semiconductor Corporation">LatticeMico8</a> • <a href="/wiki/MicroBlaze" title="MicroBlaze">MicroBlaze</a> • <a href="/wiki/PicoBlaze" title="PicoBlaze">PicoBlaze</a> • <a href="/wiki/Altera_Nios" title="Altera Nios">Nios</a> • <a href="/wiki/Altera_Nios" title="Altera Nios">Nios II</a> </p> </td></tr> <tr> <td class="erw-nav-gruppe" style="color:#202122;white-space: nowrap;text-align: right;border: 1px solid transparent;border-top: 1px solid #FFF;border-bottom: 1px solid #FFF;padding: 0 1em;"><b>Open-Source</b> </td> <td class="hlist" style="text-align: left;border-left: 2px solid #fdfdfd;width: 100%;margin: .4em 0;border-color: #fdfdfd;padding: 0 .25em;"> <p><a href="/wiki/Java-Prozessor" title="Java-Prozessor">JOP</a> • <a href="/wiki/Lattice_Semiconductor_Corporation" title="Lattice Semiconductor Corporation">LatticeMico32</a> • <a href="/w/index.php?title=OpenCores&action=edit&redlink=1" class="new" title="OpenCores (Seite nicht vorhanden)">OpenCores</a> • <a href="/wiki/OpenRISC" title="OpenRISC">OpenRISC</a> • <a href="/wiki/RISC-V" title="RISC-V">RISC-V</a> • <a href="/w/index.php?title=Zet_(Hardware)&action=edit&redlink=1" class="new" title="Zet (Hardware) (Seite nicht vorhanden)">Zet</a> </p> </td></tr> </tbody></table></div> </td></tr> </tbody></table></div> </td></tr> </tbody></table></div></div> <div class="hintergrundfarbe1 rahmenfarbe1 navigation-not-searchable normdaten-typ-s" style="border-style: solid; border-width: 1px; clear: left; margin-bottom:1em; margin-top:1em; padding: 0.25em; overflow: hidden; word-break: break-word; word-wrap: break-word;" id="normdaten"> <div style="display: table-cell; vertical-align: middle; width: 100%;"> <div> Normdaten (Sachbegriff): <a href="/wiki/Gemeinsame_Normdatei" title="Gemeinsame Normdatei">GND</a>: <span class="plainlinks-print"><a rel="nofollow" class="external text" href="https://d-nb.info/gnd/4381052-4">4381052-4</a></span> <span class="noprint">(<a rel="nofollow" class="external text" href="https://lobid.org/gnd/4381052-4">lobid</a>, <a rel="nofollow" class="external text" href="https://swb.bsz-bw.de/DB=2.104/SET=1/TTL=1/CMD?retrace=0&trm_old=&ACT=SRCHA&IKT=2999&SRT=RLV&TRM=4381052-4">OGND</a><span class="metadata">, <a rel="nofollow" class="external text" href="https://prometheus.lmu.de/gnd/4381052-4">AKS</a></span>)</span> <span class="metadata"></span></div> </div></div></div><noscript><img src="https://login.wikimedia.org/wiki/Special:CentralAutoLogin/start?type=1x1" alt="" width="1" height="1" style="border: none; position: absolute;"></noscript> <div class="printfooter" data-nosnippet="">Abgerufen von „<a dir="ltr" href="https://de.wikipedia.org/w/index.php?title=Static_random-access_memory&oldid=248138078">https://de.wikipedia.org/w/index.php?title=Static_random-access_memory&oldid=248138078</a>“</div></div> <div id="catlinks" class="catlinks" data-mw="interface"><div id="mw-normal-catlinks" class="mw-normal-catlinks"><a href="/wiki/Wikipedia:Kategorien" title="Wikipedia:Kategorien">Kategorien</a>: <ul><li><a href="/wiki/Kategorie:Speicherbaustein" title="Kategorie:Speicherbaustein">Speicherbaustein</a></li><li><a href="/wiki/Kategorie:Hardware" title="Kategorie:Hardware">Hardware</a></li><li><a href="/wiki/Kategorie:Halbleiterspeichertechnik" title="Kategorie:Halbleiterspeichertechnik">Halbleiterspeichertechnik</a></li></ul></div></div> </div> </div> <div id="mw-navigation"> <h2>Navigationsmenü</h2> <div id="mw-head"> <nav id="p-personal" class="mw-portlet mw-portlet-personal vector-user-menu-legacy vector-menu" aria-labelledby="p-personal-label" > <h3 id="p-personal-label" class="vector-menu-heading " > <span class="vector-menu-heading-label">Meine Werkzeuge</span> </h3> <div class="vector-menu-content"> <ul class="vector-menu-content-list"> <li id="pt-anonuserpage" class="mw-list-item"><span title="Benutzerseite der IP-Adresse, von der aus du Änderungen durchführst">Nicht angemeldet</span></li><li id="pt-anontalk" class="mw-list-item"><a href="/wiki/Spezial:Meine_Diskussionsseite" title="Diskussion über Änderungen von dieser IP-Adresse [n]" accesskey="n"><span>Diskussionsseite</span></a></li><li id="pt-anoncontribs" class="mw-list-item"><a href="/wiki/Spezial:Meine_Beitr%C3%A4ge" title="Eine Liste der Bearbeitungen, die von dieser IP-Adresse gemacht wurden [y]" accesskey="y"><span>Beiträge</span></a></li><li id="pt-createaccount" class="mw-list-item"><a href="/w/index.php?title=Spezial:Benutzerkonto_anlegen&returnto=Static+random-access+memory" title="Wir ermutigen dich dazu, ein Benutzerkonto zu erstellen und dich anzumelden. Es ist jedoch nicht zwingend erforderlich."><span>Benutzerkonto erstellen</span></a></li><li id="pt-login" class="mw-list-item"><a href="/w/index.php?title=Spezial:Anmelden&returnto=Static+random-access+memory" title="Anmelden ist zwar keine Pflicht, wird aber gerne gesehen. [o]" accesskey="o"><span>Anmelden</span></a></li> </ul> </div> </nav> <div id="left-navigation"> <nav id="p-namespaces" class="mw-portlet mw-portlet-namespaces vector-menu-tabs vector-menu-tabs-legacy vector-menu" aria-labelledby="p-namespaces-label" > <h3 id="p-namespaces-label" class="vector-menu-heading " > <span class="vector-menu-heading-label">Namensräume</span> </h3> <div class="vector-menu-content"> <ul class="vector-menu-content-list"> <li id="ca-nstab-main" class="selected mw-list-item"><a href="/wiki/Static_random-access_memory" title="Seiteninhalt anzeigen [c]" accesskey="c"><span>Artikel</span></a></li><li id="ca-talk" class="mw-list-item"><a href="/wiki/Diskussion:Static_random-access_memory" rel="discussion" title="Diskussion zum Seiteninhalt [t]" accesskey="t"><span>Diskussion</span></a></li> </ul> </div> </nav> <nav id="p-variants" class="mw-portlet mw-portlet-variants emptyPortlet vector-menu-dropdown vector-menu" aria-labelledby="p-variants-label" > <input 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href="https://ml.wikipedia.org/wiki/%E0%B4%B8%E0%B5%8D%E0%B4%B1%E0%B5%8D%E0%B4%B1%E0%B4%BE%E0%B4%B1%E0%B5%8D%E0%B4%B1%E0%B4%BF%E0%B4%95%E0%B5%8D_%E0%B4%B1%E0%B4%BE%E0%B5%BB%E0%B4%A1%E0%B4%82-%E0%B4%86%E0%B4%95%E0%B5%8D%E0%B4%B8%E0%B4%B8%E0%B5%8D_%E0%B4%AE%E0%B5%86%E0%B4%AE%E0%B5%8D%E0%B4%AE%E0%B4%B1%E0%B4%BF" title="സ്റ്റാറ്റിക് റാൻഡം-ആക്സസ് മെമ്മറി – Malayalam" lang="ml" hreflang="ml" data-title="സ്റ്റാറ്റിക് റാൻഡം-ആക്സസ് മെമ്മറി" data-language-autonym="മലയാളം" data-language-local-name="Malayalam" class="interlanguage-link-target"><span>മലയാളം</span></a></li><li class="interlanguage-link interwiki-nl mw-list-item"><a href="https://nl.wikipedia.org/wiki/Static_random-access_memory" title="Static random-access memory – Niederländisch" lang="nl" hreflang="nl" data-title="Static random-access memory" data-language-autonym="Nederlands" data-language-local-name="Niederländisch" class="interlanguage-link-target"><span>Nederlands</span></a></li><li class="interlanguage-link interwiki-no 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href="https://sr.wikipedia.org/wiki/%D0%A1%D1%82%D0%B0%D1%82%D0%B8%D1%87%D0%BA%D0%B8_RAM" title="Статички RAM – Serbisch" lang="sr" hreflang="sr" data-title="Статички RAM" data-language-autonym="Српски / srpski" data-language-local-name="Serbisch" class="interlanguage-link-target"><span>Српски / srpski</span></a></li><li class="interlanguage-link interwiki-sv mw-list-item"><a href="https://sv.wikipedia.org/wiki/Statiskt_minne" title="Statiskt minne – Schwedisch" lang="sv" hreflang="sv" data-title="Statiskt minne" data-language-autonym="Svenska" data-language-local-name="Schwedisch" class="interlanguage-link-target"><span>Svenska</span></a></li><li class="interlanguage-link interwiki-tr mw-list-item"><a href="https://tr.wikipedia.org/wiki/SRAM" title="SRAM – Türkisch" lang="tr" hreflang="tr" data-title="SRAM" data-language-autonym="Türkçe" data-language-local-name="Türkisch" class="interlanguage-link-target"><span>Türkçe</span></a></li><li class="interlanguage-link interwiki-uk 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