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SDRAM - Wikipedia
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<div class="vector-toc-text"> <span class="vector-toc-numb">3.1</span> <span>制御信号</span> </div> </a> <ul id="toc-制御信号-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-操作" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#操作"> <div class="vector-toc-text"> <span class="vector-toc-numb">3.2</span> <span>操作</span> </div> </a> <ul id="toc-操作-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-コマンドによる対話" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#コマンドによる対話"> <div class="vector-toc-text"> <span class="vector-toc-numb">3.3</span> <span>コマンドによる対話</span> </div> </a> <ul id="toc-コマンドによる対話-sublist" class="vector-toc-list"> <li id="toc-リードバースト割り込み" class="vector-toc-list-item vector-toc-level-3"> <a class="vector-toc-link" href="#リードバースト割り込み"> <div class="vector-toc-text"> <span class="vector-toc-numb">3.3.1</span> <span>リードバースト割り込み</span> </div> </a> <ul id="toc-リードバースト割り込み-sublist" class="vector-toc-list"> </ul> </li> </ul> </li> <li id="toc-バースト要求" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#バースト要求"> <div class="vector-toc-text"> <span class="vector-toc-numb">3.4</span> <span>バースト要求</span> </div> </a> <ul id="toc-バースト要求-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-モードレジスタ" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#モードレジスタ"> <div class="vector-toc-text"> <span class="vector-toc-numb">3.5</span> <span>モードレジスタ</span> </div> </a> <ul id="toc-モードレジスタ-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-オートリフレッシュ" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#オートリフレッシュ"> <div class="vector-toc-text"> <span class="vector-toc-numb">3.6</span> <span>オートリフレッシュ</span> </div> </a> <ul id="toc-オートリフレッシュ-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-省電力モード" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#省電力モード"> <div class="vector-toc-text"> <span class="vector-toc-numb">3.7</span> <span>省電力モード</span> </div> </a> <ul id="toc-省電力モード-sublist" class="vector-toc-list"> </ul> </li> </ul> </li> <li id="toc-世代" class="vector-toc-list-item vector-toc-level-1 vector-toc-list-item-expanded"> <a class="vector-toc-link" href="#世代"> <div class="vector-toc-text"> <span class="vector-toc-numb">4</span> <span>世代</span> </div> </a> <button aria-controls="toc-世代-sublist" class="cdx-button cdx-button--weight-quiet cdx-button--icon-only vector-toc-toggle"> <span class="vector-icon mw-ui-icon-wikimedia-expand"></span> <span>世代サブセクションを切り替えます</span> </button> <ul id="toc-世代-sublist" class="vector-toc-list"> <li id="toc-SDRAM" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#SDRAM"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.1</span> <span>SDRAM</span> </div> </a> <ul id="toc-SDRAM-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-その他の提案" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#その他の提案"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.2</span> <span>その他の提案</span> </div> </a> <ul id="toc-その他の提案-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-DDR_SDRAM" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#DDR_SDRAM"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.3</span> <span>DDR SDRAM</span> </div> </a> <ul id="toc-DDR_SDRAM-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-DDR2_SDRAM" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#DDR2_SDRAM"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.4</span> <span>DDR2 SDRAM</span> </div> </a> <ul id="toc-DDR2_SDRAM-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-DDR3_SDRAM" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#DDR3_SDRAM"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.5</span> <span>DDR3 SDRAM</span> </div> </a> <ul id="toc-DDR3_SDRAM-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-DDR4_SDRAM" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#DDR4_SDRAM"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.6</span> <span>DDR4 SDRAM</span> </div> </a> <ul id="toc-DDR4_SDRAM-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-DDR5_SDRAM" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#DDR5_SDRAM"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.7</span> <span>DDR5 SDRAM</span> </div> </a> <ul id="toc-DDR5_SDRAM-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-仕様比較" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#仕様比較"> <div class="vector-toc-text"> <span class="vector-toc-numb">4.8</span> <span>仕様比較</span> </div> </a> <ul id="toc-仕様比較-sublist" class="vector-toc-list"> </ul> </li> </ul> </li> <li id="toc-成功しなかった後継テクノロジー" class="vector-toc-list-item vector-toc-level-1 vector-toc-list-item-expanded"> <a class="vector-toc-link" href="#成功しなかった後継テクノロジー"> <div class="vector-toc-text"> <span class="vector-toc-numb">5</span> <span>成功しなかった後継テクノロジー</span> </div> </a> <button aria-controls="toc-成功しなかった後継テクノロジー-sublist" class="cdx-button cdx-button--weight-quiet cdx-button--icon-only vector-toc-toggle"> <span class="vector-icon mw-ui-icon-wikimedia-expand"></span> <span>成功しなかった後継テクノロジーサブセクションを切り替えます</span> </button> <ul id="toc-成功しなかった後継テクノロジー-sublist" class="vector-toc-list"> <li id="toc-Rambus_DRAM_(RDRAM)" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#Rambus_DRAM_(RDRAM)"> <div class="vector-toc-text"> <span class="vector-toc-numb">5.1</span> <span>Rambus DRAM (RDRAM)</span> </div> </a> <ul id="toc-Rambus_DRAM_(RDRAM)-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-Synchronous-Link_DRAM_(SLDRAM)" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#Synchronous-Link_DRAM_(SLDRAM)"> <div class="vector-toc-text"> <span class="vector-toc-numb">5.2</span> <span>Synchronous-Link DRAM (SLDRAM)</span> </div> </a> <ul id="toc-Synchronous-Link_DRAM_(SLDRAM)-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-Virtual_Channel_Memory_(VCM)_SDRAM" class="vector-toc-list-item vector-toc-level-2"> <a class="vector-toc-link" href="#Virtual_Channel_Memory_(VCM)_SDRAM"> <div class="vector-toc-text"> <span class="vector-toc-numb">5.3</span> <span>Virtual Channel Memory (VCM) SDRAM</span> </div> </a> <ul id="toc-Virtual_Channel_Memory_(VCM)_SDRAM-sublist" class="vector-toc-list"> </ul> </li> </ul> </li> <li id="toc-セキュリティ" class="vector-toc-list-item vector-toc-level-1 vector-toc-list-item-expanded"> <a class="vector-toc-link" href="#セキュリティ"> <div class="vector-toc-text"> <span class="vector-toc-numb">6</span> <span>セキュリティ</span> </div> </a> <ul id="toc-セキュリティ-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-脚注・出典" class="vector-toc-list-item vector-toc-level-1 vector-toc-list-item-expanded"> <a class="vector-toc-link" href="#脚注・出典"> <div class="vector-toc-text"> <span class="vector-toc-numb">7</span> <span>脚注・出典</span> </div> </a> <ul id="toc-脚注・出典-sublist" class="vector-toc-list"> </ul> </li> <li id="toc-関連項目" class="vector-toc-list-item vector-toc-level-1 vector-toc-list-item-expanded"> <a class="vector-toc-link" href="#関連項目"> <div class="vector-toc-text"> <span class="vector-toc-numb">8</span> <span>関連項目</span> </div> </a> <ul id="toc-関連項目-sublist" class="vector-toc-list"> </ul> </li> </ul> </div> </div> </nav> </div> </div> <div class="mw-content-container"> <main id="content" class="mw-body"> <header class="mw-body-header vector-page-titlebar"> <nav aria-label="目次" class="vector-toc-landmark"> <div id="vector-page-titlebar-toc" class="vector-dropdown vector-page-titlebar-toc vector-button-flush-left" title="目次" > <input type="checkbox" id="vector-page-titlebar-toc-checkbox" role="button" aria-haspopup="true" data-event-name="ui.dropdown-vector-page-titlebar-toc" class="vector-dropdown-checkbox " aria-label="目次の表示・非表示を切り替え" > <label id="vector-page-titlebar-toc-label" for="vector-page-titlebar-toc-checkbox" class="vector-dropdown-label cdx-button cdx-button--fake-button cdx-button--fake-button--enabled cdx-button--weight-quiet cdx-button--icon-only " aria-hidden="true" ><span class="vector-icon mw-ui-icon-listBullet mw-ui-icon-wikimedia-listBullet"></span> <span class="vector-dropdown-label-text">目次の表示・非表示を切り替え</span> </label> <div class="vector-dropdown-content"> <div id="vector-page-titlebar-toc-unpinned-container" class="vector-unpinned-container"> </div> </div> </div> </nav> <h1 id="firstHeading" class="firstHeading mw-first-heading"><span class="mw-page-title-main">SDRAM</span></h1> <div id="p-lang-btn" class="vector-dropdown mw-portlet mw-portlet-lang" > <input type="checkbox" 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href="https://ar.wikipedia.org/wiki/%D8%B0%D8%A7%D9%83%D8%B1%D8%A9_%D9%88%D8%B5%D9%88%D9%84_%D8%B9%D8%B4%D9%88%D8%A7%D8%A6%D9%8A%D8%A9_%D8%AD%D8%B1%D9%83%D9%8A%D8%A9_%D9%85%D8%AA%D8%B2%D8%A7%D9%85%D9%86%D8%A9" title="アラビア語: ذاكرة وصول عشوائية حركية متزامنة" lang="ar" hreflang="ar" data-title="ذاكرة وصول عشوائية حركية متزامنة" data-language-autonym="العربية" data-language-local-name="アラビア語" class="interlanguage-link-target"><span>العربية</span></a></li><li class="interlanguage-link interwiki-az mw-list-item"><a href="https://az.wikipedia.org/wiki/SDRAM" title="アゼルバイジャン語: SDRAM" lang="az" hreflang="az" data-title="SDRAM" data-language-autonym="Azərbaycanca" data-language-local-name="アゼルバイジャン語" class="interlanguage-link-target"><span>Azərbaycanca</span></a></li><li class="interlanguage-link interwiki-ca mw-list-item"><a href="https://ca.wikipedia.org/wiki/SDRAM" title="カタロニア語: SDRAM" lang="ca" hreflang="ca" data-title="SDRAM" data-language-autonym="Català" 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data-language-local-name="フィンランド語" class="interlanguage-link-target"><span>Suomi</span></a></li><li class="interlanguage-link interwiki-fr mw-list-item"><a href="https://fr.wikipedia.org/wiki/SDRAM" title="フランス語: SDRAM" lang="fr" hreflang="fr" data-title="SDRAM" data-language-autonym="Français" data-language-local-name="フランス語" class="interlanguage-link-target"><span>Français</span></a></li><li class="interlanguage-link interwiki-he mw-list-item"><a href="https://he.wikipedia.org/wiki/SDRAM" title="ヘブライ語: SDRAM" lang="he" hreflang="he" data-title="SDRAM" data-language-autonym="עברית" data-language-local-name="ヘブライ語" class="interlanguage-link-target"><span>עברית</span></a></li><li class="interlanguage-link interwiki-hu mw-list-item"><a href="https://hu.wikipedia.org/wiki/SDRAM" title="ハンガリー語: SDRAM" lang="hu" hreflang="hu" data-title="SDRAM" data-language-autonym="Magyar" data-language-local-name="ハンガリー語" class="interlanguage-link-target"><span>Magyar</span></a></li><li class="interlanguage-link interwiki-id mw-list-item"><a href="https://id.wikipedia.org/wiki/SDRAM" title="インドネシア語: SDRAM" lang="id" hreflang="id" data-title="SDRAM" data-language-autonym="Bahasa Indonesia" data-language-local-name="インドネシア語" class="interlanguage-link-target"><span>Bahasa Indonesia</span></a></li><li class="interlanguage-link interwiki-it mw-list-item"><a href="https://it.wikipedia.org/wiki/SDRAM" title="イタリア語: SDRAM" lang="it" hreflang="it" data-title="SDRAM" data-language-autonym="Italiano" data-language-local-name="イタリア語" class="interlanguage-link-target"><span>Italiano</span></a></li><li class="interlanguage-link interwiki-ko mw-list-item"><a href="https://ko.wikipedia.org/wiki/SDRAM" title="韓国語: SDRAM" lang="ko" hreflang="ko" data-title="SDRAM" data-language-autonym="한국어" data-language-local-name="韓国語" class="interlanguage-link-target"><span>한국어</span></a></li><li class="interlanguage-link interwiki-lt mw-list-item"><a href="https://lt.wikipedia.org/wiki/SDRAM" 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interwiki-zh mw-list-item"><a href="https://zh.wikipedia.org/wiki/SDRAM" title="中国語: SDRAM" lang="zh" hreflang="zh" data-title="SDRAM" data-language-autonym="中文" data-language-local-name="中国語" class="interlanguage-link-target"><span>中文</span></a></li> </ul> <div class="after-portlet after-portlet-lang"><span class="wb-langlinks-edit wb-langlinks-link"><a href="https://www.wikidata.org/wiki/Special:EntityPage/Q746478#sitelinks-wikipedia" title="言語間リンクを編集" class="wbc-editpage">リンクを編集</a></span></div> </div> </div> </div> </header> <div class="vector-page-toolbar"> <div class="vector-page-toolbar-container"> <div id="left-navigation"> <nav aria-label="名前空間"> <div id="p-associated-pages" class="vector-menu vector-menu-tabs mw-portlet mw-portlet-associated-pages" > <div class="vector-menu-content"> <ul class="vector-menu-content-list"> <li id="ca-nstab-main" class="selected vector-tab-noicon mw-list-item"><a href="/wiki/SDRAM" title="本文を閲覧[c]" accesskey="c"><span>ページ</span></a></li><li id="ca-talk" class="new vector-tab-noicon mw-list-item"><a href="/w/index.php?title=%E3%83%8E%E3%83%BC%E3%83%88:SDRAM&action=edit&redlink=1" rel="discussion" class="new" title="本文ページについての議論 (存在しないページ)[t]" accesskey="t"><span>ノート</span></a></li> </ul> </div> </div> <div id="vector-variants-dropdown" class="vector-dropdown emptyPortlet" > <input type="checkbox" id="vector-variants-dropdown-checkbox" role="button" aria-haspopup="true" data-event-name="ui.dropdown-vector-variants-dropdown" class="vector-dropdown-checkbox " aria-label="別の言語に切り替える" > <label id="vector-variants-dropdown-label" for="vector-variants-dropdown-checkbox" class="vector-dropdown-label cdx-button cdx-button--fake-button cdx-button--fake-button--enabled cdx-button--weight-quiet" aria-hidden="true" ><span class="vector-dropdown-label-text">日本語</span> </label> <div class="vector-dropdown-content"> <div id="p-variants" class="vector-menu mw-portlet mw-portlet-variants emptyPortlet" > <div class="vector-menu-content"> <ul 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mw-list-item"><a href="/w/index.php?title=SDRAM&action=history"><span>履歴を表示</span></a></li> </ul> </div> </div> <div id="p-tb" class="vector-menu mw-portlet mw-portlet-tb" > <div class="vector-menu-heading"> 全般 </div> <div class="vector-menu-content"> <ul class="vector-menu-content-list"> <li id="t-whatlinkshere" class="mw-list-item"><a href="/wiki/%E7%89%B9%E5%88%A5:%E3%83%AA%E3%83%B3%E3%82%AF%E5%85%83/SDRAM" title="ここにリンクしている全ウィキページの一覧[j]" accesskey="j"><span>リンク元</span></a></li><li id="t-recentchangeslinked" class="mw-list-item"><a href="/wiki/%E7%89%B9%E5%88%A5:%E9%96%A2%E9%80%A3%E3%83%9A%E3%83%BC%E3%82%B8%E3%81%AE%E6%9B%B4%E6%96%B0%E7%8A%B6%E6%B3%81/SDRAM" rel="nofollow" title="このページからリンクしているページの最近の更新[k]" accesskey="k"><span>関連ページの更新状況</span></a></li><li id="t-upload" class="mw-list-item"><a href="//ja.wikipedia.org/wiki/Wikipedia:ファイルのアップロード" title="ファイルをアップロードする[u]" accesskey="u"><span>ファイルをアップロード</span></a></li><li id="t-specialpages" class="mw-list-item"><a href="/wiki/%E7%89%B9%E5%88%A5:%E7%89%B9%E5%88%A5%E3%83%9A%E3%83%BC%E3%82%B8%E4%B8%80%E8%A6%A7" title="特別ページの一覧[q]" accesskey="q"><span>特別ページ</span></a></li><li id="t-permalink" class="mw-list-item"><a href="/w/index.php?title=SDRAM&oldid=103202424" title="このページのこの版への固定リンク"><span>この版への固定リンク</span></a></li><li id="t-info" class="mw-list-item"><a href="/w/index.php?title=SDRAM&action=info" title="このページについての詳細情報"><span>ページ情報</span></a></li><li id="t-cite" class="mw-list-item"><a href="/w/index.php?title=%E7%89%B9%E5%88%A5:%E3%81%93%E3%81%AE%E3%83%9A%E3%83%BC%E3%82%B8%E3%82%92%E5%BC%95%E7%94%A8&page=SDRAM&id=103202424&wpFormIdentifier=titleform" title="このページの引用方法"><span>このページを引用</span></a></li><li id="t-urlshortener" class="mw-list-item"><a href="/w/index.php?title=%E7%89%B9%E5%88%A5:UrlShortener&url=https%3A%2F%2Fja.wikipedia.org%2Fwiki%2FSDRAM"><span>短縮URLを取得する</span></a></li><li id="t-urlshortener-qrcode" class="mw-list-item"><a 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class="mw-indicators"> </div> <div id="siteSub" class="noprint">出典: フリー百科事典『ウィキペディア（Wikipedia）』</div> </div> <div id="contentSub"><div id="mw-content-subtitle"></div></div> <div id="mw-content-text" class="mw-body-content"><div class="mw-content-ltr mw-parser-output" lang="ja" dir="ltr"><p><b>SDRAM</b> (Synchronous Dynamic Random Access Memory) は、<a href="/wiki/%E3%83%95%E3%83%AD%E3%83%B3%E3%83%88%E3%82%B5%E3%82%A4%E3%83%89%E3%83%90%E3%82%B9" title="フロントサイドバス">システムバス</a>に同期して動作するDRAM (<a href="/wiki/Dynamic_Random_Access_Memory" title="Dynamic Random Access Memory">Dynamic Random Access Memory</a>)。<b>シンクロナスDRAM</b>とも。初期のDRAMのインタフェースは非同期式であり、制御入力の変化に反応して可能な限り素早く応答するようになっていた。SDRAMのインタフェースは同期式であり、制御入力に応答する前に<a href="/wiki/%E3%82%AF%E3%83%AD%E3%83%83%E3%82%AF" title="クロック">クロック信号</a>を待つため、コンピュータのシステムバスに同期して動作する。クロックは入ってくる命令をパイプライン化する内部の<a href="/wiki/%E6%9C%89%E9%99%90%E7%8A%B6%E6%85%8B%E6%A9%9F%E6%A2%B0" class="mw-redirect" title="有限状態機械">有限状態機械</a>を駆動するのに使われる。そのためSDRAMのチップは非同期DRAMよりも複雑な操作パターンを持つことができ、より高速に動作できる。 </p><p><a href="/wiki/%E3%83%91%E3%82%A4%E3%83%97%E3%83%A9%E3%82%A4%E3%83%B3%E5%87%A6%E7%90%86" title="パイプライン処理">パイプライン化</a>とはこの場合、SDRAMのチップが前の命令の処理を完了する前に新たな命令を受け付けられることを意味する。パイプライン化された書き込みでは、書き込み命令のすぐ後に書き込むべきデータがメモリアレイに到着する前でも次の命令を受け付けられる。パイプライン化された読み出しでは、要求したデータは読み出し命令からある固定数のクロックパルスが経過した後に出力され、その間のサイクルの間に別の命令を送ることができる。読み出し命令からデータが出力されるまでの遅延を「<a href="/w/index.php?title=SDRAM%E3%83%AC%E3%82%A4%E3%83%86%E3%83%B3%E3%82%B7&action=edit&redlink=1" class="new" title="SDRAMレイテンシ (存在しないページ)">レイテンシ</a>」と呼び、SDRAMを選択する際の重要な観点となっている。 </p><p>SDRAMは<a href="/wiki/%E3%82%B3%E3%83%B3%E3%83%94%E3%83%A5%E3%83%BC%E3%82%BF" title="コンピュータ">コンピュータ</a>で広く使われている。元々のSDRAMだけでなく、そこから発展した世代であるDDR (DDR1)、DDR2、DDR3、DDR4、DDR5が量産されている。 </p> <meta property="mw:PageProp/toc" /> <div class="mw-heading mw-heading2"><h2 id="歴史"><span id=".E6.AD.B4.E5.8F.B2"></span>歴史</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=1" title="節を編集: 歴史"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/%E3%83%95%E3%82%A1%E3%82%A4%E3%83%AB:SDR_SDRAM-1.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/8/8b/SDR_SDRAM-1.jpg/220px-SDR_SDRAM-1.jpg" decoding="async" width="220" height="58" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/8/8b/SDR_SDRAM-1.jpg/330px-SDR_SDRAM-1.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/8/8b/SDR_SDRAM-1.jpg/440px-SDR_SDRAM-1.jpg 2x" data-file-width="1697" data-file-height="450" /></a><figcaption>8個のSDRAMチップを <a href="/wiki/PC100" class="mw-disambig" title="PC100">PC100</a> <a href="/wiki/DIMM" title="DIMM">DIMM</a> パッケージに搭載したもの</figcaption></figure> <p>SDRAMのコンセプトは1970年代には既に知られており、<a href="/wiki/%E3%82%A4%E3%83%B3%E3%83%86%E3%83%AB" title="インテル">インテル</a>の初期のプロセッサでも使われていたが、広く使われるようになったのは1993年以降のことである。1993年、<a href="/wiki/%E3%82%B5%E3%83%A0%E3%82%B9%E3%83%B3%E9%9B%BB%E5%AD%90" title="サムスン電子">サムスン電子</a>がSDRAMチップ KM48SL2000 を導入。性能がよいため、コンピュータの主記憶として使われるDRAMは2000年までにほぼ全てがSDRAMとなった。 </p><p>SDRAMのレイテンシは元々非同期型のDRAMに比べて無視できるものではなかった。実際初期のSDRAMは内部ロジックが複雑だったため、同時期の <a href="/wiki/Dynamic_Random_Access_Memory#BEDO_DRAM" title="Dynamic Random Access Memory">burst EDO RAM</a> に比べて性能が低かった。SDRAM内部でのバッファリングはメモリの複数バンクへの操作を<a href="/wiki/%E3%82%A4%E3%83%B3%E3%82%BF%E3%83%BC%E3%83%AA%E3%83%BC%E3%83%96" title="インターリーブ">インターリーブ</a>できることに由来し、それによって実質的な<a href="/wiki/%E5%B8%AF%E5%9F%9F%E5%B9%85" title="帯域幅">帯域幅</a>を向上させている。 </p><p>今では事実上全てのSDRAMが、電子部品の相互運用を促進するために<a href="/wiki/%E3%82%AA%E3%83%BC%E3%83%97%E3%83%B3%E6%A8%99%E6%BA%96" title="オープン標準">オープン標準</a>の採用を進める電子業界団体<a href="/wiki/JEDEC" title="JEDEC">JEDEC</a>の規格に準拠して生産されている。JEDECは1993年に最初のSDRAMの規格を定め、その後も <a href="/wiki/DDR_SDRAM" title="DDR SDRAM">DDR</a>、<a href="/wiki/DDR2_SDRAM" title="DDR2 SDRAM">DDR2</a>、<a href="/wiki/DDR3_SDRAM" title="DDR3 SDRAM">DDR3 SDRAM</a> といったSDRAMの規格を定めてきた。 </p><p>SDRAMには<a href="/w/index.php?title=%E3%83%AC%E3%82%B8%E3%82%B9%E3%82%BF%E4%BB%98%E3%81%8DSDRAM&action=edit&redlink=1" class="new" title="レジスタ付きSDRAM (存在しないページ)">レジスタ付き</a>の派生品もあり、<a href="/wiki/%E3%82%B5%E3%83%BC%E3%83%90" title="サーバ">サーバ</a>や<a href="/wiki/%E3%83%AF%E3%83%BC%E3%82%AF%E3%82%B9%E3%83%86%E3%83%BC%E3%82%B7%E3%83%A7%E3%83%B3" title="ワークステーション">ワークステーション</a>などよりよいスケーラビリティを要求するシステムで使われる。 </p><p>2017年現在、パーソナルコンピュータの主記憶に単なるSDRAMが使われることはなく、<a href="/wiki/DDR3_SDRAM" title="DDR3 SDRAM">DDR3 SDRAM</a> や <a href="/wiki/DDR4_SDRAM" title="DDR4 SDRAM">DDR4 SDRAM</a> が主流である。 </p><p>SDRAMの主なメーカーとしては、<a href="/wiki/%E3%82%B5%E3%83%A0%E3%82%B9%E3%83%B3%E9%9B%BB%E5%AD%90" title="サムスン電子">サムスン電子</a>、<a href="/wiki/%E3%83%8F%E3%82%A4%E3%83%8B%E3%83%83%E3%82%AF%E3%82%B9%E5%8D%8A%E5%B0%8E%E4%BD%93" class="mw-redirect" title="ハイニックス半導体">ハイニックス半導体</a>、<a href="/wiki/%E3%82%A8%E3%83%AB%E3%83%94%E3%83%BC%E3%83%80%E3%83%A1%E3%83%A2%E3%83%AA" class="mw-redirect" title="エルピーダメモリ">エルピーダメモリ</a>、<a href="/wiki/%E3%83%9E%E3%82%A4%E3%82%AF%E3%83%AD%E3%83%B3%E3%83%BB%E3%83%86%E3%82%AF%E3%83%8E%E3%83%AD%E3%82%B8" title="マイクロン・テクノロジ">マイクロン・テクノロジ</a>などがある。 </p> <div class="mw-heading mw-heading2"><h2 id="タイミング"><span id=".E3.82.BF.E3.82.A4.E3.83.9F.E3.83.B3.E3.82.B0"></span>タイミング</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=2" title="節を編集: タイミング"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>DRAMの性能を制限する要因はいくつかある。中でも重視されるのがリードサイクル時間で、オープン状態（SDRAMの行データをセンスアンプの配列に格納した状態）のロウ（行）への連続な読み出し操作の間の時間である。100MHzのSDRAMでは10nsだったその時間が、DDR-400では5nsに短縮されたものの、DDR2-800 と DDR3-1600 の世代では相対的にほとんど短縮されていない。しかし、インタフェース回路を基本リードレートよりも何倍もの速さで操作することにより、帯域幅は急激に増大した。 </p><p>もう1つの制限要因は<a href="/w/index.php?title=CAS%E3%83%AC%E3%82%A4%E3%83%86%E3%83%B3%E3%82%B7&action=edit&redlink=1" class="new" title="CASレイテンシ (存在しないページ)">CASレイテンシ</a>で、カラムアドレスを供給してから対応するデータが得られるまでの時間である。これも最近の DDR SDRAM の数世代を通して 10-15ns と相対的に一定となっている。 </p><p>実装においてはCASレイテンシは、SDRAMのモードレジスタを通してクロックサイクル数の形でプログラム可能であり、DRAMコントローラが期待する値を設定する。任意の値をプログラム可能だが、あまりに小さい値を設定するとSDRAMは正しく動作できない。クロックレートが高いと、実用可能なCASレイテンシのクロックサイクル数は増大する。10-15ns という時間は、200MHzの DDR-400 SDRAM では 2-3サイクル (CL2-3)、DDR2-800 では CL4-6、DDR3-1600 では CL8-12 となる。クロックサイクルが遅ければ、当然ながらCASレイテンシのサイクル数も小さくなる。 </p><p>SDRAMモジュールにはそれぞれのタイミング仕様があり、そのモジュールで使っているチップ自体のそれよりも遅いことがある。100MHz SDRAMチップが登場したころ、100MHz対応と称したモジュールはそのクロックレートでは確実に動作できないことがあった。そのためインテルは <a href="/wiki/PC100" class="mw-disambig" title="PC100">PC100</a> 規格を策定し、100MHzで安定動作できるメモリモジュールを生産するためのガイドラインと要求仕様を定めた。この規格は広く影響を及ぼし、PC100 は100MHzのSDRAMモジュールを指す用語となり、"PC" の後に数字をつけた名称が広く使われるようになった（その後、数字の意味は変化している）。 </p> <div class="mw-heading mw-heading2"><h2 id="SDR_SDRAM">SDR SDRAM</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=3" title="節を編集: SDR SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/%E3%83%95%E3%82%A1%E3%82%A4%E3%83%AB:Micron_48LC32M8A2-AB.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/8/89/Micron_48LC32M8A2-AB.jpg/220px-Micron_48LC32M8A2-AB.jpg" decoding="async" width="220" height="165" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/8/89/Micron_48LC32M8A2-AB.jpg/330px-Micron_48LC32M8A2-AB.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/8/89/Micron_48LC32M8A2-AB.jpg/440px-Micron_48LC32M8A2-AB.jpg 2x" data-file-width="1202" data-file-height="901" /></a><figcaption><a href="https://en.wikipedia.org/wiki/Sound_Blaster_X-Fi" class="extiw" title="en:Sound Blaster X-Fi">Sound Blaster X-Fi Fatal1ty Pro</a> に搭載された64MBのメモリ。<a href="/wiki/%E3%83%9E%E3%82%A4%E3%82%AF%E3%83%AD%E3%83%B3%E3%83%BB%E3%83%86%E3%82%AF%E3%83%8E%E3%83%AD%E3%82%B8" title="マイクロン・テクノロジ">マイクロン</a>製の 48LC32M8A2-75 C というSDRAMチップ（8ビット幅）を133MHz (7.5ns) で駆動 <sup id="cite_ref-1" class="reference"><a href="#cite_note-1"><span class="cite-bracket">[</span>1<span class="cite-bracket">]</span></a></sup></figcaption></figure> <p>元々は単にSDRAMと呼ばれていた SDR（シングルデータレート）SDRAMは、クロックサイクル当たり1つのコマンドを受けつけるか、1ワードのデータを転送できる。典型的なクロック周波数は100MHzと133MHzである。様々なデータバス幅のチップがあるが（4ビット、8ビット、16ビットなど）、一般に168ピンの<a href="/wiki/DIMM" title="DIMM">DIMM</a>の形でモジュール化され、64ビット（ECCなし）または72ビット（<a href="/wiki/%E8%AA%A4%E3%82%8A%E6%A4%9C%E5%87%BA%E8%A8%82%E6%AD%A3" title="誤り検出訂正">ECC</a>）を一度に読み書きできる。 </p><p>データバスの使い方は複雑で、そのため複雑なDRAM制御回路を必要とする。例えば、書き込みの際にはライトコマンドと同じサイクルで書き込むべきデータを提示しなければならないが、読み出し操作ではリードコマンドの2または3サイクル後にデータが出力される。そのため、DRAMコントローラはリードとライトが同時にデータバスを必要としないように調整しなければならない。 </p><p>典型的な SDR SDRAM のクロックレートは 66MHz、100MHz、133MHz である（それぞれ、15ns、10ns、7.5ns）。 </p> <div class="mw-heading mw-heading3"><h3 id="制御信号"><span id=".E5.88.B6.E5.BE.A1.E4.BF.A1.E5.8F.B7"></span>制御信号</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=4" title="節を編集: 制御信号"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>すべてのコマンドはクロック信号の立ち上がりのタイミングでとられる。クロックに加えて6つの制御信号があり、たいていは<a href="/wiki/%E8%B2%A0%E8%AB%96%E7%90%86" title="負論理">負論理</a>で、クロックの立ち上がりのタイミングでサンプリングされる。 </p> <dl><dt>CKE (Clock Enable)</dt> <dd>この信号がローレベルのとき、チップはクロックが停止しているかのように動作する。コマンドは全く解釈されず、コマンドレイテンシ時間は経過しない。他の制御線の状態は考慮されない。この信号の効力は実際には1クロックサイクルだけ遅延される。すなわち現在のクロックサイクルは通常通り進行するが、次のクロックサイクルは無視され、CKE入力のチェックだけが行われる。CKEがハイレベルとなったクロックサイクル後の立ち上がりの時点から通常の処理が続行される。<br />言い換えれば、全ての処理はマスクされたクロックの立ち上がりに対応して進行する。マスクされたクロックとは、クロック入力と直前のクロック入力立ち上がり時のCKE信号の状態の論理積である。</dd> <dt>/CS (Chip Select)</dt> <dd>この信号がハイのとき、チップは全ての入力（CKE以外）を無視し、NOPコマンドを受け取ったかのように動作する。</dd> <dt>DQM (Data Mask)</dt> <dd>略号に"Q"という文字があるのは、データ線を"DQ"線と呼ぶことがあるためである。この信号がハイのとき、それらの信号はデータI/Oを抑制する。書き込みデータを伴う場合、そのデータは実際にはDRAMに書き込まれない。リードサイクルの前に2サイクルの間ハイにした場合、リードデータはチップから出力されない。DQM線は x16のメモリチップまたはDIMMの8ビットごとに1つある。</dd> <dt>/RAS (Row Address Strobe)</dt> <dd>名前に「ストローブ」とあるが、単なるコマンドビットとして機能する。/CAS および /WE と組み合わせて8種類のコマンドを指定する。</dd> <dt>/CAS (Column Address Strobe)</dt> <dd>名前に「ストローブ」とあるが、単なるコマンドビットとして機能する。/RAS および /WE と組み合わせて8種類のコマンドを指定する。</dd> <dt>/WE (Write enable)</dt> <dd>/RAS および /CAS と組み合わせて、8種類のコマンドを指定する。一般に読み出し系コマンドと書き込み系コマンドを区別する信号である。</dd></dl> <p>SDRAMデバイスは内部が2または4個の独立したバンクに分けられている。バンクアドレス入力が1つ以上あり（BA0、BA1）、コマンドがどのバンクに対するものかを選択するようになっている。 </p><p>コマンドの多くはアドレス入力ピンで示されるアドレスを使う。アドレスを使わない一部のコマンドやカラムアドレスを示さない一部のコマンドでもA10を使ってコマンドの種別を示す。 </p><p>コマンドを次の表に示す。 </p> <table class="wikitable" style="text-align:center; margin-right:0px;"> <tbody><tr> <th style="width:3em">/CS</th> <th style="width:3em">/RAS</th> <th style="width:3em">/CAS</th> <th style="width:3em">/WE</th> <th style="width:3em">BA<i>n</i></th> <th style="width:3em">A10</th> <th style="width:3em">A<i>n</i></th> <th>コマンド </th></tr> <tr> <td>H</td> <td>x</td> <td>x</td> <td>x</td> <td>x</td> <td>x</td> <td>x</td> <td align="left">コマンド抑制（何もしない） </td></tr> <tr> <td>L</td> <td>H</td> <td>H</td> <td>H</td> <td>x</td> <td>x</td> <td>x</td> <td align="left">何もしない（NOP） </td></tr> <tr> <td>L</td> <td>H</td> <td>H</td> <td>L</td> <td>x</td> <td>x</td> <td>x</td> <td align="left">バースト終了: 実行中のバーストリードまたはバーストライトを停止 </td></tr> <tr> <td>L</td> <td>H</td> <td>L</td> <td>H</td> <td style="white-space:nowrap;">バンク</td> <td>L</td> <td style="white-space:nowrap;">カラム</td> <td align="left">リード: 現在アクティブなロウからデータをバーストで読み出す。 </td></tr> <tr> <td>L</td> <td>H</td> <td>L</td> <td>H</td> <td>バンク</td> <td>H</td> <td>カラム</td> <td align="left">自動プリチャージ付きリード: リードと同じことを行い、完了時にプリチャージする（ロウを閉じる）。 </td></tr> <tr> <td>L</td> <td>H</td> <td>L</td> <td>L</td> <td>バンク</td> <td>L</td> <td>カラム</td> <td align="left">ライト: 現在アクティブなロウにデータをバーストで書き込む。 </td></tr> <tr> <td>L</td> <td>H</td> <td>L</td> <td>L</td> <td>バンク</td> <td>H</td> <td>カラム</td> <td align="left">自動プリチャージ付きライト: ライトと同じことを行い、完了時にプリチャージする（ロウを閉じる）。 </td></tr> <tr> <td>L</td> <td>L</td> <td>H</td> <td>H</td> <td>バンク</td> <td colspan="2">ロウ</td> <td align="left">アクティブ（活性化）: リードまたはライトコマンドのためにロウを開く。 </td></tr> <tr> <td>L</td> <td>L</td> <td>H</td> <td>L</td> <td>バンク</td> <td>L</td> <td>x</td> <td align="left">プリチャージ: 選択したバンクの現在のロウを非活性化する。 </td></tr> <tr> <td>L</td> <td>L</td> <td>H</td> <td>L</td> <td>x</td> <td>H</td> <td>x</td> <td align="left">全プリチャージ: 全バンクの現在のロウを非活性化する。 </td></tr> <tr> <td>L</td> <td>L</td> <td>L</td> <td>H</td> <td>x</td> <td>x</td> <td>x</td> <td align="left">オートリフレッシュ: 内部カウンタを使い、各バンクの1つのロウをリフレッシュする。全バンクをプリチャージしなければならない。 </td></tr> <tr> <td>L</td> <td>L</td> <td>L</td> <td>L</td> <td>0 0</td> <td colspan="2">モード</td> <td align="left">モードレジスタのロード: DRAMチップを設定するため、A0からA9までをロードする。最も重要な設定はCASレイテンシ（2または3サイクル）とバースト長（1/2/4/8サイクル）である。 </td></tr></tbody></table> <p>DDRx SDRAM でも基本的なコマンドは同じであり、若干追加がある。追加のモードレジスタは、バンクアドレスビットを使って識別され、3番目のバンクアドレスビットが追加されている。 </p> <div class="mw-heading mw-heading3"><h3 id="操作"><span id=".E6.93.8D.E4.BD.9C"></span>操作</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=5" title="節を編集: 操作"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>512<a href="/wiki/%E3%83%A1%E3%82%AC%E3%83%90%E3%82%A4%E3%83%88" title="メガバイト">MB</a> SDRAM DIMM（正確には 512MiB = <span class="nowrap">512 × 1024<sup>2</sup> bytes</span> = 536,870,912 bytes）は8個か9個のSDRAMチップで構成され、それぞれのチップが512<a href="/wiki/%E3%83%A1%E3%82%AC%E3%83%93%E3%83%83%E3%83%88" title="メガビット">Mbit</a>を格納し、DIMMの64ビットまたは72ビットのワード幅のうちの8ビットを各チップが分担している。典型的な512Mbit SDRAMチップの内部には4つの独立した16MBメモリバンクがある。それぞれのバンクは、16,384ビットのロウ（行）が8,192個並んだアレイになっている。バンクはアイドル状態、アクティブ状態、またはそれらの間で遷移中の状態のいずれかである。 </p><p>アクティブ・コマンドはアイドル状態のバンクを活性化する。2ビットのバンクアドレス (BA0–BA1) でバンクを示し、13ビットのロウアドレス (A0–A12) でロウを示し、バンクの持つ16,384個のカラム（列）のセンスアンプにそのロウの内容を送り込む。この操作を「ロウを開く」と呼ぶ。この操作の副作用として、そのロウ内のメモリセルのリフレッシュが行われる。 </p><p>ロウが活性化され開かれる（オープン状態になる）と、リード・コマンドとライト・コマンドをそのロウに対して実行可能となる。活性化に必要な時間は数クロックであり、それを「row-to-column 遅延」または t<sub>RCD</sub> と呼び、アクティブ・コマンド発行後にリードまたはライトを発行可能となるまでの時間を指し、通常クロックサイクル数で丸めた形で示す。それぞれのバンクは完全に独立しているため、このウェイトサイクルの間でも他のバンクに対してコマンドを発行できる。 </p><p>リード・コマンドとライト・コマンドはカラムアドレスを必要とする。ひとつのチップは一度に8ビットのデータにアクセスするので、カラムアドレスは2048種類あり（16384÷8=2048）、アドレス線は11本だけ必要となる（A0-A9、A11）。 </p><p>リード・コマンドを発行すると、SDRAMは2または3クロックサイクル後（CASレイテンシの設定による）のクロック立ち上がりの時点でDQ線に対応する出力データを出力する。それに続くワードのバーストが引き続きクロック信号の立ち上がりにあわせて出力される。 </p><p>ライト・コマンドは書き込むべきデータを伴い、クロック信号の立ち上がりの時点でDQ線をそのデータで駆動する。ライト・コマンドでDQ線にデータを伝送する際にSDRAMがリード・コマンドのデータを同時に出力しないようにしなければならない。これはメモリコントローラの役目である。これは通常リード・バーストの完了を待ち合わせるか、リード・バーストを停止するか、DQM制御線を使うことでなされる。 </p><p>メモリコントローラが別のロウにアクセスする必要が生じると、まずそのロウの所属するバンクのセンスアンプをアイドル状態に戻す必要があり、その後に次のロウにアクセスする準備をする。これを「プリチャージ」と称し、「ロウを閉じる」と呼ぶ。プリチャージは独立したコマンドとして実行することもあるし、リードまたはライトの際に自動的に行うこともある。プリチャージにも時間がかかり、ロウ・プリチャージ遅延または t<sub>RP</sub> と呼ぶ。指定したバンクが完全にアイドル状態となるまでにかかる時間であり、その後に次のアクティブ・コマンドを受け付けられるようになる。 </p><p>ロウを活性化すると副作用としてリフレッシュが行われるが、それにも時間がかかる。これを最小ロウ<a href="/wiki/%E3%82%A2%E3%82%AF%E3%82%BB%E3%82%B9%E6%99%82%E9%96%93" title="アクセス時間">アクセス時間</a> t<sub>RAS</sub> と呼び、あるロウをアクティブ・コマンドで開いた後からプリチャージ・コマンドで閉じることができるようになるまでの間に生じる遅延時間として現れる（言い換えると、アクティブ・コマンドとプリチャージ・コマンドの間でカラムアドレスを出すこと以外は何もしなくても遅延時間が発生する）。しかし、通常アクティブ・コマンドの後にはリードまたはライトを行うので、性能にはほとんど影響を及ぼさない。リード・ライトの動作の方が t<sub>RAS</sub> よりも長いからである。 </p> <div class="mw-heading mw-heading3"><h3 id="コマンドによる対話"><span id=".E3.82.B3.E3.83.9E.E3.83.B3.E3.83.89.E3.81.AB.E3.82.88.E3.82.8B.E5.AF.BE.E8.A9.B1"></span>コマンドによる対話</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=6" title="節を編集: コマンドによる対話"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>どのような状態でも<a href="/wiki/NOP" title="NOP">NOP</a>コマンドは常に受け付けられる。 </p><p>全バンクがアイドル状態のとき、以下のコマンドが発行できる。 </p> <ul><li>モードレジスタのロード・コマンド：モードレジスタの変更が効力を持つまである遅延時間がかかる。</li> <li>オートリフレッシュ・コマンド：チップがアイドル状態に戻るまでにリフレッシュサイクル時間 t<sub>RFC</sub> がかかる。この時間は一般に t<sub>RCD</sub>+t<sub>RP</sub> と同じである。</li></ul> <p>全バンクではなく、対話したい特定のバンクがアイドル状態のときに発行できるコマンド </p> <ul><li>アクティブ・コマンド：上述の通り、アクティブ・コマンドはロウが完全に開いてリードまたはライト・コマンドを受けつけ可能になるまで t<sub>RCD</sub> という時間を要する。</li></ul> <p>バンクが開いているとき（オープン状態のとき）、4つのコマンドを受け付けられる。 </p> <ul><li>リード・コマンド</li> <li>ライト・コマンド</li> <li>バースト終了コマンド</li> <li>プリチャージ・コマンド</li></ul> <p>リード・コマンドはリードバースト（連続読出）を開始する。一方、ライト・コマンドはライトバースト（連続書込）を開始する。そして、続くコマンドによってバーストを中断できる。 </p> <div class="mw-heading mw-heading4"><h4 id="リードバースト割り込み"><span id=".E3.83.AA.E3.83.BC.E3.83.89.E3.83.90.E3.83.BC.E3.82.B9.E3.83.88.E5.89.B2.E3.82.8A.E8.BE.BC.E3.81.BF"></span>リードバースト割り込み</h4><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=7" title="節を編集: リードバースト割り込み"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>「リード・コマンド」「バースト終了コマンド」「プリチャージ・コマンド」は、リードバースト開始後、任意の時点で発行でき、設定されたCASレイテンシ後にリードバーストに割り込むことができる。 </p><p>リード・コマンドをサイクル0で発行し、別のリード・コマンドをサイクル2で発行したとする。CASレイテンシが3の場合、最初のリード・コマンドはデータのバースト出力をサイクル3および4で開始し、2つ目のリード・コマンドの処理はサイクル5から開始される。 </p><p>以上をまとめると以下のようになる。 </p> <dl><dd>サイクル0 : リード・コマンド（1つ目）</dd> <dd>サイクル1 :</dd> <dd>サイクル2 : リード・コマンド（2つ目）</dd> <dd>サイクル3 : リードバースト開始</dd> <dd>サイクル4 : （ここでリードバースト開始になることもある）</dd> <dd>サイクル5 : 2つ目のリード・コマンドの処理開始</dd></dl> <p>サイクル2で発行したコマンドがバースト終了またはアクティブなバンクのプリチャージだった場合、サイクル5までの間に出力は生成されない。 </p><p>リードバースト割り込みは任意のアクティブなバンクで起きうるが、プリチャージ・コマンドがリードバーストに割り込むのは、それが同じバンクに対するものか全バンクに対するものだった場合だけである。異なるバンクへのプリチャージ・コマンドはリードバーストに割り込まない。 </p><p>ライト・コマンドでリードバーストに割り込むことも可能だが、やや難しい。ライトの際にはDQ線でSDRAMに書き込むデータを示す必要があるため、メモリコントローラはDQM信号を使ってSDRAMの出力を抑制する必要がある。DQMによるリードデータ抑制の効果は2サイクル遅延するが、ライトデータへの効果は即座に現れる。したがってライト・コマンドの少なくとも2サイクル前にDQMをアサートしてリードデータをマスクする必要があるが、ライト・コマンドを発行する時点にはDQMを下げておく必要がある。その間はわずか2サイクルであり、微妙なタイミング調整を必要とする。クロック周波数が高い場合は3サイクルを必要とすることもある。 </p><p>自動プリチャージ付きのリード・コマンドの場合、プリチャージはコマンドに割り込むのと同じサイクルで開始される。 </p> <div class="mw-heading mw-heading3"><h3 id="バースト要求"><span id=".E3.83.90.E3.83.BC.E3.82.B9.E3.83.88.E8.A6.81.E6.B1.82"></span>バースト要求</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=8" title="節を編集: バースト要求"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>最近の<a href="/wiki/%E3%82%AD%E3%83%A3%E3%83%83%E3%82%B7%E3%83%A5%E3%83%A1%E3%83%A2%E3%83%AA" title="キャッシュメモリ">キャッシュ</a>を持つ<a href="/wiki/%E3%83%9E%E3%82%A4%E3%82%AF%E3%83%AD%E3%83%97%E3%83%AD%E3%82%BB%E3%83%83%E3%82%B5" title="マイクロプロセッサ">マイクロプロセッサ</a>は、一般に<a href="/wiki/%E3%82%AD%E3%83%A3%E3%83%83%E3%82%B7%E3%83%A5%E3%83%A9%E3%82%A4%E3%83%B3" class="mw-redirect" title="キャッシュライン">キャッシュライン</a>単位でメモリにアクセスする。キャッシュラインが64バイト（512bit）の場合、64ビットのDIMMに8回連続アクセスする必要がある。64ビットのDIMMが8つのSDRAMチップで構成されている場合、1つのSDRAMチップは8bit単位で8回連続アクセスされることになる。それを1回のリードまたはライト・コマンドで開始するよう設定できる。すなわち、モードレジスタで8ワードのバースト転送を設定すればよい（BL=8、BLとは「バースト長」）。 </p><p>キャッシュラインのフェッチは一般に特定アドレスからのリードで開始され、SDRAMは「<b>クリティカルワード</b>」（キャッシュラインの先頭に位置しないワード）を最初に転送することを可能としている。ここでいう「ワード」の長さは、SDRAMチップまたはDIMMのデータ出力幅であり、典型的なDIMMでは64ビットである。SDRAMチップは、キャッシュライン内の残りのワードの転送順序を2種類サポートする。 </p><p>バーストは常にバースト長 (BL) でアライン（整列）されたブロック（キャッシュラインに対応）にアクセスし、ブロックの開始アドレスはBLの整数倍の位置となる。例えば4ワード・バーストでカラムアドレス4から7のいずれかにアクセスしようとすると、4-7の4ワードがバースト転送される。ブロックの先頭から転送を要求した場合、順番に転送されるだけである。しかし、ブロックの途中のアドレスから転送を要求すると、その転送順序は要求したアドレスに依存し、「シーケンシャル」または「インターリーブ」という2つのバースト種別のオプションで設定される。一般にメモリコントローラはどちらか一方をサポートしている。 </p><p>バースト長が1または2の場合、バースト種別は問題とはならない。バースト長が1なら、要求されたワードにアクセスするだけである。バースト長が2なら、まず要求されたアドレスのワードにアクセスし、次にブロックを構成するもう1つのワードにアクセスする。指定したアドレスが偶数なら2番目にアクセスするのはその次のワードであり、奇数なら1つ前のワードということになる。 </p><p>シーケンシャル型のバーストモードでは、指定されたアドレスを起点としてアドレスが大きくなる順にアクセスしていき、ブロック境界まで来るとブロック先頭に戻って順にアクセスしていく。例えばバースト長が4の場合、要求したカラムアドレスが5だとすると、アクセスするワードの順序は 5-6-7-4 となる。バースト長が8の場合、アクセス順序は 5-6-7-0-1-2-3-4 となる。これはカラムアドレスにカウンタの値を加算することでなされ、バースト長を超えたときにキャリーを無視することでこのような順序となる。 </p><p>インターリーブ型のバーストモードでは、カウンタと指定されたアドレスの間で<a href="/wiki/%E6%8E%92%E4%BB%96%E7%9A%84%E8%AB%96%E7%90%86%E5%92%8C" title="排他的論理和">排他的論理和</a>操作をおこなってアドレスを計算する。バースト長が4ワードの場合、同じようにアドレス5で開始すると、アクセス順序は 5-4-7-6 となる。同様に8ワードバーストなら 5-4-7-6-1-0-3-2 となる。人間にはこのような順序は判りにくいが、ハードウェアでの実装は容易であり、<a href="/wiki/%E3%82%A4%E3%83%B3%E3%83%86%E3%83%AB" title="インテル">インテル</a>製マイクロプロセッサがこの方式をよく採用している（どのような順番でもブロック内が全て転送されればよい）。 </p><p>要求されたカラムアドレスがブロック（キャッシュラインに対応）の先頭だった場合、どちらのモードであっても同じ 0-1-2-3-4-5-6-7 という整列した順序でデータを返す。2つのモードの違いが問題となるのは、クリティカルワードを最初としてキャッシュラインをフェッチする場合である。 </p> <div class="mw-heading mw-heading3"><h3 id="モードレジスタ"><span id=".E3.83.A2.E3.83.BC.E3.83.89.E3.83.AC.E3.82.B8.E3.82.B9.E3.82.BF"></span>モードレジスタ</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=9" title="節を編集: モードレジスタ"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>シングルデータレートのSDRAMには、10ビットのプログラム可能なモードレジスタがある。DDR SDRAM の規格ではモードレジスタがさらに追加されており、バンクアドレスピンを使って指定できる。SDR SDRAM の場合、バンクアドレスピンや A10 以上のアドレス線は無視されるが、モードレジスタに書き込む際はそれらを0にしておくべきである。 </p><p>モードレジスタのロードを行うサイクルでは、アドレス線 A0 から A9 でモードレジスタの内容を指定し、それぞれ M0 から M9 のビットに対応している。 </p> <ol><li>M9: ライトバーストモード。0の場合、ライト・コマンドでもリードバーストの長さとモードでバースト転送する。1の場合、全てのライトはバースト転送しない（1ワードのみの書き込みとなる）。</li> <li>M8, M7: 予約されている。常に 00 とする。</li> <li>M6, M5, M4: CASレイテンシ。一般に 010 (CL2) と 011 (CL3) のみが妥当である。リード・コマンドからデータ出力までのサイクル数を指定する。チップにはナノ秒単位の基本的な限界が存在する。初期化の際にメモリコントローラがその限界を考慮して適切なサイクル数に変換して設定しなければならない。</li> <li>M3: バースト種別。0の場合はシーケンシャル型のバースト順序、1の場合はインターリーブ型のバースト順序となる。</li> <li>M2, M1, M0: バースト長。000、001、010、011 がそれぞれ1ワード、2ワード、4ワード、8ワードに対応する。リード・コマンド（M9が0ならライトも）は、指定された長さでアクセスするが、バースト終了または他のコマンドで割り込むこともできる。111と設定した場合、ロウ全体のバースト転送となる。バーストは割り込むまで続く。ロウ全体のバーストはシーケンシャルモードのときのみ可能である。</li></ol> <div class="mw-heading mw-heading3"><h3 id="オートリフレッシュ"><span id=".E3.82.AA.E3.83.BC.E3.83.88.E3.83.AA.E3.83.95.E3.83.AC.E3.83.83.E3.82.B7.E3.83.A5"></span>オートリフレッシュ</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=10" title="節を編集: オートリフレッシュ"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>それぞれのバンクのそれぞれのロウを開いて閉じる（アクティブとプリチャージ）ことで、メモリセルをリフレッシュできる。しかし、メモリコントローラを単純化するため、SDRAMチップには「オートリフレッシュ」コマンドがあり、それぞれのバンクの1つのロウに対して同時にリフレッシュを行うことができる。SDRAMは内部にカウンタを持っていて、バンク内のロウを順番にオートリフレッシュすることができる。メモリコントローラはリフレッシュインターバル（一般に t<sub>REF</sub> = 64 ms）ごとにロウの数（これまで説明してきた例では4096）をカバーするのに十分なだけのオートリフレッシュ・コマンドを発行すればよい（この例だと、64ms内に4096回発行するということ）。このコマンドを発行する際には全バンクがアイドル状態でなければならない。 </p> <div class="mw-heading mw-heading3"><h3 id="省電力モード"><span id=".E7.9C.81.E9.9B.BB.E5.8A.9B.E3.83.A2.E3.83.BC.E3.83.89"></span>省電力モード</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=11" title="節を編集: 省電力モード"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>CKE (clock enable) 信号を使うと、SDRAMのクロックを事実上停止することができる。CKE信号はクロック波形の立ち上がりごとにサンプリングされ、ローレベルであれば次のクロックの立ち上がりが無視され、CKE信号のチェック以外の処理が行われなくなる。CKEをローレベルにしている間はクロック周波数を変更したり、クロックを完全に止めたりすることも可能である。 </p><p>CKEがローレベルになるとSDRAMは処理をフリーズさせ、CKEがハイレベルになるまでその状態を保つ。 </p><p>CKEがローレベルとなってSDRAMがアイドル状態なら（全バンクがプリチャージされ、コマンドを処理中でない場合）、SDRAMは自動的に省電力モードとなり、CKEがハイレベルになるまで最小限の電力しか消費しない状態となる。ただし、リフレッシュインターバル t<sub>REF</sub> 以上にこのモードを続けることはできない（メモリの内容が失われてしまうため）。この状態でクロックを完全に止めれば、さらに電力消費を抑えることができる。 </p><p>また、CKEをローレベルにしたときにオートリフレッシュ・コマンドをSDRAMに送れば、SDRAMはセルフリフレッシュ・モードとなる。この場合も省電力状態となるが、SDRAMは内部のタイマを使って必要なリフレッシュサイクルを生成する。この場合もクロック供給を止めることができる。上述の省電力モードよりも電力消費は若干多いが、メモリコントローラを完全に停止させることができ、システム全体としてはこちらの方が省電力となる。 </p><p>バッテリ駆動の機器向けにさらなる省電力オプションが用意されている。 </p> <ol><li>温度対応型リフレッシュ : チップ上の温度センサが温度を測定し、低温になるほどセルフリフレッシュでのリフレッシュレートを低減させる。</li> <li>選択的リフレッシュ : DRAMアレイの一部だけでセルフリフレッシュを行う。どの部分をリフレッシュするかは追加のモードレジスタで設定する。</li> <li>DPD (deep power down) モード : <a href="/w/index.php?title=%E3%83%A2%E3%83%90%E3%82%A4%E3%83%ABDDR&action=edit&redlink=1" class="new" title="モバイルDDR (存在しないページ)">モバイルDDR</a> (LPDDR) やLPDDR2が実装している。メモリ内容を無効化して、通常状態に復帰するときに再設定を必要とする。CKEをローレベルにする際にバースト終了コマンドを発行することでDPDモードとなる。</li></ol> <div class="mw-heading mw-heading2"><h2 id="世代"><span id=".E4.B8.96.E4.BB.A3"></span>世代</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=12" title="節を編集: 世代"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="mw-heading mw-heading3"><h3 id="SDRAM">SDRAM</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=13" title="節を編集: SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>SDR SDRAM（詳細は前述）は、1クロックサイクルの片エッジでの転送である（シングルデータレート（SDR））。 </p> <div class="mw-heading mw-heading3"><h3 id="その他の提案"><span id=".E3.81.9D.E3.81.AE.E4.BB.96.E3.81.AE.E6.8F.90.E6.A1.88"></span>その他の提案</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=14" title="節を編集: その他の提案"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>SDR SDRAMの後継としてDDR SDRAMが普及するまでの間に、多少の技術的・政治的混沌があった。<a href="#成功しなかった後継テクノロジー">#成功しなかった後継テクノロジー</a>の節を参照。 </p> <div class="mw-heading mw-heading3"><h3 id="DDR_SDRAM">DDR SDRAM</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=15" title="節を編集: DDR SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="rellink" style="margin-bottom: 0.5em; padding-left: 2em; font-size: 90%;" role="note">→詳細は「<a href="/wiki/DDR_SDRAM" title="DDR SDRAM">DDR SDRAM</a>」を参照</div> <p>DRAMのアクセスレイテンシはDRAMアレイによって基本的に制限されているが、内部では数千ビットのロウを一度に読み出すので、帯域幅はさらに高められる可能性を持っている。ユーザーに対してさらなる帯域幅を提供するため、<a href="/w/index.php?title=%E3%83%80%E3%83%96%E3%83%AB%E3%83%87%E3%83%BC%E3%82%BF%E3%83%AC%E3%83%BC%E3%83%88&action=edit&redlink=1" class="new" title="ダブルデータレート (存在しないページ)">ダブルデータレート</a>というインタフェースが開発された。コマンドを1サイクルに1つ受け付けるのは従来と同じだが、リードとライトは1クロックサイクルに2ワードのデータを扱う。またSDRインタフェースでのタイミングにいくつかマイナーな変更を加え、電源電圧を3.3Vから2.5Vに下げた。結果として DDR SDRAM は SDR SDRAM との互換性を保っていない。 </p><p>DDR SDRAM（その後の製品と区別するため "DDR1" とされることもある）は最小の読み書き単位を倍にし、1回のアクセスで少なくとも2ワードを参照するようになった。 </p><p>DDR SDRAM の典型的なクロック周波数は 133MHz、166MHz、200MHz（それぞれサイクル時間は 7.5ns、6ns、5ns）で、それぞれ DDR-266、DDR-333、DDR-400 と呼ばれる。対応する184ピンのDIMMはそれぞれ PC-2100、PC-2700、PC-3200 と呼ばれる。さらに高性能な DDR-550 (PC-4400) までそれなりの価格で入手可能である。 </p> <div class="mw-heading mw-heading3"><h3 id="DDR2_SDRAM">DDR2 SDRAM</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=16" title="節を編集: DDR2 SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="rellink" style="margin-bottom: 0.5em; padding-left: 2em; font-size: 90%;" role="note">→詳細は「<a href="/wiki/DDR2_SDRAM" title="DDR2 SDRAM">DDR2 SDRAM</a>」を参照</div> <p>DDR2 SDRAM は DDR SDRAM とよく似ているが、最小読み書き単位をさらに倍にし、4ワード単位としている。また、高速操作を実現するためにバスプロトコルを単純化している。特にバースト終了コマンドを削除した。それによって内部のRAM操作のクロック周波数を上げずにSDRAMのバスレートを倍にしている。その代わり、内部の操作はもともとのSDRAMの4倍の単位で行っている。またチップのメモリ容量増大に対応するため、バンク数を8にできるよう新たなバンクアドレスピン (BA2) を追加している。 </p><p>DDR2 SDRAM の典型的なクロック周波数は 200MHz、266MHz、333MHz、400MHz（それぞれ 5ns、3.75ns、3ns、2.5ns）で、それぞれ DDR2-400、DDR2-533、DDR2-667、DDR2-800 と呼ばれる。対応する240ピンのDIMMは、PC2-3200からPC2-6400までの名称である。最近では533MHzのものもあり DDR2-1066 と呼ばれ、対応するDIMMは PC2-8500（メーカーによっては PC2-8600 とも）と呼ばれている。さらに高性能な DDR2-1250 (PC2-10000) までそれなりの価格で入手可能である。 </p><p>内部操作は2分の1のクロックレートで行われるため、DDR2-400（内部クロック周波数は100MHz）はDDR-400（内部クロック周波数は200MHz）よりも各種レイテンシが大きい。 </p> <div class="mw-heading mw-heading3"><h3 id="DDR3_SDRAM">DDR3 SDRAM</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=17" title="節を編集: DDR3 SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="rellink" style="margin-bottom: 0.5em; padding-left: 2em; font-size: 90%;" role="note">→詳細は「<a href="/wiki/DDR3_SDRAM" title="DDR3 SDRAM">DDR3 SDRAM</a>」を参照</div> <p>DDR3でも同様の進化の傾向が継続され、読み書きの最小単位は連続する8ワードと倍になった。これによって内部クロックレートを変更せずに外部バスの周波数と帯域幅を倍増させることが可能になった。毎秒800Mから1600M回の転送を実現するため（400-800MHzのクロックの両方のエッジで転送）、内部のメモリアレイでは毎秒100Mから200M回のフェッチを実行する。 </p><p>この場合も問題は<a href="/wiki/%E3%83%AC%E3%82%A4%E3%83%86%E3%83%B3%E3%82%B7" title="レイテンシ">レイテンシ</a>の相対的な増大である。DDR SDRAM 全般に言えることだが、コマンドは依然としてクロックサイクルの立ち上がりに1回だけ発行できるだけで、通常言われる転送速度の半分の速度である。同じ100MHzでメモリセルが動いている、DDR3-800の<a href="/w/index.php?title=CAS%E3%83%AC%E3%82%A4%E3%83%86%E3%83%B3%E3%82%B7&action=edit&redlink=1" class="new" title="CASレイテンシ (存在しないページ)">CASレイテンシ</a>は 8/(400MHz) = 20ns であり、<a href="/wiki/PC100" class="mw-disambig" title="PC100">PC100</a>の SDR SDRAM の CAS2 のレイテンシと全く同一である。メモリセルのクロック周波数はDDR以降、133MHz〜266MHzが商品の中心であり、クロック周波数は伸びていなく、1クロックで取得できるビット数が2倍ずつ増えているだけである。この傾向はDDR4でも続く予定。 </p><p>DDR3メモリチップは2007年後半に出荷が開始され<sup id="cite_ref-2" class="reference"><a href="#cite_note-2"><span class="cite-bracket">[</span>2<span class="cite-bracket">]</span></a></sup>、2008年以降徐々に生産量が伸びている<sup id="cite_ref-3" class="reference"><a href="#cite_note-3"><span class="cite-bracket">[</span>3<span class="cite-bracket">]</span></a></sup><sup id="cite_ref-4" class="reference"><a href="#cite_note-4"><span class="cite-bracket">[</span>4<span class="cite-bracket">]</span></a></sup>。当初のクロック周波数は400MHzと533MHzで、それぞれ DDR3-800 と DDR3-1066（DIMMモジュールは PC3-6400 と PC3-8500）と呼ばれていたが、今では DDR3-1333 と DDR3-1600（DIMMモジュールは PC3-10600 と PC3-12800）が一般的となっている<sup id="cite_ref-5" class="reference"><a href="#cite_note-5"><span class="cite-bracket">[</span>5<span class="cite-bracket">]</span></a></sup>。さらに高性能な DDR3-2200 までそれなりの価格で入手可能である<sup id="cite_ref-6" class="reference"><a href="#cite_note-6"><span class="cite-bracket">[</span>6<span class="cite-bracket">]</span></a></sup>。 </p> <div class="mw-heading mw-heading3"><h3 id="DDR4_SDRAM">DDR4 SDRAM</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=18" title="節を編集: DDR4 SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="rellink" style="margin-bottom: 0.5em; padding-left: 2em; font-size: 90%;" role="note">→詳細は「<a href="/wiki/DDR4_SDRAM" title="DDR4 SDRAM">DDR4 SDRAM</a>」を参照</div> <p><a href="/wiki/DDR3_SDRAM" title="DDR3 SDRAM">DDR3 SDRAM</a> の後継とされているのが <b>DDR4 SDRAM</b> である。2008年、<a href="/wiki/%E3%82%B5%E3%83%B3%E3%83%95%E3%83%A9%E3%83%B3%E3%82%B7%E3%82%B9%E3%82%B3" title="サンフランシスコ">サンフランシスコ</a>で開催された<a href="/wiki/%E3%82%A4%E3%83%B3%E3%83%86%E3%83%AB%E3%83%BB%E3%83%87%E3%83%99%E3%83%AD%E3%83%83%E3%83%91%E3%83%BC%E3%83%BB%E3%83%95%E3%82%A9%E3%83%BC%E3%83%A9%E3%83%A0" title="インテル・デベロッパー・フォーラム">インテル・デベロッパー・フォーラム</a>で明らかにされ、当初2012年までのリリースが期待されていた<sup id="cite_ref-7" class="reference"><a href="#cite_note-7"><span class="cite-bracket">[</span>7<span class="cite-bracket">]</span></a></sup>。今は、サーバー向けが2013年、PC向けが2015年のリリースが期待されている<sup id="cite_ref-20111107_488696.html_8-0" class="reference"><a href="#cite_note-20111107_488696.html-8"><span class="cite-bracket">[</span>8<span class="cite-bracket">]</span></a></sup><sup id="cite_ref-9" class="reference"><a href="#cite_note-9"><span class="cite-bracket">[</span>9<span class="cite-bracket">]</span></a></sup>。DDR以降、3〜5年で2倍の高速化をしていたメモリの転送速度の伸びが鈍化する形となる。 </p><p>転送能力は2.133GT/s(DDR4-2133, 133MHz, 17.066GB/s)のものが最初に登場し、最終的に4.266GT/s(DDR4-4266, 266MHz, 34.133GB/s) まで向上すると予測されていて<sup id="cite_ref-10" class="reference"><a href="#cite_note-10"><span class="cite-bracket">[</span>10<span class="cite-bracket">]</span></a></sup>、DDR3の2倍となる。メモリクロックはDDR〜DDR3同様、133MHz〜266MHzあたりが中心となる。また、電源電圧はDDR3の1.5Vに対して1.2<a href="/wiki/%E3%83%9C%E3%83%AB%E3%83%88_(%E5%8D%98%E4%BD%8D)" title="ボルト (単位)">V</a>以下が予定されており<sup id="cite_ref-11" class="reference"><a href="#cite_note-11"><span class="cite-bracket">[</span>11<span class="cite-bracket">]</span></a></sup><sup id="cite_ref-12" class="reference"><a href="#cite_note-12"><span class="cite-bracket">[</span>12<span class="cite-bracket">]</span></a></sup>、1.0Vまで下げられると予測されている<sup id="cite_ref-13" class="reference"><a href="#cite_note-13"><span class="cite-bracket">[</span>13<span class="cite-bracket">]</span></a></sup>。 </p><p>2009年2月、<a href="/wiki/%E3%82%B5%E3%83%A0%E3%82%B9%E3%83%B3%E9%9B%BB%E5%AD%90" title="サムスン電子">サムスン電子</a>はDDR4開発の重要なステップとして 40nmルールのDRAMチップの試作検証を行った<sup id="cite_ref-14" class="reference"><a href="#cite_note-14"><span class="cite-bracket">[</span>14<span class="cite-bracket">]</span></a></sup>。2009年時点で一般に製造されているDRAMチップは50nmルールに移行しつつある状態だった<sup id="cite_ref-15" class="reference"><a href="#cite_note-15"><span class="cite-bracket">[</span>15<span class="cite-bracket">]</span></a></sup>。 </p><p>2011年2月、サムスン電子は2GBの DDR4 SDRAM モジュールの開発を発表した。電源電圧 1.2V での最大帯域幅は 2.133Gbps で、30nmプロセス技術で「擬似オープンドレイン」テクノロジーを採用。同等のDDR3モジュールと比較すると消費電力を40%抑えている<sup id="cite_ref-16" class="reference"><a href="#cite_note-16"><span class="cite-bracket">[</span>16<span class="cite-bracket">]</span></a></sup> <sup id="cite_ref-17" class="reference"><a href="#cite_note-17"><span class="cite-bracket">[</span>17<span class="cite-bracket">]</span></a></sup>。 </p><p>2014年6月下旬、販売開始Intelの「Haswell-E」およびX99チップセットが対応する </p><p>2015年9月 Intelが第6世代Coreプロセッサを発表。今までハイエンドモデルでのみ対応していたDDR4がメインスリーム向けCPUで対応した。 </p> <div class="mw-heading mw-heading3"><h3 id="DDR5_SDRAM">DDR5 SDRAM</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=19" title="節を編集: DDR5 SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="rellink" style="margin-bottom: 0.5em; padding-left: 2em; font-size: 90%;" role="note">→詳細は「<a href="/wiki/DDR5_SDRAM" title="DDR5 SDRAM">DDR5 SDRAM</a>」を参照</div> <p><a href="/wiki/DDR4_SDRAM" title="DDR4 SDRAM">DDR4 SDRAM</a>と比較して、DDR5は消費電力を削減しつつ<a href="/wiki/%E5%B8%AF%E5%9F%9F%E5%B9%85" title="帯域幅">帯域幅</a>が2倍になる<sup id="cite_ref-18" class="reference"><a href="#cite_note-18"><span class="cite-bracket">[</span>18<span class="cite-bracket">]</span></a></sup>。<a href="/wiki/2020%E5%B9%B4" title="2020年">2020年</a><a href="/wiki/7%E6%9C%8814%E6%97%A5" title="7月14日">7月14日</a>に標準規格が発表された<sup id="cite_ref-:0_19-0" class="reference"><a href="#cite_note-:0-19"><span class="cite-bracket">[</span>19<span class="cite-bracket">]</span></a></sup><sup id="cite_ref-20" class="reference"><a href="#cite_note-20"><span class="cite-bracket">[</span>20<span class="cite-bracket">]</span></a></sup>。 </p> <div class="mw-heading mw-heading3"><h3 id="仕様比較"><span id=".E4.BB.95.E6.A7.98.E6.AF.94.E8.BC.83"></span>仕様比較</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=20" title="節を編集: 仕様比較"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <table class="wikitable"> <tbody><tr> <th>種類</th> <th>仕様 </th></tr> <tr> <td>SDRAM</td> <td><span class="nowrap">V<sub>cc</sub> = 3.3 V</span><br />信号: LV<a href="/wiki/Transistor-transistor_logic" title="Transistor-transistor logic">TTL</a> </td></tr> <tr> <td><a href="/wiki/DDR_SDRAM" title="DDR SDRAM">DDR1</a></td> <td>アクセスは2ワード単位以上<br /> <a href="/w/index.php?title=%E3%83%80%E3%83%96%E3%83%AB%E3%83%87%E3%83%BC%E3%82%BF%E3%83%AC%E3%83%BC%E3%83%88&action=edit&redlink=1" class="new" title="ダブルデータレート (存在しないページ)">ダブルデータレート</a><br /> <span class="nowrap">V<sub>cc</sub> = 2.5 V</span><br />1サイクル当たり <span class="nowrap">2.5 - 7.5 ns</span><br /> 信号: <a href="https://en.wikipedia.org/wiki/Stub_Series_Terminated_Logic" class="extiw" title="en:Stub Series Terminated Logic">SSTL_2</a> (2.5V)<sup id="cite_ref-eda-dramconsumer_21-0" class="reference"><a href="#cite_note-eda-dramconsumer-21"><span class="cite-bracket">[</span>21<span class="cite-bracket">]</span></a></sup> </td></tr> <tr> <td><a href="/wiki/DDR2_SDRAM" title="DDR2 SDRAM">DDR2</a></td> <td>アクセスは4ワード単位以上<br /> "Burst terminate" を削除<br /> 4ユニットを並列接続して使用<br /> 1サイクル当たり <span class="nowrap">1.25 - 5 ns</span><br /> 内部操作は1/2のクロックレートで行われる。<br /> 信号: SSTL_18 (1.8V)<sup id="cite_ref-eda-dramconsumer_21-1" class="reference"><a href="#cite_note-eda-dramconsumer-21"><span class="cite-bracket">[</span>21<span class="cite-bracket">]</span></a></sup> </td></tr> <tr> <td><a href="/wiki/DDR3_SDRAM" title="DDR3 SDRAM">DDR3</a></td> <td>アクセスは8ワード単位以上<br /> 信号: SSTL_15 (1.5V)<sup id="cite_ref-eda-dramconsumer_21-2" class="reference"><a href="#cite_note-eda-dramconsumer-21"><span class="cite-bracket">[</span>21<span class="cite-bracket">]</span></a></sup><br /> CASレイテンシが長い。 </td></tr> <tr> <td><a href="/wiki/DDR4_SDRAM" title="DDR4 SDRAM">DDR4</a></td> <td><span class="nowrap">V<sub>cc</sub> ≤ 1.2 V</span> </td></tr> <tr> <td><a href="/wiki/DDR5_SDRAM" title="DDR5 SDRAM">DDR5</a></td> <td><span class="nowrap">V<sub>dd</sub> ≤ 1.1 V</span> </td></tr></tbody></table> <div class="mw-heading mw-heading2"><h2 id="成功しなかった後継テクノロジー"><span id=".E6.88.90.E5.8A.9F.E3.81.97.E3.81.AA.E3.81.8B.E3.81.A3.E3.81.9F.E5.BE.8C.E7.B6.99.E3.83.86.E3.82.AF.E3.83.8E.E3.83.AD.E3.82.B8.E3.83.BC"></span>成功しなかった後継テクノロジー</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=21" title="節を編集: 成功しなかった後継テクノロジー"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>SDR SDRAM の後継として、DDR以外にも次のようなメモリテクノロジーが提案されてきた。 </p> <div class="mw-heading mw-heading3"><h3 id="Rambus_DRAM_(RDRAM)"><span id="Rambus_DRAM_.28RDRAM.29"></span>Rambus DRAM (RDRAM)</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=22" title="節を編集: Rambus DRAM (RDRAM)"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p><a href="/wiki/RDRAM" title="RDRAM">RDRAM</a>はDDRと競合した独自テクノロジーだった。比較的高価で性能も期待されたほどではなく（レイテンシが大きく、データ転送幅もSDRAMの64ビットに比べて小さい）、SDRAMとの競争に敗退した。 </p> <div class="mw-heading mw-heading3"><h3 id="Synchronous-Link_DRAM_(SLDRAM)"><span id="Synchronous-Link_DRAM_.28SLDRAM.29"></span>Synchronous-Link DRAM (SLDRAM)</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=23" title="節を編集: Synchronous-Link DRAM (SLDRAM)"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>SLDRAMもRDRAMと競合した。1990年代後半にSLDRAMコンソーシアムが開発したもので、同コンソーシアムは約20社の主要メーカーが結成したものである。<a href="/wiki/%E3%82%AA%E3%83%BC%E3%83%97%E3%83%B3%E6%A8%99%E6%BA%96" title="オープン標準">オープン標準</a>であり、ライセンス料を徴収しない規格だった。64ビット200MHzのバスに接続する。同じ線上で全ての信号を転送し、複数の線の同期問題を解消している。<a href="/wiki/DDR_SDRAM" title="DDR SDRAM">DDR SDRAM</a> と同様、SLDRAMもクロックの立ち上がりと立ち下がりでデータを転送するため、毎秒400M回のデータ転送を行う仕様だった<sup id="cite_ref-22" class="reference"><a href="#cite_note-22"><span class="cite-bracket">[</span>22<span class="cite-bracket">]</span></a></sup>。 </p> <div class="mw-heading mw-heading3"><h3 id="Virtual_Channel_Memory_(VCM)_SDRAM"><span id="Virtual_Channel_Memory_.28VCM.29_SDRAM"></span>Virtual Channel Memory (VCM) SDRAM</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=24" title="節を編集: Virtual Channel Memory (VCM) SDRAM"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>VCMは<a href="/wiki/NEC" class="mw-redirect" title="NEC">NEC</a>が独自開発したSDRAMの一種だが、オープン標準としてリリースされ、ライセンス料を徴収しなかった。VCMでは各種システムプロセスにそれぞれ仮想チャネルを割り当てられるため、プロセス群がバッファ空間を共有する必要性を避け、システム全体の効率を向上させる方式だった。具体的にはメモリを独立したブロック群で構成し、ブロック毎にメモリコントローラとのインタフェースとバッファ空間を設けていた。SDRAMに比べてレイテンシが格段に小さく、高性能だった。<a href="/wiki/RDRAM" title="RDRAM">RDRAM</a>に比べると安価で、そのモジュールは通常のSDRAMと互換性があったが、メモリコントローラはVCMであることを認識して対応する必要があった。VCMをサポートしたマザーボードは数少ない。 </p> <div class="mw-heading mw-heading2"><h2 id="セキュリティ"><span id=".E3.82.BB.E3.82.AD.E3.83.A5.E3.83.AA.E3.83.86.E3.82.A3"></span>セキュリティ</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=25" title="節を編集: セキュリティ"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>一般には揮発性メモリの内容は電源が切れた途端消えてしまうものと考えるが、実はSDRAMの記憶した内容はすぐには消えない。完全に消えるまでには常温では数秒かかり、より低温ではそれを数分まで延ばすことができる。これを利用して直前まで動作していたメモリ上のデータを復元して盗むという手法が考えられる<sup id="cite_ref-23" class="reference"><a href="#cite_note-23"><span class="cite-bracket">[</span>23<span class="cite-bracket">]</span></a></sup>。これを「コールド・ブート攻撃」あるいは「アイスマン攻撃」などと呼ぶこともある。 </p> <div class="mw-heading mw-heading2"><h2 id="脚注・出典"><span id=".E8.84.9A.E6.B3.A8.E3.83.BB.E5.87.BA.E5.85.B8"></span>脚注・出典</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=26" title="節を編集: 脚注・出典"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="reflist" style="list-style-type: decimal;"> <ol class="references"> <li id="cite_note-1"><b><a href="#cite_ref-1">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">“<a rel="nofollow" class="external text" href="http://www.micron.com/partscatalog.html?categoryPath=products/parametric/dram/sdram">SDRAM Part Catalog</a>”. <span title="">2011年2月18日</span>閲覧。</cite> micron.com</span> </li> <li id="cite_note-2"><b><a href="#cite_ref-2">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">Thomas Soderstrom (June 5, 2007). “<a rel="nofollow" class="external text" href="http://www.tomshardware.com/2007/06/05/pipe_dreams_six_p35-ddr3_motherboards_compared/">Pipe Dreams: Six P35-DDR3 Motherboards Compared</a>”.  Tom's Hardware. <span title="">2011年2月22日</span>閲覧。</cite></span> </li> <li id="cite_note-3"><b><a href="#cite_ref-3">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">“<a rel="nofollow" class="external text" href="http://www.simmtester.com/page/news/showpubnews.asp?num=145">What is DDR memory?</a>”. <span title="">2011年2月22日</span>閲覧。</cite></span> </li> <li id="cite_note-4"><b><a href="#cite_ref-4">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">“<a rel="nofollow" class="external text" href="https://news.softpedia.com/news/AMD-to-Adopt-DDR3-in-Three-Years-13486.shtml">AMD to Adopt DDR3 in Three Years</a>”. <span title="">2011年2月22日</span>閲覧。</cite></span> </li> <li id="cite_note-5"><b><a href="#cite_ref-5">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">Wesly Fink (July 20, 2007). “<a rel="nofollow" class="external text" href="http://www.anandtech.com/printarticle.aspx?i=3045">Super Talent & TEAM: DDR3-1600 Is Here!</a>”.  Anandtech. <span title="">2011年2月22日</span>閲覧。</cite></span> </li> <li id="cite_note-6"><b><a href="#cite_ref-6">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">Thomas Jørgen Jacobsen (28 July 2009). “<a rel="nofollow" class="external text" href="http://www.brightsideofnews.com/news/2009/7/28/a-data-launches-ddr3-2200-with-2oz-pcb.aspx">A-Data launches DDR3-2200 with 2oz. copper PCB</a>”. <span title="">2011年2月22日</span>閲覧。</cite></span> </li> <li id="cite_note-7"><b><a href="#cite_ref-7">^</a></b> <span class="reference-text"><a rel="nofollow" class="external text" href="http://intel.wingateweb.com/US08/published/sessions/MASS006/SF08_MASS006_100s.pdf">DDR4 PDF page 23</a><sup class="noprint Inline-Template nowrap">[<i><a href="/wiki/Wikipedia:%E5%87%BA%E5%85%B8%E3%82%92%E6%98%8E%E8%A8%98%E3%81%99%E3%82%8B#リンク切れの回避と修復" title="Wikipedia:出典を明記する"><span title="外部リンクがリンク切れとなっています。（2011年2月）">リンク切れ</span></a></i>]</sup></span> </li> <li id="cite_note-20111107_488696.html-8"><b><a href="#cite_ref-20111107_488696.html_8-0">^</a></b> <span class="reference-text"><a rel="nofollow" class="external text" href="https://pc.watch.impress.co.jp/docs/column/kaigai/488696.html">【後藤弘茂のWeekly海外ニュース】 JEDECが「DDR4」とTSVを使う「3DS」メモリ技術の概要を明らかに</a></span> </li> <li id="cite_note-9"><b><a href="#cite_ref-9">^</a></b> <span class="reference-text"> <a rel="nofollow" class="external text" href="http://www.semiaccurate.com/2010/08/16/ddr4-not-expected-until-2015/">DDR4 not expected until 2015 - SemiAccurate</a></span> </li> <li id="cite_note-10"><b><a href="#cite_ref-10">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">“<a rel="nofollow" class="external text" href="http://www.xbitlabs.com/news/memory/display/20100816124343_Next_Generation_DDR4_Memory_to_Reach_4_266GHz_Report.html">Next-Generation DDR4 Memory to Reach 4.266GHz - Report</a>”.  Xbitlabs.com (August 16, 2010). <span title="">2011年1月3日</span>閲覧。</cite></span> </li> <li id="cite_note-11"><b><a href="#cite_ref-11">^</a></b> <span class="reference-text"><a rel="nofollow" class="external text" href="http://www.pcpro.co.uk/news/220257/idf-ddr3-wont-catch-up-with-ddr2-during-2009.html">Looking forward to DDR4</a></span> </li> <li id="cite_note-12"><b><a href="#cite_ref-12">^</a></b> <span class="reference-text"><a rel="nofollow" class="external text" href="http://www.heise-online.co.uk/news/IDF-DDR4-the-successor-to-DDR3-memory--/111367">DDR3 successor</a></span> </li> <li id="cite_note-13"><b><a href="#cite_ref-13">^</a></b> <span class="reference-text"><cite style="font-style:normal" class="citation news"><a rel="nofollow" class="external text" href="http://www.hardware-infos.com/news.php?news=2332">“IDF: DDR4 memory targeted for 2012”</a> (German). hardware-infos.com<span style="display:none;">. <a rel="nofollow" class="external free" href="http://www.hardware-infos.com/news.php?news=2332">http://www.hardware-infos.com/news.php?news=2332</a></span> <span class="reference-accessdate"><span title="">2009年6月16日</span>閲覧。</span></cite><span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Abook&rft.genre=bookitem&rft.btitle=IDF%3A+DDR4+memory+targeted+for+2012&rft.atitle=&rft.pub=hardware-infos.com&rft_id=http%3A%2F%2Fwww.hardware-infos.com%2Fnews.php%3Fnews%3D2332&rfr_id=info:sid/ja.wikipedia.org:SDRAM"><span style="display: none;"> </span></span><sup class="noprint Inline-Template nowrap">[<i><a href="/wiki/Wikipedia:%E5%87%BA%E5%85%B8%E3%82%92%E6%98%8E%E8%A8%98%E3%81%99%E3%82%8B#リンク切れの回避と修復" title="Wikipedia:出典を明記する"><span title="外部リンクがリンク切れとなっています。（2011年2月）">リンク切れ</span></a></i>]</sup> <i><a rel="nofollow" class="external text" href="https://translate.google.com/translate?hl=en&sl=de&u=http://www.hardware-infos.com/news.php%3Fnews%3D2332&ei=bi44Sv_wBouZjAfVzYyjDQ&sa=X&oi=translate&resnum=1&ct=result&prev=/search%3Fq%3Dhttp://www.hardware-infos.com/news.php%253Fnews%253D2332%26hl%3Den%26safe%3Doff%26num%3D100">English translation</a></i></span> </li> <li id="cite_note-14"><b><a href="#cite_ref-14">^</a></b> <span class="reference-text"><cite style="font-style:normal" class="citation news">Gruener, Wolfgang (February 4, 2009). <a rel="nofollow" class="external text" href="http://www.tgdaily.com/content/view/41316/139/">“Samsung hints to DDR4 with first validated 40 nm DRAM”</a>. tgdaily.com<span style="display:none;">. <a rel="nofollow" class="external free" href="http://www.tgdaily.com/content/view/41316/139/">http://www.tgdaily.com/content/view/41316/139/</a></span> <span class="reference-accessdate"><span title="">2009年6月16日</span>閲覧。</span></cite><span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Abook&rft.genre=bookitem&rft.btitle=Samsung+hints+to+DDR4+with+first+validated+40+nm+DRAM&rft.atitle=&rft.aulast=Gruener&rft.aufirst=Wolfgang&rft.au=Gruener%2C%26%2332%3BWolfgang&rft.date=February+4%2C+2009&rft.pub=tgdaily.com&rft_id=http%3A%2F%2Fwww.tgdaily.com%2Fcontent%2Fview%2F41316%2F139%2F&rfr_id=info:sid/ja.wikipedia.org:SDRAM"><span style="display: none;"> </span></span></span> </li> <li id="cite_note-15"><b><a href="#cite_ref-15">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">Jansen, Ng (January 20, 2009). “<a rel="nofollow" class="external text" href="http://www.dailytech.com/DDR3+Will+be+Cheaper+Faster+in+2009/article13977.htm">DDR3 Will be Cheaper, Faster in 2009</a>”.  dailytech.com. <span title="">2009年6月17日</span>閲覧。</cite></span> </li> <li id="cite_note-16"><b><a href="#cite_ref-16">^</a></b> <span class="reference-text"><a rel="nofollow" class="external text" href="http://www.techspot.com/news/41818-samsung-develops-ddr4-memory-up-to-40-more-efficient.html">Samsung develops DDR4 memory, up to 40% more efficient</a></span> </li> <li id="cite_note-17"><b><a href="#cite_ref-17">^</a></b> <span class="reference-text"><a rel="nofollow" class="external text" href="http://www.engadget.com/2011/01/04/samsung-develops-ddr4-memory-with-up-to-40-percent-better-energy/">Samsung develops DDR4 memory with up to 40 percent better energy efficiency than DDR3</a></span> </li> <li id="cite_note-18"><b><a href="#cite_ref-18">^</a></b> <span class="reference-text"><cite style="font-style:normal" class="citation news">Manion, Wayne (March 31, 2017). <a rel="nofollow" class="external text" href="https://techreport.com/news/31673/ddr5-will-boost-bandwidth-and-lower-power-consumption">“DDR5 will boost bandwidth and lower power consumption”</a>. Tech Report<span style="display:none;">. <a rel="nofollow" class="external free" href="https://techreport.com/news/31673/ddr5-will-boost-bandwidth-and-lower-power-consumption">https://techreport.com/news/31673/ddr5-will-boost-bandwidth-and-lower-power-consumption</a></span> <span class="reference-accessdate"><span title="">April 1, 2017</span>閲覧。</span></cite><span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Abook&rft.genre=bookitem&rft.btitle=DDR5+will+boost+bandwidth+and+lower+power+consumption&rft.atitle=&rft.aulast=Manion&rft.aufirst=Wayne&rft.au=Manion%2C%26%2332%3BWayne&rft.date=March+31%2C+2017&rft.pub=Tech+Report&rft_id=https%3A%2F%2Ftechreport.com%2Fnews%2F31673%2Fddr5-will-boost-bandwidth-and-lower-power-consumption&rfr_id=info:sid/ja.wikipedia.org:SDRAM"><span style="display: none;"> </span></span></span> </li> <li id="cite_note-:0-19"><b><a href="#cite_ref-:0_19-0">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">“<a rel="nofollow" class="external text" href="https://www.jedec.org/news/pressreleases/jedec-publishes-new-ddr5-standard-advancing-next-generation-high-performance">JEDEC Publishes New DDR5 Standard for Advancing Next-Generation High Performance Computing Systems</a>”. <span title="">2022年1月16日</span>閲覧。</cite></span> </li> <li id="cite_note-20"><b><a href="#cite_ref-20">^</a></b> <span class="reference-text"><cite class="citation web" style="font-style:normal">“<a rel="nofollow" class="external text" href="https://gigazine.net/news/20200717-ddr5-memory-standard/">次世代メモリの標準規格「DDR5」の最終仕様をJEDECが発表、DDR4から何が進化したのか？</a>”. <i>GIGAZINE</i>. <span title="">2020年7月30日</span>閲覧。</cite></span> </li> <li id="cite_note-eda-dramconsumer-21">^ <a href="#cite_ref-eda-dramconsumer_21-0"><sup><i><b>a</b></i></sup></a> <a href="#cite_ref-eda-dramconsumer_21-1"><sup><i><b>b</b></i></sup></a> <a href="#cite_ref-eda-dramconsumer_21-2"><sup><i><b>c</b></i></sup></a> <span class="reference-text"><cite class="citation web" style="font-style:normal">“<a rel="nofollow" class="external text" href="http://www.edadesignline.com/196900432?printableArticle=true">EDA DesignLine, januari 12, 2007, The outlook for DRAMs in consumer electronics</a>”. <span title="">2010年6月22日</span>閲覧。</cite> edadesignline.com<sup class="noprint Inline-Template nowrap">[<i><a href="/wiki/Wikipedia:%E5%87%BA%E5%85%B8%E3%82%92%E6%98%8E%E8%A8%98%E3%81%99%E3%82%8B#リンク切れの回避と修復" title="Wikipedia:出典を明記する"><span title="外部リンクがリンク切れとなっています。（2011年2月）">リンク切れ</span></a></i>]</sup></span> </li> <li id="cite_note-22"><b><a href="#cite_ref-22">^</a></b> <span class="reference-text"><cite style="font-style:normal" class="citation" id="CITEREFDean_Kent1998">Dean Kent (1998-10-24), <a rel="nofollow" class="external text" href="http://www.tomshardware.com/reviews/ram-guide,89-15.html"><i>RAM Guide: SLDRAM</i></a>, Tom's Hardware<span style="display:none;">, <a rel="nofollow" class="external free" href="http://www.tomshardware.com/reviews/ram-guide,89-15.html">http://www.tomshardware.com/reviews/ram-guide,89-15.html</a></span> <span class="reference-accessdate"><span title="">2011年1月1日</span>閲覧。</span></cite><span class="Z3988" title="ctx_ver=Z39.88-2004&rft_val_fmt=info%3Aofi%2Ffmt%3Akev%3Amtx%3Abook&rft.genre=book&rft.btitle=RAM+Guide%3A+SLDRAM&rft.aulast=Dean+Kent&rft.au=Dean+Kent&rft.date=1998-10-24&rft.pub=Tom%27s+Hardware&rft_id=http%3A%2F%2Fwww.tomshardware.com%2Freviews%2Fram-guide%2C89-15.html&rfr_id=info:sid/ja.wikipedia.org:SDRAM"><span style="display: none;"> </span></span></span> </li> <li id="cite_note-23"><b><a href="#cite_ref-23">^</a></b> <span class="reference-text"><a rel="nofollow" class="external text" href="http://citp.princeton.edu/memory">Cold Boot Attacks on Encryption Keys</a> Princeton University</span> </li> </ol></div> <div class="mw-heading mw-heading2"><h2 id="関連項目"><span id=".E9.96.A2.E9.80.A3.E9.A0.85.E7.9B.AE"></span>関連項目</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=SDRAM&action=edit&section=27" title="節を編集: 関連項目"><span>編集</span></a><span class="mw-editsection-bracket">]</span></span></div> <ul><li><a href="/wiki/%E3%83%87%E3%83%90%E3%82%A4%E3%82%B9%E5%B8%AF%E5%9F%9F%E5%B9%85%E3%81%AE%E4%B8%80%E8%A6%A7" title="デバイス帯域幅の一覧">デバイス帯域幅の一覧</a></li></ul> <div class="navbox" aria-labelledby="DRAMの種類" style="border-collapse:collapse;padding:3px"><table class="nowraplinks mw-collapsible autocollapse navbox-inner" style="background:transparent;color:inherit;min-width:100%;border-spacing:0px;border-collapse:separate"><tbody><tr><th scope="col" class="navbox-title" colspan="2"><div style="float:left;width:6em;text-align:left"><div class="noprint plainlinks navbar hlist" style="white-space:nowrap;font-size:60%;font-weight:normal;background-color:transparent;padding:0;color:#000;;border:none;"><ul style="display:inline"><li><a href="/wiki/Template:DRAM" title="Template:DRAM"><span title="このテンプレートを表示します" style="font-size:125%;;;border:none;">表</span></a></li><li><a href="/w/index.php?title=Template%E2%80%90%E3%83%8E%E3%83%BC%E3%83%88:DRAM&action=edit&redlink=1" class="new" title="Template‐ノート:DRAM (存在しないページ)"><span title="このテンプレートのノートを表示します" style="font-size:125%;color:#002bb8;;;border:none;">話</span></a></li><li><a class="external text" href="https://ja.wikipedia.org/w/index.php?title=Template%3ADRAM&action=edit"><span title="このテンプレートを編集します。保存の前にプレビューを忘れずに。" style="font-size:125%;color:#002bb8;;;border:none;">編</span></a></li><li><a class="external text" href="https://ja.wikipedia.org/w/index.php?title=Template%3ADRAM&action=history"><span title="このテンプレートの過去の版を表示します" style="font-size:125%;color:#002bb8;;;border:none;">歴</span></a></li></ul></div></div><div id="DRAMの種類" style="font-size:110%;margin:0 6em"><a href="/wiki/Dynamic_Random_Access_Memory" title="Dynamic Random Access Memory">DRAM</a>の種類</div></th></tr><tr><th scope="row" class="navbox-group" style="width:1%">非同期</th><td class="navbox-list navbox-odd hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/FPM_RAM" class="mw-redirect" title="FPM RAM">FPM RAM</a></li> <li><a href="/wiki/EDO_RAM" class="mw-redirect" title="EDO RAM">EDO RAM</a></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%">同期</th><td class="navbox-list navbox-even hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a class="mw-selflink selflink">SDRAM</a></li> <li><a href="/wiki/DDR_SDRAM" title="DDR SDRAM">DDR SDRAM</a> <ul><li><a href="/wiki/DDR2_SDRAM" title="DDR2 SDRAM">DDR2 SDRAM</a></li> <li><a href="/wiki/DDR3_SDRAM" title="DDR3 SDRAM">DDR3 SDRAM</a></li> <li><a href="/wiki/DDR4_SDRAM" title="DDR4 SDRAM">DDR4 SDRAM</a></li> <li><a href="/wiki/DDR5_SDRAM" title="DDR5 SDRAM">DDR5 SDRAM</a></li></ul></li> <li><a href="/wiki/LPDDR" title="LPDDR">LPDDR</a>（モバイル用DDR）</li> <li><span title="リンク先の項目はまだありません。新規の執筆や他言語版からの翻訳が望まれます。"><a href="/w/index.php?title=Fast_Cycle_DRAM&action=edit&redlink=1" class="new" title="Fast Cycle DRAM (存在しないページ)">Fast Cycle DRAM</a><span style="font-size: 0.77em; font-weight: normal;" class="noprint">（<a href="https://en.wikipedia.org/wiki/Fast_Cycle_DRAM" class="extiw" title="en:Fast Cycle DRAM">英語版</a>）</span></span>（FCRAM）</li> <li><a href="/wiki/EDRAM" title="EDRAM">eDRAM</a></li> <li><span title="リンク先の項目はまだありません。新規の執筆や他言語版からの翻訳が望まれます。"><a href="/w/index.php?title=RLDRAM&action=edit&redlink=1" class="new" title="RLDRAM (存在しないページ)">RLDRAM</a><span style="font-size: 0.77em; font-weight: normal;" class="noprint">（<a href="https://en.wikipedia.org/wiki/RLDRAM" class="extiw" title="en:RLDRAM">英語版</a>）</span></span></li> <li><a href="/wiki/High_Bandwidth_Memory" title="High Bandwidth Memory">HBM</a> <ul><li><a href="/wiki/High_Bandwidth_Memory#HBM_2" title="High Bandwidth Memory">HBM2</a></li> <li><a href="/wiki/High_Bandwidth_Memory#HBM_2" title="High Bandwidth Memory">HBM3</a></li></ul></li> <li><span title="リンク先の項目はまだありません。新規の執筆や他言語版からの翻訳が望まれます。"><a href="/w/index.php?title=Hybrid_Memory_Cube&action=edit&redlink=1" class="new" title="Hybrid Memory Cube (存在しないページ)">Hybrid Memory Cube</a><span style="font-size: 0.77em; font-weight: normal;" class="noprint">（<a href="https://en.wikipedia.org/wiki/Hybrid_Memory_Cube" class="extiw" title="en:Hybrid Memory Cube">英語版</a>）</span></span></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%">グラフィック</th><td class="navbox-list navbox-odd hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/VRAM" title="VRAM">VRAM</a></li> <li><a href="/w/index.php?title=WRAM&action=edit&redlink=1" class="new" title="WRAM (存在しないページ)">WRAM</a></li> <li><a href="/w/index.php?title=MDRAM&action=edit&redlink=1" class="new" title="MDRAM (存在しないページ)">MDRAM</a></li> <li><a href="/w/index.php?title=SGRAM&action=edit&redlink=1" class="new" title="SGRAM (存在しないページ)">SGRAM</a> <ul><li><a href="/wiki/GDDR" class="mw-disambig" title="GDDR">GDDR</a></li> <li><a href="/wiki/DDR2_SDRAM" title="DDR2 SDRAM">DDR2</a></li> <li><a href="/wiki/GDDR3" title="GDDR3">GDDR3</a></li> <li><a href="/wiki/GDDR4" title="GDDR4">GDDR4</a></li> <li><a href="/wiki/DDR3_SDRAM" title="DDR3 SDRAM">DDR3</a></li> <li><a href="/wiki/GDDR5" title="GDDR5">GDDR5</a></li> <li><a href="/wiki/GDDR6_SDRAM" title="GDDR6 SDRAM">GDDR6</a></li> <li><a href="/wiki/GDDR7_SDRAM" title="GDDR7 SDRAM">GDDR7</a></li></ul></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%"><a href="/wiki/%E3%83%A9%E3%83%A0%E3%83%90%E3%82%B9" title="ラムバス">ラムバス</a></th><td class="navbox-list navbox-even hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/RDRAM" title="RDRAM">RDRAM</a></li> <li><a href="/wiki/XDR_DRAM" title="XDR DRAM">XDR DRAM</a></li> <li><span title="リンク先の項目はまだありません。新規の執筆や他言語版からの翻訳が望まれます。"><a href="/w/index.php?title=XDR2_DRAM&action=edit&redlink=1" class="new" title="XDR2 DRAM (存在しないページ)">XDR2 DRAM</a><span style="font-size: 0.77em; font-weight: normal;" class="noprint">（<a href="https://en.wikipedia.org/wiki/XDR2_DRAM" class="extiw" title="en:XDR2 DRAM">英語版</a>）</span></span></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%"><a href="/wiki/%E3%83%A2%E3%82%B8%E3%83%A5%E3%83%BC%E3%83%AB" title="モジュール">モジュール</a></th><td class="navbox-list navbox-odd hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/SIMM" title="SIMM">SIMM</a></li> <li><a href="/wiki/DIMM" title="DIMM">DIMM</a></li> <li><a href="/wiki/SO-DIMM" title="SO-DIMM">SO-DIMM</a></li> <li><span title="リンク先の項目はまだありません。新規の執筆や他言語版からの翻訳が望まれます。"><a href="/w/index.php?title=UniDIMM&action=edit&redlink=1" class="new" title="UniDIMM (存在しないページ)">UniDIMM</a><span style="font-size: 0.77em; font-weight: normal;" class="noprint">（<a href="https://en.wikipedia.org/wiki/UniDIMM" class="extiw" title="en:UniDIMM">英語版</a>）</span></span></li> <li><a href="/wiki/Compression_Attached_Memory_Module" title="Compression Attached Memory Module">CAMM</a></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%">リスト</th><td class="navbox-list navbox-even hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/w/index.php?title=DRAM%E3%82%B9%E3%82%B1%E3%82%B8%E3%83%A5%E3%83%BC%E3%83%AB&action=edit&redlink=1" class="new" title="DRAMスケジュール (存在しないページ)">DRAMスケジュール</a></li> <li><a href="/w/index.php?title=SDRAM%E3%82%B9%E3%82%B1%E3%82%B8%E3%83%A5%E3%83%BC%E3%83%AB&action=edit&redlink=1" class="new" title="SDRAMスケジュール (存在しないページ)">SDRAMスケジュール</a></li> <li><a href="/wiki/%E5%B8%AF%E5%9F%9F%E5%B9%85" title="帯域幅">帯域幅</a></li> <li><a href="/w/index.php?title=%E3%83%88%E3%83%A9%E3%83%B3%E3%82%B8%E3%82%B9%E3%82%BF%E6%95%B0&action=edit&redlink=1" class="new" title="トランジスタ数 (存在しないページ)">トランジスタ数</a></li></ul> </div></td></tr></tbody></table></div> <div class="navbox" aria-labelledby="半導体メモリ" style="border-collapse:collapse;padding:3px"><table class="nowraplinks mw-collapsible autocollapse navbox-inner" style="background:transparent;color:inherit;min-width:100%;border-spacing:0px;border-collapse:separate"><tbody><tr><th scope="col" class="navbox-title" colspan="2"><div style="float:left;width:6em;text-align:left"><div class="noprint plainlinks navbar hlist" style="white-space:nowrap;font-size:60%;font-weight:normal;background-color:transparent;padding:0;color:#000;;border:none;"><ul style="display:inline"><li><a href="/wiki/Template:%E5%8D%8A%E5%B0%8E%E4%BD%93%E3%83%A1%E3%83%A2%E3%83%AA" title="Template:半導体メモリ"><span title="このテンプレートを表示します" style="font-size:125%;;;border:none;">表</span></a></li><li><a href="/wiki/Template%E2%80%90%E3%83%8E%E3%83%BC%E3%83%88:%E5%8D%8A%E5%B0%8E%E4%BD%93%E3%83%A1%E3%83%A2%E3%83%AA" title="Template‐ノート:半導体メモリ"><span title="このテンプレートのノートを表示します" style="font-size:125%;color:#002bb8;;;border:none;">話</span></a></li><li><a class="external text" href="https://ja.wikipedia.org/w/index.php?title=Template%3A%E5%8D%8A%E5%B0%8E%E4%BD%93%E3%83%A1%E3%83%A2%E3%83%AA&action=edit"><span title="このテンプレートを編集します。保存の前にプレビューを忘れずに。" style="font-size:125%;color:#002bb8;;;border:none;">編</span></a></li><li><a class="external text" href="https://ja.wikipedia.org/w/index.php?title=Template%3A%E5%8D%8A%E5%B0%8E%E4%BD%93%E3%83%A1%E3%83%A2%E3%83%AA&action=history"><span title="このテンプレートの過去の版を表示します" style="font-size:125%;color:#002bb8;;;border:none;">歴</span></a></li></ul></div></div><div id="半導体メモリ" style="font-size:110%;margin:0 6em"><a href="/wiki/%E5%8D%8A%E5%B0%8E%E4%BD%93%E3%83%A1%E3%83%A2%E3%83%AA" title="半導体メモリ">半導体メモリ</a></div></th></tr><tr><th scope="row" class="navbox-group" style="width:1%"><a href="/wiki/Read_only_memory" title="Read only memory">リードオンリーメモリ</a>（ROM）</th><td class="navbox-list navbox-odd hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/%E3%83%9E%E3%82%B9%E3%82%AFROM" title="マスクROM">マスクROM</a></li> <li><a href="/wiki/PROM" title="PROM">PROM</a></li> <li><a href="/wiki/EPROM" title="EPROM">EPROM</a></li> <li><a href="/wiki/UV-EPROM" title="UV-EPROM">UV-EPROM</a></li> <li><a href="/wiki/EEPROM" title="EEPROM">EEPROM</a></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%"><a href="/wiki/Random_Access_Memory" title="Random Access Memory">ランダムアクセスメモリ</a>（RAM）</th><td class="navbox-list navbox-even hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/Static_Random_Access_Memory" title="Static Random Access Memory">SRAM</a></li> <li><a href="/wiki/Dynamic_Random_Access_Memory" title="Dynamic Random Access Memory">DRAM</a> <ul><li><a href="/w/index.php?title=%E3%82%BC%E3%83%AD%E3%82%AD%E3%83%A3%E3%83%91%E3%82%B7%E3%82%BF%E3%83%BCRAM&action=edit&redlink=1" class="new" title="ゼロキャパシターRAM (存在しないページ)">Z-RAM</a></li> <li><a href="/w/index.php?title=%E3%82%AD%E3%83%A3%E3%83%91%E3%82%B7%E3%82%BF%E3%83%AC%E3%82%B9%E3%83%84%E3%82%A4%E3%83%B3%E3%82%BB%E3%83%AB%E3%83%88%E3%83%A9%E3%83%B3%E3%82%B8%E3%82%B9%E3%82%BF%E3%83%BCRAM&action=edit&redlink=1" class="new" title="キャパシタレスツインセルトランジスターRAM (存在しないページ)">TTRAM</a></li></ul></li> <li><a href="/wiki/NOR%E5%9E%8B%E3%83%95%E3%83%A9%E3%83%83%E3%82%B7%E3%83%A5%E3%83%A1%E3%83%A2%E3%83%AA" title="NOR型フラッシュメモリ">NOR型フラッシュメモリ</a></li> <li><a href="/wiki/%E5%BC%B7%E8%AA%98%E9%9B%BB%E4%BD%93%E3%83%A1%E3%83%A2%E3%83%AA" title="強誘電体メモリ">FeRAM</a> <ul><li><a href="/wiki/%E5%BC%B7%E8%AA%98%E9%9B%BB%E4%BD%93%E6%B5%AE%E9%81%8A%E3%82%B2%E3%83%BC%E3%83%88%E3%83%A1%E3%83%A2%E3%83%AA" title="強誘電体浮遊ゲートメモリ">FFRAM</a></li></ul></li> <li><a href="/wiki/%E7%A3%81%E6%B0%97%E6%8A%B5%E6%8A%97%E3%83%A1%E3%83%A2%E3%83%AA" title="磁気抵抗メモリ">MRAM</a> <ul><li><a href="/wiki/%E3%82%B9%E3%83%94%E3%83%B3%E6%B3%A8%E5%85%A5%E3%83%A1%E3%83%A2%E3%83%AA" title="スピン注入メモリ">STT-RAM</a></li></ul></li> <li><a href="/wiki/%E7%9B%B8%E5%A4%89%E5%8C%96%E3%83%A1%E3%83%A2%E3%83%AA" title="相変化メモリ">PCRAM</a></li> <li><a href="/wiki/%E6%8A%B5%E6%8A%97%E5%A4%89%E5%8C%96%E5%9E%8B%E3%83%A1%E3%83%A2%E3%83%AA" title="抵抗変化型メモリ">ReRAM</a> <ul><li><a href="/w/index.php?title=OXRAM&action=edit&redlink=1" class="new" title="OXRAM (存在しないページ)">OXRAM</a></li> <li><a href="/w/index.php?title=%E4%BC%9D%E5%B0%8E%E3%83%96%E3%83%AA%E3%83%83%E3%82%B8%E5%9E%8B%E3%83%A1%E3%83%A2%E3%83%AA&action=edit&redlink=1" class="new" title="伝導ブリッジ型メモリ (存在しないページ)">CBRAM</a></li></ul></li> <li><a href="/w/index.php?title=Nano-RAM&action=edit&redlink=1" class="new" title="Nano-RAM (存在しないページ)">NRAM</a></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%"><a href="/wiki/%E6%8F%AE%E7%99%BA%E6%80%A7%E3%83%A1%E3%83%A2%E3%83%AA" title="揮発性メモリ">揮発性メモリ</a>（VM）</th><td class="navbox-list navbox-odd hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/Static_Random_Access_Memory" title="Static Random Access Memory">SRAM</a></li> <li><a href="/wiki/Dynamic_Random_Access_Memory" title="Dynamic Random Access Memory">DRAM</a> <ul><li><a href="/w/index.php?title=%E3%82%BC%E3%83%AD%E3%82%AD%E3%83%A3%E3%83%91%E3%82%B7%E3%82%BF%E3%83%BCRAM&action=edit&redlink=1" class="new" title="ゼロキャパシターRAM (存在しないページ)">Z-RAM</a></li> <li><a href="/w/index.php?title=%E3%82%AD%E3%83%A3%E3%83%91%E3%82%B7%E3%82%BF%E3%83%AC%E3%82%B9%E3%83%84%E3%82%A4%E3%83%B3%E3%82%BB%E3%83%AB%E3%83%88%E3%83%A9%E3%83%B3%E3%82%B8%E3%82%B9%E3%82%BF%E3%83%BCRAM&action=edit&redlink=1" class="new" title="キャパシタレスツインセルトランジスターRAM (存在しないページ)">TTRAM</a></li></ul></li></ul> </div></td></tr><tr><th scope="row" class="navbox-group" style="width:1%"><a href="/wiki/%E4%B8%8D%E6%8F%AE%E7%99%BA%E6%80%A7%E3%83%A1%E3%83%A2%E3%83%AA" title="不揮発性メモリ">不揮発性メモリ</a>（<a href="/wiki/%E4%B8%8D%E6%8F%AE%E7%99%BA%E6%80%A7%E3%83%A1%E3%83%A2%E3%83%AA" title="不揮発性メモリ">NVM</a>）</th><td class="navbox-list navbox-even hlist" style="text-align:left;border-left-width:2px;border-left-style:solid;width:100%;padding:0px"><div style="padding:0em 0.25em"> <ul><li><a href="/wiki/PROM" title="PROM">PROM</a></li> <li><a href="/w/index.php?title=EAROM&action=edit&redlink=1" class="new" title="EAROM (存在しないページ)">EAROM</a></li> <li><a href="/wiki/EPROM" title="EPROM">EPROM</a></li> <li><a href="/wiki/EEPROM" title="EEPROM">EEPROM</a></li> <li><a href="/wiki/%E3%83%95%E3%83%A9%E3%83%83%E3%82%B7%E3%83%A5%E3%83%A1%E3%83%A2%E3%83%AA" title="フラッシュメモリ">フラッシュメモリ</a> <ul><li><a href="/wiki/NOR%E5%9E%8B%E3%83%95%E3%83%A9%E3%83%83%E3%82%B7%E3%83%A5%E3%83%A1%E3%83%A2%E3%83%AA" title="NOR型フラッシュメモリ">NOR型フラッシュメモリ</a></li> <li><a href="/wiki/NAND%E5%9E%8B%E3%83%95%E3%83%A9%E3%83%83%E3%82%B7%E3%83%A5%E3%83%A1%E3%83%A2%E3%83%AA" title="NAND型フラッシュメモリ">NAND型フラッシュメモリ</a></li> <li><a href="/w/index.php?title=MONOS%E5%9E%8B%E3%83%A1%E3%83%A2%E3%83%AA&action=edit&redlink=1" class="new" title="MONOS型メモリ (存在しないページ)">MONOS型メモリ</a></li> <li><a href="/w/index.php?title=SONOS%E5%9E%8B%E3%83%A1%E3%83%A2%E3%83%AA&action=edit&redlink=1" class="new" title="SONOS型メモリ (存在しないページ)">SONOS型メモリ</a></li> <li><a href="/w/index.php?title=%E3%83%8A%E3%83%8E%E3%82%AF%E3%83%AA%E3%82%B9%E3%82%BF%E3%83%AB%E3%83%A1%E3%83%A2%E3%83%AA&action=edit&redlink=1" class="new" title="ナノクリスタルメモリ (存在しないページ)">ナノクリスタルメモリ</a></li></ul></li> <li><a href="/wiki/%E5%BC%B7%E8%AA%98%E9%9B%BB%E4%BD%93%E3%83%A1%E3%83%A2%E3%83%AA" title="強誘電体メモリ">FeRAM</a> <ul><li><a href="/wiki/%E5%BC%B7%E8%AA%98%E9%9B%BB%E4%BD%93%E6%B5%AE%E9%81%8A%E3%82%B2%E3%83%BC%E3%83%88%E3%83%A1%E3%83%A2%E3%83%AA" title="強誘電体浮遊ゲートメモリ">FFRAM</a></li></ul></li> <li><a href="/wiki/%E7%A3%81%E6%B0%97%E6%8A%B5%E6%8A%97%E3%83%A1%E3%83%A2%E3%83%AA" title="磁気抵抗メモリ">MRAM</a> <ul><li><a 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