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<!DOCTYPE html> <html class="client-nojs" lang="de" dir="ltr"> <head> <meta charset="UTF-8"> <title>Intel ICH – Wikipedia</title> <script>(function(){var className="client-js";var cookie=document.cookie.match(/(?:^|; )dewikimwclientpreferences=([^;]+)/);if(cookie){cookie[1].split('%2C').forEach(function(pref){className=className.replace(new RegExp('(^| )'+pref.replace(/-clientpref-\w+$|[^\w-]+/g,'')+'-clientpref-\\w+( |$)'),'$1'+pref+'$2');});}document.documentElement.className=className;}());RLCONF={"wgBreakFrames":false,"wgSeparatorTransformTable":[",\t.",".\t,"],"wgDigitTransformTable":["",""],"wgDefaultDateFormat":"dmy","wgMonthNames":["","Januar","Februar","März","April","Mai","Juni","Juli","August","September","Oktober","November","Dezember"],"wgRequestId":"85c7b8f7-57db-4afc-b5e5-b654a9716c28","wgCanonicalNamespace":"","wgCanonicalSpecialPageName":false,"wgNamespaceNumber":0,"wgPageName":"Intel_ICH","wgTitle":"Intel ICH","wgCurRevisionId":219075815,"wgRevisionId":219075815,"wgArticleId":2933142,"wgIsArticle":true,"wgIsRedirect":false,"wgAction":"view","wgUserName":null,"wgUserGroups":["*"],"wgCategories":[ "Chipsatz"],"wgPageViewLanguage":"de","wgPageContentLanguage":"de","wgPageContentModel":"wikitext","wgRelevantPageName":"Intel_ICH","wgRelevantArticleId":2933142,"wgIsProbablyEditable":true,"wgRelevantPageIsProbablyEditable":true,"wgRestrictionEdit":[],"wgRestrictionMove":[],"wgNoticeProject":"wikipedia","wgCiteReferencePreviewsActive":true,"wgFlaggedRevsParams":{"tags":{"accuracy":{"levels":1}}},"wgStableRevisionId":219075815,"wgMediaViewerOnClick":true,"wgMediaViewerEnabledByDefault":true,"wgPopupsFlags":0,"wgVisualEditor":{"pageLanguageCode":"de","pageLanguageDir":"ltr","pageVariantFallbacks":"de"},"wgMFDisplayWikibaseDescriptions":{"search":true,"watchlist":true,"tagline":true,"nearby":true},"wgWMESchemaEditAttemptStepOversample":false,"wgWMEPageLength":20000,"wgRelatedArticlesCompat":[],"wgEditSubmitButtonLabelPublish":true,"wgULSPosition":"interlanguage","wgULSisCompactLinksEnabled":true,"wgVector2022LanguageInHeader":false,"wgULSisLanguageSelectorEmpty":false,"wgWikibaseItemId": "Q657492","wgCheckUserClientHintsHeadersJsApi":["brands","architecture","bitness","fullVersionList","mobile","model","platform","platformVersion"],"GEHomepageSuggestedEditsEnableTopics":true,"wgGETopicsMatchModeEnabled":false,"wgGEStructuredTaskRejectionReasonTextInputEnabled":false,"wgGELevelingUpEnabledForUser":false};RLSTATE={"ext.gadget.citeRef":"ready","ext.gadget.defaultPlainlinks":"ready","ext.gadget.dewikiCommonHide":"ready","ext.gadget.dewikiCommonLayout":"ready","ext.gadget.dewikiCommonStyle":"ready","ext.gadget.NavFrame":"ready","ext.globalCssJs.user.styles":"ready","site.styles":"ready","user.styles":"ready","ext.globalCssJs.user":"ready","user":"ready","user.options":"loading","ext.cite.styles":"ready","skins.vector.styles.legacy":"ready","ext.flaggedRevs.basic":"ready","mediawiki.codex.messagebox.styles":"ready","ext.visualEditor.desktopArticleTarget.noscript":"ready","codex-search-styles":"ready","ext.uls.interlanguage":"ready","wikibase.client.init":"ready", "ext.wikimediaBadges":"ready"};RLPAGEMODULES=["ext.cite.ux-enhancements","mediawiki.page.media","site","mediawiki.page.ready","mediawiki.toc","skins.vector.legacy.js","ext.centralNotice.geoIP","ext.centralNotice.startUp","ext.flaggedRevs.advanced","ext.gadget.createNewSection","ext.gadget.WikiMiniAtlas","ext.gadget.OpenStreetMap","ext.gadget.CommonsDirekt","ext.gadget.donateLink","ext.urlShortener.toolbar","ext.centralauth.centralautologin","mmv.bootstrap","ext.popups","ext.visualEditor.desktopArticleTarget.init","ext.visualEditor.targetLoader","ext.echo.centralauth","ext.eventLogging","ext.wikimediaEvents","ext.navigationTiming","ext.uls.compactlinks","ext.uls.interface","ext.cx.eventlogging.campaigns","ext.checkUser.clientHints","ext.growthExperiments.SuggestedEditSession","wikibase.sidebar.tracking"];</script> <script>(RLQ=window.RLQ||[]).push(function(){mw.loader.impl(function(){return["user.options@12s5i",function($,jQuery,require,module){mw.user.tokens.set({"patrolToken":"+\\","watchToken":"+\\","csrfToken":"+\\"}); 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Es handelt sich um hochintegrierte Schaltkreise, die beispielsweise in <a href="/wiki/Ball_Grid_Array" title="Ball Grid Array">BGA</a>-Gehäusen untergebracht sind (ICH9M-SSF z. B. 16 × 16 mm mit 569 Lotperlen). </p><p>Der Begriff wird von der Firma <a href="/wiki/Intel" title="Intel">Intel</a> als Synonym für <a href="/wiki/Southbridge" title="Southbridge">Southbridge</a> (eine Komponente der <a href="/wiki/Personal_Computer" title="Personal Computer">Computer</a>-Architektur) benutzt. </p> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/Datei:Intel_ICH2.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/a/ab/Intel_ICH2.jpg/220px-Intel_ICH2.jpg" decoding="async" width="220" height="220" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/a/ab/Intel_ICH2.jpg/330px-Intel_ICH2.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/a/ab/Intel_ICH2.jpg/440px-Intel_ICH2.jpg 2x" data-file-width="1017" data-file-height="1017" /></a><figcaption>Intel 82801 (ICH2)</figcaption></figure> <div id="toc" class="toc" role="navigation" aria-labelledby="mw-toc-heading"><input type="checkbox" role="button" id="toctogglecheckbox" class="toctogglecheckbox" style="display:none" /><div class="toctitle" lang="de" dir="ltr"><h2 id="mw-toc-heading">Inhaltsverzeichnis</h2><span class="toctogglespan"><label class="toctogglelabel" for="toctogglecheckbox"></label></span></div> <ul> <li class="toclevel-1 tocsection-1"><a href="#Hintergründe"><span class="tocnumber">1</span> <span class="toctext">Hintergründe</span></a></li> <li class="toclevel-1 tocsection-2"><a href="#Produktgeschichte"><span class="tocnumber">2</span> <span class="toctext">Produktgeschichte</span></a> <ul> <li class="toclevel-2 tocsection-3"><a href="#ICH"><span class="tocnumber">2.1</span> <span class="toctext">ICH</span></a></li> <li class="toclevel-2 tocsection-4"><a href="#ICH0"><span class="tocnumber">2.2</span> <span class="toctext">ICH0</span></a></li> <li class="toclevel-2 tocsection-5"><a href="#ICH2"><span class="tocnumber">2.3</span> <span class="toctext">ICH2</span></a></li> <li class="toclevel-2 tocsection-6"><a href="#ICH3"><span class="tocnumber">2.4</span> <span class="toctext">ICH3</span></a></li> <li class="toclevel-2 tocsection-7"><a href="#ICH4"><span class="tocnumber">2.5</span> <span class="toctext">ICH4</span></a></li> <li class="toclevel-2 tocsection-8"><a href="#ICH5"><span class="tocnumber">2.6</span> <span class="toctext">ICH5</span></a></li> <li class="toclevel-2 tocsection-9"><a href="#ICH6"><span class="tocnumber">2.7</span> <span class="toctext">ICH6</span></a></li> <li class="toclevel-2 tocsection-10"><a href="#ICH7"><span class="tocnumber">2.8</span> <span class="toctext">ICH7</span></a></li> <li class="toclevel-2 tocsection-11"><a href="#ICH8"><span class="tocnumber">2.9</span> <span class="toctext">ICH8</span></a></li> <li class="toclevel-2 tocsection-12"><a href="#ICH9"><span class="tocnumber">2.10</span> <span class="toctext">ICH9</span></a></li> <li class="toclevel-2 tocsection-13"><a href="#ICH10"><span class="tocnumber">2.11</span> <span class="toctext">ICH10</span></a></li> </ul> </li> <li class="toclevel-1 tocsection-14"><a href="#Kombinationen"><span class="tocnumber">3</span> <span class="toctext">Kombinationen</span></a></li> <li class="toclevel-1 tocsection-15"><a href="#Modellübersicht"><span class="tocnumber">4</span> <span class="toctext">Modellübersicht</span></a></li> <li class="toclevel-1 tocsection-16"><a href="#Einzelnachweise"><span class="tocnumber">5</span> <span class="toctext">Einzelnachweise</span></a></li> </ul> </div> <div class="mw-heading mw-heading2"><h2 id="Hintergründe"><span id="Hintergr.C3.BCnde"></span>Hintergründe</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=1" title="Abschnitt bearbeiten: Hintergründe" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=1" title="Quellcode des Abschnitts bearbeiten: Hintergründe"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Der i82801 wurde <a href="/wiki/1998" title="1998">1998</a> von Intel als Southbridge für zukünftige Chipsätze nach der Zeit der sehr erfolgreichen BX-<a href="/wiki/Northbridge" title="Northbridge">Northbridge</a> 82443 entwickelt. Anders als sein Vorgänger 82371 (PIIX) ist der 82801 nicht mehr über einen internen <a href="/wiki/Peripheral_Component_Interconnect" title="Peripheral Component Interconnect">PCI</a>-Bus mit 133 MByte/s, sondern über eine proprietäre Schnittstelle, die von Intel <i>Hub Interface</i> genannt wurde, mit 266 MByte/s (Busbreite 8 Bit) an seine Northbridge angeschlossen. Das Hub-Interface ist eine Punkt-zu-Punkt-Verbindung zwischen verschiedenen Komponenten auf der Hauptplatine. Hintergedanke war, weg von der starren Nord-Süd-Achse auf der Hauptplatine hin zu einer eher sternförmig orientierten Struktur zu kommen. Parallel zum ICH wurden daher zahlreiche weitere "Hubs" entwickelt: Die bisherige Northbridge wurde zum <a href="/wiki/Memory_Controller_Hub" title="Memory Controller Hub">Memory Controller Hub</a> (MCH). Wenn sie zusätzlich einen Grafikkern integriert, spricht man vom <a href="/wiki/Memory_Controller_Hub" title="Memory Controller Hub">Graphics and Memory Controller Hub</a> (GMCH). Für den Server-Einsatz konnte der ICH über das Hub Interface um den Chip 82806 ergänzt werden, der zusätzliche PCI-64-Ports bereitstellt. Der klassische <a href="/wiki/BIOS" title="BIOS">BIOS</a>-Flashbaustein wurde mit einem Hardware-Zufallszahlengenerator (basierend auf thermischem Rauschen) aufgewertet und fortan <a href="/w/index.php?title=Firmware_Hub&action=edit&redlink=1" class="new" title="Firmware Hub (Seite nicht vorhanden)">Firmware Hub</a> (FWH) genannt. Mit der neuen Northbridge 82820 setzte Intel voll auf das damals ebenso moderne wie teure <a href="/wiki/Rambus_Dynamic_Random_Access_Memory" title="Rambus Dynamic Random Access Memory">Rambus DRAM</a>. Um auf Server-Hauptplatinen mehr Arbeitsspeicher unterbringen zu können, gab es den 82803 <a href="/w/index.php?title=Memory_Repeater_Hub&action=edit&redlink=1" class="new" title="Memory Repeater Hub (Seite nicht vorhanden)">Memory Repeater Hub</a> (MRH), mit dem ein Rambus-Kanal auf zwei Kanäle aufgesplittet werden kann. Auf Druck der Hauptplatinen-Hersteller wurden ein <a href="/w/index.php?title=Memory_Translator_Hub&action=edit&redlink=1" class="new" title="Memory Translator Hub (Seite nicht vorhanden)">Memory Translator Hub</a> (MTH) und ein MRH-S entwickelt, um dennoch weiterhin Hauptplatinen für <a href="/wiki/SDRAM" class="mw-redirect" title="SDRAM">SDRAM</a> bauen zu können. Die Chips funktionierten jedoch nie völlig problemfrei und mussten schließlich begraben werden. </p> <div class="mw-heading mw-heading2"><h2 id="Produktgeschichte">Produktgeschichte</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=2" title="Abschnitt bearbeiten: Produktgeschichte" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=2" title="Quellcode des Abschnitts bearbeiten: Produktgeschichte"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <div class="mw-heading mw-heading3"><h3 id="ICH">ICH</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=3" title="Abschnitt bearbeiten: ICH" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=3" title="Quellcode des Abschnitts bearbeiten: ICH"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/Datei:Asus_P3C2000_-_Intel_FW82801AA-8642.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/9/96/Asus_P3C2000_-_Intel_FW82801AA-8642.jpg/220px-Asus_P3C2000_-_Intel_FW82801AA-8642.jpg" decoding="async" width="220" height="220" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/9/96/Asus_P3C2000_-_Intel_FW82801AA-8642.jpg/330px-Asus_P3C2000_-_Intel_FW82801AA-8642.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/9/96/Asus_P3C2000_-_Intel_FW82801AA-8642.jpg/440px-Asus_P3C2000_-_Intel_FW82801AA-8642.jpg 2x" data-file-width="3384" data-file-height="3384" /></a><figcaption>82801AA</figcaption></figure> <p>Die erste Version des <b>ICH</b> (82801AA) hat 241 Pins und unterstützt bis zu sechs PCI-Geräte, <a href="/wiki/ATA/ATAPI" title="ATA/ATAPI">ATA/66</a>, zwei <a href="/wiki/Universal_Serial_Bus" title="Universal Serial Bus">USB</a>-1.1-Ports und die damals noch jungen Standards <a href="/wiki/Advanced_Configuration_and_Power_Interface" title="Advanced Configuration and Power Interface">ACPI</a> und <a href="/wiki/Advanced_Programmable_Interrupt_Controller" title="Advanced Programmable Interrupt Controller">APIC</a>. Erstmals wurde eine <a href="/wiki/AC%E2%80%9997" title="AC’97">AC97</a>-basierte 3-Kanal-Soundlösung in die Southbridge integriert. Da es keine PCI-Verbindung mehr zwischen North- und Southbridge gab, wurde der PCI-<a href="/wiki/Arbiter" title="Arbiter">Arbiter</a> in den ICH verlegt. Zur damaligen Zeit verfolgten Intel und Microsoft mit Nachdruck die <i>Legacy-free</i>-Initiative, in deren Rahmen man veraltete Schnittstellen wie den ISA-Bus und <a href="/wiki/RS-232" title="RS-232">RS-232</a> durch moderne Anschlüsse ersetzen wollte. „Altlasten“ wie <a href="/wiki/Industry_Standard_Architecture" title="Industry Standard Architecture">ISA-Bus</a>, Super-I/O-Chips (für Tastatur, Maus, parallele Schnittstellen etc.) lassen sich über eine standardisierte <a href="/wiki/Low_Pin_Count" title="Low Pin Count">LPC-Schnittstelle</a> an den ICH anschließen. Auch der bereits angesprochene Firmware Hub fand hier seinen Platz. </p> <div class="mw-heading mw-heading3"><h3 id="ICH0">ICH0</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=4" title="Abschnitt bearbeiten: ICH0" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=4" title="Quellcode des Abschnitts bearbeiten: ICH0"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Für den Einsatz auf Niedrigpreis-Hauptplatinen mit <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i810</a>-Northbridge entwickelte Intel eine abgespeckte Variante des ICH, den <b>ICH0</b> (82801AB). Er ist auf ATA/33 und vier PCI-Geräte beschränkt und beherrscht kein <a href="/wiki/Wake_On_LAN" title="Wake On LAN">Wake on LAN</a>. </p> <div class="mw-heading mw-heading3"><h3 id="ICH2">ICH2</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=5" title="Abschnitt bearbeiten: ICH2" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=5" title="Quellcode des Abschnitts bearbeiten: ICH2"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Im Jahr <a href="/wiki/2000" title="2000">2000</a> hatte Intel mit der Northbridge <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i820</a> Schiffbruch erlitten. Die Kunden waren nicht bereit, die hohen Preise für <a href="/wiki/Rambus_Dynamic_Random_Access_Memory" title="Rambus Dynamic Random Access Memory">RDRAM</a> zu bezahlen und kauften entweder billige i810-Hauptplatinen oder wechselten zur Konkurrenz. Besonders <a href="/wiki/VIA_Technologies" title="VIA Technologies">VIA Technologies</a> konnte mit den <a href="/wiki/VIA_Apollo_Pro" title="VIA Apollo Pro">Apollo-Pro-Chipsätzen</a> einige Erfolge feiern. </p><p>Die eilig entwickelte Northbridge <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i815</a> für PC-133 SDRAM wurde Intels Rettungsanker im Mittelklasse-Segment. Ihr konnte wahlweise der ICH oder der neue <b>ICH2</b> (82801BA) mit 360 Pins zur Seite gestellt werden. Erstmals wurde ein Fast-<a href="/wiki/Ethernet" title="Ethernet">Ethernet</a>-Chip (82559) in die Southbridge integriert, der jedoch einen externen <a href="/wiki/PHY" title="PHY">PHY-Chip</a> benötigte, um die Verbindung nach außen herstellen zu können. Die <a href="/wiki/ATA/ATAPI" title="ATA/ATAPI">ATA/ATAPI</a>-Schnittstelle wurde auf ATA/100 beschleunigt und die Anzahl der USB-Anschlüsse auf vier verdoppelt. Der Soundchip beherrscht nun 6-Kanal-Klang. </p><p>Von diesem Chip gab es auch eine mobile Variante <b>ICH2-M</b> (82801BAM), die ihren Teil zur Verlängerung der Akkulaufzeiten in <a href="/wiki/Notebook" title="Notebook">Notebooks</a> beiträgt. Sie unterstützt einige weitere ACPI-Energiesparmodi, die über die normalen Fähigkeiten des 82801BA hinausgehen, Intels <a href="/wiki/Intel-SpeedStep-Technologie" title="Intel-SpeedStep-Technologie">SpeedStep</a>, und kann den Takt der angeschlossenen PCI-Geräte bei Bedarf senken, um noch mehr Energie zu sparen. </p> <div class="mw-heading mw-heading3"><h3 id="ICH3">ICH3</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=6" title="Abschnitt bearbeiten: ICH3" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=6" title="Quellcode des Abschnitts bearbeiten: ICH3"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Der 2001 erschienene ICH3 war in einer Server-Version <b>ICH3-S</b> (82801CA) im Gespann mit der Northbridge E7501 und in der Mobilversion <b>ICH3-M</b> (82801CAM) erhältlich, die mit den Northbridges <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i830</a> und später der <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">Mobile-i845</a> verkauft wurde. Es existiert keine Variante für Desktop-Hauptplatinen. Im Vergleich zum ICH2 beschränken sich die Änderungen auf Details: Der ATA/ATAPI-Controller unterstützt jetzt den <i>Native Mode</i>, es können bis zu sechs USB-1.1-Geräte angeschlossen werden, <a href="/wiki/SMBus" class="mw-redirect" title="SMBus">SMBus</a> 2.0 und die neueste SpeedStep-Version werden unterstützt, und nicht benötigte Geräte können im laufenden Betrieb abgeschaltet werden. Der Chip hat 421 Pins. </p> <div class="mw-heading mw-heading3"><h3 id="ICH4">ICH4</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=7" title="Abschnitt bearbeiten: ICH4" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=7" title="Quellcode des Abschnitts bearbeiten: ICH4"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Der <b>ICH4</b> (82801DB) war Intels Southbridge für das Jahr 2002. Wichtigste Neuerung war die Unterstützung von USB 2.0 auf allen sechs Ports. Der Soundchip wurde überarbeitet und entsprach der neuesten <a href="/wiki/AC97" class="mw-redirect" title="AC97">AC97</a>-Spezifikation, Version 2.3. Wie die Vorgängergeneration hat der ICH4 421 Pins. Von dieser Southbridge gab es erneut eine Mobilversion <b>ICH4-M</b> (82801DBM). </p> <div class="mw-heading mw-heading3"><h3 id="ICH5">ICH5</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=8" title="Abschnitt bearbeiten: ICH5" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=8" title="Quellcode des Abschnitts bearbeiten: ICH5"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Mit den Northbridges <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i865</a> und <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i875</a> wurde 2003 der <b>ICH5</b> (82801EB) eingesetzt. Neu war ein integrierter <a href="/wiki/Serial_ATA" title="Serial ATA">Serial-ATA</a>-(SATA)-Hostcontroller. Die Variante <b>ICH5R</b> (82801ER) beherrscht zusätzlich das Intel-spezifische <i><a href="/wiki/RAID#Matrix-RAID" title="RAID">Matrix-RAID</a></i> mit RAID 0 und RAID 1 auf den SATA-Ports. Es stehen acht USB-2.0-Ports zur Verfügung. Der Chip unterstützt nun vollständig ACPI 2.0. Er hat 460 Pins. </p><p>Das 1999 eingeführte Hub-Interface mit einer Datenrate von 266 MByte/s entwickelte sich zunehmend zum Flaschenhals. In der neuen Chipsatz-Generation bot Intel daher einen optionalen Port von einem Gigabit-Ethernet-Controller direkt zum <a href="/wiki/Memory_Controller_Hub" title="Memory Controller Hub">MCH</a> an. Ziel dieser <i>Communication Streaming Architecture</i> genannten Technik war einerseits, die Latenzen für Gigabit-LAN durch direkten Speicherzugang zu verringern, und anderseits das an die Grenzen seiner Leistungsfähigkeit stoßende Hub-Interface zwischen ICH und MCH so weit wie möglich für Festplatten- und PCI-Datenverkehr freizuhalten. </p><p>Seit Mitte 2004 bemerkten vor allem die großen Hauptplatinen-Hersteller eine erhöhte Reklamationsquote bei mit ICH5 ausgestatteten Hauptplatinen. Ursache war die ungenügende <a href="/wiki/Elektrostatische_Entladung" title="Elektrostatische Entladung">ESD</a>-Festigkeit bestimmter ICH5-Chargen.<sup id="cite_ref-1" class="reference"><a href="#cite_note-1"><span class="cite-bracket">[</span>1<span class="cite-bracket">]</span></a></sup> Insbesondere beim Anschluss von USB-Geräten über Frontpanels starben die Chips reihenweise durch Entladungen statischer Elektrizität. Intel reagierte später auf das Problem, indem nur noch ICH5 mit erhöhter ESD-Toleranz ausgeliefert wurden. Unabhängig davon sind effektive ESD-Schutzmaßnahmen an USB-Ports aber ohnehin nur schwer und unter Kostenaufwand zu realisieren, da sie leicht auf die Signalqualität des USB-2.0-Highspeed-Signals durchschlagen können. Bei Frontpanel-USB-Anschlüssen werden die notwendigen hochqualitativen Sicherungen daher auch gerne aus Kostengründen weggelassen. </p> <div class="mw-heading mw-heading3"><h3 id="ICH6">ICH6</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=9" title="Abschnitt bearbeiten: ICH6" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=9" title="Quellcode des Abschnitts bearbeiten: ICH6"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Der <b>ICH6</b> (82801FB) war Intels erste <a href="/wiki/PCI_Express" title="PCI Express">PCI-Express</a>-Southbridge. Er stellt vier PCI-Express-x1-Ports zur Verfügung. Schnelle x16-Ports für PEG-Grafikkarten waren im MCH untergebracht. Der Flaschenhals Hub-Interface wurde durch ein neues <i>Direct Media Interface</i> (DMI) mit 1 GByte/s pro Richtung ersetzt. Neu ist Unterstützung für <a href="/wiki/High_Definition_Audio_Interface" title="High Definition Audio Interface">HDA</a>. Aber auch <a href="/wiki/AC97" class="mw-redirect" title="AC97">AC97</a> und das klassische PCI 2.3 werden noch im gewohnten Umfang unterstützt. Den zwei zusätzlichen SATA-Ports fiel allerdings ein ATA/ATAPI-Kanal zum Opfer. Die Variante <b>ICH6R</b> (82801FR) unterstützt wie gehabt das Intel-spezifische <i><a href="/wiki/RAID#Matrix-RAID" title="RAID">Matrix RAID</a></i> mit RAID 0, RAID 1 sowie zusätzlich RAID 10. Der SATA-Controller des ICH6R und der Mobilversion des ICH6, dem <b>ICH6-M</b> (82801FBM), beherrscht <a href="/wiki/Advanced_Host_Controller_Interface" title="Advanced Host Controller Interface">AHCI</a>. Die Chips haben 652 Pins. </p><p>Ursprünglich hatte Intel geplant, zwei weitere Varianten unter den Namen ICH6W und ICH6RW auf den Markt zu bringen, die einen Software-Accesspoint für Wireless-LAN enthalten sollten. Diese Chips sind schlussendlich nicht erschienen. </p> <div class="mw-heading mw-heading3"><h3 id="ICH7">ICH7</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=10" title="Abschnitt bearbeiten: ICH7" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=10" title="Quellcode des Abschnitts bearbeiten: ICH7"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/Datei:Asus_P5PL2_-_Intel_NH82801GB_-_SL8FX-93719.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/6/6d/Asus_P5PL2_-_Intel_NH82801GB_-_SL8FX-93719.jpg/220px-Asus_P5PL2_-_Intel_NH82801GB_-_SL8FX-93719.jpg" decoding="async" width="220" height="220" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/6/6d/Asus_P5PL2_-_Intel_NH82801GB_-_SL8FX-93719.jpg/330px-Asus_P5PL2_-_Intel_NH82801GB_-_SL8FX-93719.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/6/6d/Asus_P5PL2_-_Intel_NH82801GB_-_SL8FX-93719.jpg/440px-Asus_P5PL2_-_Intel_NH82801GB_-_SL8FX-93719.jpg 2x" data-file-width="3814" data-file-height="3814" /></a><figcaption>ICH7 NH82801GB</figcaption></figure> <p>Der <b>ICH7</b> (82801GB) kam ab Mitte 2005 gemeinsam mit Intels neuestem Highend-MCH zum Einsatz, dem <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i955X</a>. Neu hinzugekommen sind zwei zusätzliche PCI-Express-x1-Ports, ein beschleunigter SATA-Controller für bis zu 300 MB/s Übertragungsrate sowie Unterstützung für Intels <i>Active Management Technology</i>. Der <b>ICH7R</b> (82801GR) beherrscht nun zusätzlich auch RAID 5. </p><p>Auch der ICH7 ist in einer „mobile“ Variante erhältlich, als ICH7-M (82801GBM) und ICH7-M DH (Digital Home) als 82801GHM, des Weiteren die Variante ICH7-U (Ultra) als 82801GU. Die "mobile" Varianten unterstützen kein Sata-II. </p> <div class="mw-heading mw-heading3"><h3 id="ICH8">ICH8</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=11" title="Abschnitt bearbeiten: ICH8" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=11" title="Quellcode des Abschnitts bearbeiten: ICH8"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/Datei:Intel_NH82801HBM_SLB9A_Southbridge-2408.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/5/5c/Intel_NH82801HBM_SLB9A_Southbridge-2408.jpg/220px-Intel_NH82801HBM_SLB9A_Southbridge-2408.jpg" decoding="async" width="220" height="220" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/5/5c/Intel_NH82801HBM_SLB9A_Southbridge-2408.jpg/330px-Intel_NH82801HBM_SLB9A_Southbridge-2408.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/5/5c/Intel_NH82801HBM_SLB9A_Southbridge-2408.jpg/440px-Intel_NH82801HBM_SLB9A_Southbridge-2408.jpg 2x" data-file-width="2164" data-file-height="2164" /></a><figcaption>ICH8 NH82801HBM</figcaption></figure> <p>Der ICH8 (6/2006) wird in vier verschiedenen Versionen angeboten und ist die Southbridge zu den 965er Chips von Intel. Mit dem ICH8 wird – außer bei der Mobilvariante – endgültig auf das althergebrachte ATA/ATAPI-Interface und AC97 verzichtet. In der Praxis möchten die meisten Mainboard-Hersteller ATA/ATAPI allerdings noch unterstützen und bieten entsprechende Anschlussmöglichkeiten über zusätzliche Chips von <a href="/w/index.php?title=JMicron&action=edit&redlink=1" class="new" title="JMicron (Seite nicht vorhanden)">JMicron</a> oder <a href="/wiki/Marvell_Technology_Group" title="Marvell Technology Group">Marvell</a>. </p><p>Als erster ICH beherrscht der ICH8 <a href="/wiki/ESATA" class="mw-redirect" title="ESATA">eSATA</a> und Gigabit-Ethernet (vormals im MCH untergebracht). Die Basisversion <b>ICH8</b> (82801HB) besitzt nur vier SATA-II-Ports. Der <b>ICH8R</b> (82801HR), der natürlich RAID bietet, hat, wie auch die restlichen Chips, die Möglichkeit, sechs SATA-Geräte anzuschließen. Zusätzlich verfügt der <b>ICH8DH</b> (82801HDH) – Digital Home – über <a href="/w/index.php?title=Quick_Resume&action=edit&redlink=1" class="new" title="Quick Resume (Seite nicht vorhanden)">Quick Resume</a> und kommt zusammen mit dem <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">P965</a> bzw. <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">G965</a> in <a href="/wiki/Viiv" title="Viiv">Viiv-zertifizierten</a> Systemen zum Einsatz. Der <b>ICH8DO</b> (82801HDO) – Digital Office – bildet zusammen mit Northbridge <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">Q965</a> die Grundlage für <a href="/wiki/Intel_vPro" title="Intel vPro">vPro</a>. </p> <div class="mw-heading mw-heading3"><h3 id="ICH9">ICH9</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=12" title="Abschnitt bearbeiten: ICH9" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=12" title="Quellcode des Abschnitts bearbeiten: ICH9"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <figure class="mw-default-size" typeof="mw:File/Thumb"><a href="/wiki/Datei:Intel_AF82801IBM_SLB8Q_Southbridge-3593.jpg" class="mw-file-description"><img src="//upload.wikimedia.org/wikipedia/commons/thumb/2/2a/Intel_AF82801IBM_SLB8Q_Southbridge-3593.jpg/220px-Intel_AF82801IBM_SLB8Q_Southbridge-3593.jpg" decoding="async" width="220" height="220" class="mw-file-element" srcset="//upload.wikimedia.org/wikipedia/commons/thumb/2/2a/Intel_AF82801IBM_SLB8Q_Southbridge-3593.jpg/330px-Intel_AF82801IBM_SLB8Q_Southbridge-3593.jpg 1.5x, //upload.wikimedia.org/wikipedia/commons/thumb/2/2a/Intel_AF82801IBM_SLB8Q_Southbridge-3593.jpg/440px-Intel_AF82801IBM_SLB8Q_Southbridge-3593.jpg 2x" data-file-width="2743" data-file-height="2743" /></a><figcaption>ICH9 AF82801IBM</figcaption></figure> <p>Der <b>ICH9R</b> (82801IR) kam im Mai 2007 im Chipsatz <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">P35</a> auf den Markt. Er bietet genauso wie der ICH8 keine ATA/ATAPI-Ports mehr, in der Praxis möchten die meisten Mainboard-Hersteller ATA/ATAPI allerdings nach wie vor unterstützen und bieten entsprechende Anschlussmöglichkeiten (wie schon beim ICH8) über zusätzliche Chipsätze. </p> <div class="mw-heading mw-heading3"><h3 id="ICH10">ICH10</h3><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=13" title="Abschnitt bearbeiten: ICH10" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=13" title="Quellcode des Abschnitts bearbeiten: ICH10"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Der ICH10 startet 2008 in Verbindung mit dem Intel Chipsatz <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">P45</a>. Große Neuerungen zum Vorgänger ICH9 sind nicht vorhanden, weshalb der Highend-Chipsatz <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">X48</a> noch auf den ICH9 setzt. </p> <div class="mw-heading mw-heading2"><h2 id="Kombinationen">Kombinationen</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=14" title="Abschnitt bearbeiten: Kombinationen" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=14" title="Quellcode des Abschnitts bearbeiten: Kombinationen"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <p>Obwohl jeder ICH mit fast jedem MCH kombiniert werden kann, haben sich typische Kombinationen manifestiert: </p> <ul><li>ICH: <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i810</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i820</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i840</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i815</a></li> <li>ICH0: <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i810</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i815</a></li> <li>ICH2: <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i815</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i845</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i850</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i860</a></li> <li>ICH3: <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i830</a>, <a href="/w/index.php?title=Intel-E7000-Serie&action=edit&redlink=1" class="new" title="Intel-E7000-Serie (Seite nicht vorhanden)">E7500</a>, <a href="/w/index.php?title=Intel-E7000-Serie&action=edit&redlink=1" class="new" title="Intel-E7000-Serie (Seite nicht vorhanden)">E7501</a></li> <li>ICH4: <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i845</a>, <a href="/w/index.php?title=Intel-E7000-Serie&action=edit&redlink=1" class="new" title="Intel-E7000-Serie (Seite nicht vorhanden)">E7205</a>, <a href="/w/index.php?title=Intel-E7000-Serie&action=edit&redlink=1" class="new" title="Intel-E7000-Serie (Seite nicht vorhanden)">E7505</a></li> <li>ICH5: <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i848</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i865</a>, <a href="/wiki/Intel-800-Serie" title="Intel-800-Serie">i875</a>,</li> <li>ICH6: <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i910</a>, <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i915</a>, <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i925</a></li> <li>ICH7: <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i945</a>, <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i946</a>, <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i955</a>, <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">i975</a>, <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">G31</a>, <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">G41</a></li> <li>ICH8: <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">G965</a>, <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">P965</a>, <a href="/wiki/Intel-900-Serie" title="Intel-900-Serie">Q965</a>, <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">G35</a>,</li> <li>ICH9: <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">G33</a>, <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">Q33</a>, <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">Q35</a>, <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">X38</a>, <a href="/wiki/Intel-3-Serie" title="Intel-3-Serie">P35</a>, <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">X48</a></li> <li>ICH10: <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">P43</a>, <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">P45</a>, <a href="/wiki/Intel-5-Serie" title="Intel-5-Serie">X58</a>, <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">G45</a>, <a href="/wiki/Intel-4-Serie" title="Intel-4-Serie">Q45</a></li></ul> <div class="mw-heading mw-heading2"><h2 id="Modellübersicht"><span id="Modell.C3.BCbersicht"></span>Modellübersicht</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=15" title="Abschnitt bearbeiten: Modellübersicht" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=15" title="Quellcode des Abschnitts bearbeiten: Modellübersicht"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <table class="wikitable center" style="font-size: 90%;"> <tbody><tr> <th>Modell </th> <th>Produktion </th> <th>PATA </th> <th>SATA </th> <th>RAID-Modi </th> <th>AHCI </th> <th>USB </th> <th>PCI-Slots </th> <th>Ethernet </th> <th>Audio </th> <th>TDP </th> <th>Sonstiges </th></tr> <tr> <td style="text-align:left;">ICH </td> <td><i>k. A.</i> </td> <td>4× ATA-66 </td> <td>- </td> <td>- </td> <td>? </td> <td>2× USB 1.1 </td> <td>6 </td> <td>- </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH0 </td> <td><i>k. A.</i> </td> <td>4× ATA-33 </td> <td>- </td> <td>- </td> <td>? </td> <td>2× USB 1.1 </td> <td>4 </td> <td>- </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH2 </td> <td><i>k. A.</i> </td> <td>4× ATA-100 </td> <td>- </td> <td>- </td> <td>? </td> <td>4× USB 1.1 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH2-M </td> <td><i>k. A.</i> </td> <td>4× ATA-100 </td> <td>- </td> <td>- </td> <td>? </td> <td>4× USB 1.1 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>SpeedStep </td></tr> <tr> <td style="text-align:left;">ICH3-S </td> <td><i>k. A.</i> </td> <td>4× ATA-100 </td> <td>- </td> <td>- </td> <td>? </td> <td>6× USB 1.1 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH3-M </td> <td><i>k. A.</i> </td> <td>4× ATA-100 </td> <td>- </td> <td>- </td> <td>? </td> <td>6× USB 1.1 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>SpeedStep </td></tr> <tr> <td style="text-align:left;">ICH4 </td> <td><i>k. A.</i> </td> <td>4× ATA-100 </td> <td>- </td> <td>- </td> <td>? </td> <td>6× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH4-M </td> <td><i>k. A.</i> </td> <td>4× ATA-100 </td> <td>- </td> <td>- </td> <td>? </td> <td>6× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td><i>k. A.</i> </td> <td>SpeedStep </td></tr> <tr> <td style="text-align:left;">ICH5 </td> <td>180 nm </td> <td>4× ATA-100 </td> <td>2× SATA-I </td> <td>- </td> <td>? </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td>2,4 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH5R </td> <td>180 nm </td> <td>4× ATA-100 </td> <td>2× SATA-I </td> <td>0, 1 </td> <td>? </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>AC97 </td> <td>2,4 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH6 </td> <td>180 nm </td> <td>2× ATA-100 </td> <td>4× SATA-I </td> <td>- </td> <td>? </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>HDA </td> <td>3,8 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH6R </td> <td>180 nm </td> <td>2× ATA-100 </td> <td>4× SATA-I </td> <td>0, 1, 10 </td> <td>Y </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>HDA </td> <td>3,8 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH6-M </td> <td>180 nm </td> <td>2× ATA-100 </td> <td>4× SATA-I </td> <td>- </td> <td>Y </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>HDA </td> <td>3,8 W </td> <td>SpeedStep </td></tr> <tr> <td style="text-align:left;">ICH7 </td> <td>130 nm </td> <td>2× ATA-100 </td> <td>4× SATA-II </td> <td>- </td> <td>N </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>HDA </td> <td>3,3 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH7DH </td> <td> </td> <td> </td> <td> </td> <td> </td> <td>Y </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td></tr> <tr> <td style="text-align:left;">ICH7R </td> <td>130 nm </td> <td>2× ATA-100 </td> <td>4× SATA-II </td> <td>0, 1, 10, 5 </td> <td>Y </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 100 MBit </td> <td>HDA </td> <td>3,3 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH7-U </td> <td> </td> <td>1× ATA-100 </td> <td> </td> <td> </td> <td>N </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td></tr> <tr> <td style="text-align:left;">ICH7-M DH </td> <td> </td> <td> </td> <td> </td> <td> </td> <td>Y </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td></tr> <tr> <td style="text-align:left;">ICH7-M </td> <td> </td> <td>1× ATA-100 </td> <td>2× SATA-I </td> <td> </td> <td>Y </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td> <td> </td></tr> <tr> <td style="text-align:left;">ICH8 </td> <td>130 nm </td> <td>- </td> <td>4× SATA-II </td> <td>- </td> <td>(Y)* </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,1 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH8R </td> <td>130 nm </td> <td>- </td> <td>6× SATA-II </td> <td>0, 1, 10, 5 </td> <td>Y </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,1 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH8DH </td> <td>130 nm </td> <td>- </td> <td>6× SATA-II </td> <td>0, 1, 10, 5 </td> <td>? </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,1 W </td> <td>Viiv </td></tr> <tr> <td style="text-align:left;">ICH8DO </td> <td>130 nm </td> <td>- </td> <td>6× SATA-II </td> <td>0, 1, 10, 5 </td> <td>? </td> <td>8× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,1 W </td> <td>vPro </td></tr> <tr> <td style="text-align:left;">ICH9 </td> <td>130 nm </td> <td>- </td> <td>4× SATA-II </td> <td>- </td> <td>(Y)* </td> <td>12× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,3 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH9R </td> <td>130 nm </td> <td>- </td> <td>4× oder 6× SATA-II </td> <td>0, 1, 10, 5 </td> <td>Y </td> <td>12× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,3 W </td> <td>Intel Turbo Memory </td></tr> <tr> <td style="text-align:left;">ICH9DH </td> <td>130 nm </td> <td>- </td> <td>4× oder 6× SATA-II </td> <td>- </td> <td>? </td> <td>12× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,3 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH9DO </td> <td>130 nm </td> <td>- </td> <td>4× oder 6× SATA-II </td> <td>0, 1, 10, 5 </td> <td>? </td> <td>12× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,3 W </td> <td>Intel Turbo Memory </td></tr> <tr> <td style="text-align:left;">ICH10 </td> <td>130 nm </td> <td>- </td> <td>6× SATA-II </td> <td>- </td> <td>? </td> <td>12× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,5 W </td> <td>- </td></tr> <tr> <td style="text-align:left;">ICH10R </td> <td>130 nm </td> <td>- </td> <td>6× SATA-II </td> <td>0, 1, 10, 5 </td> <td>Y </td> <td>12× USB 2.0 </td> <td>6 </td> <td>1× 1000 MBit </td> <td>HDA </td> <td>4,5 W </td> <td>Intel Turbo Memory </td></tr></tbody></table> <p>(* AHCI vorhanden, aber nicht freigeschaltet (Lizenz/Marketing), siehe u. a. ASUS P5K (ICH9 – im ersten BIOS war AHCI noch vorhanden, in den späteren nicht mehr); CrossFlash mit BIOS von ASUS P5KR möglich (ICH9R, ansonsten baugleich wie P5K)) </p> <div class="mw-heading mw-heading2"><h2 id="Einzelnachweise">Einzelnachweise</h2><span class="mw-editsection"><span class="mw-editsection-bracket">[</span><a href="/w/index.php?title=Intel_ICH&veaction=edit&section=16" title="Abschnitt bearbeiten: Einzelnachweise" class="mw-editsection-visualeditor"><span>Bearbeiten</span></a><span class="mw-editsection-divider"> | </span><a href="/w/index.php?title=Intel_ICH&action=edit&section=16" title="Quellcode des Abschnitts bearbeiten: Einzelnachweise"><span>Quelltext bearbeiten</span></a><span class="mw-editsection-bracket">]</span></span></div> <ol class="references"> <li id="cite_note-1"><span class="mw-cite-backlink"><a href="#cite_ref-1">↑</a></span> <span class="reference-text">heise online: <a rel="nofollow" class="external text" href="https://www.heise.de/newsticker/meldung/Erhoehte-Ausfallraten-bei-Mainboards-mit-einigen-Intel-Chipsaetzen-161665.html">Erhöhte Ausfallraten bei Mainboards mit einigen Intel-Chipsätzen</a> (19. Mai 2005)</span> </li> </ol></div><noscript><img src="https://login.wikimedia.org/wiki/Special:CentralAutoLogin/start?type=1x1&useformat=desktop" alt="" width="1" height="1" style="border: none; position: absolute;"></noscript> <div class="printfooter" data-nosnippet="">Abgerufen von „<a dir="ltr" href="https://de.wikipedia.org/w/index.php?title=Intel_ICH&oldid=219075815">https://de.wikipedia.org/w/index.php?title=Intel_ICH&oldid=219075815</a>“</div></div> <div id="catlinks" class="catlinks" data-mw="interface"><div id="mw-normal-catlinks" class="mw-normal-catlinks"><a href="/wiki/Wikipedia:Kategorien" title="Wikipedia:Kategorien">Kategorie</a>: <ul><li><a href="/wiki/Kategorie:Chipsatz" title="Kategorie:Chipsatz">Chipsatz</a></li></ul></div></div> </div> </div> <div id="mw-navigation"> <h2>Navigationsmenü</h2> <div id="mw-head"> <nav id="p-personal" class="mw-portlet mw-portlet-personal vector-user-menu-legacy vector-menu" aria-labelledby="p-personal-label" > <h3 id="p-personal-label" class="vector-menu-heading " > <span class="vector-menu-heading-label">Meine Werkzeuge</span> </h3> <div class="vector-menu-content"> <ul class="vector-menu-content-list"> <li id="pt-anonuserpage" class="mw-list-item"><span title="Benutzerseite der IP-Adresse, von der aus du Änderungen durchführst">Nicht angemeldet</span></li><li id="pt-anontalk" class="mw-list-item"><a href="/wiki/Spezial:Meine_Diskussionsseite" title="Diskussion über Änderungen von dieser IP-Adresse [n]" accesskey="n"><span>Diskussionsseite</span></a></li><li id="pt-anoncontribs" class="mw-list-item"><a href="/wiki/Spezial:Meine_Beitr%C3%A4ge" title="Eine Liste der Bearbeitungen, die von dieser IP-Adresse gemacht wurden [y]" accesskey="y"><span>Beiträge</span></a></li><li id="pt-createaccount" class="mw-list-item"><a href="/w/index.php?title=Spezial:Benutzerkonto_anlegen&returnto=Intel+ICH" title="Wir ermutigen dich dazu, ein Benutzerkonto zu erstellen und dich anzumelden. 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[o]" accesskey="o"><span>Anmelden</span></a></li> </ul> </div> </nav> <div id="left-navigation"> <nav id="p-namespaces" class="mw-portlet mw-portlet-namespaces vector-menu-tabs vector-menu-tabs-legacy vector-menu" aria-labelledby="p-namespaces-label" > <h3 id="p-namespaces-label" class="vector-menu-heading " > <span class="vector-menu-heading-label">Namensräume</span> </h3> <div class="vector-menu-content"> <ul class="vector-menu-content-list"> <li id="ca-nstab-main" class="selected mw-list-item"><a href="/wiki/Intel_ICH" title="Seiteninhalt anzeigen [c]" accesskey="c"><span>Artikel</span></a></li><li id="ca-talk" class="new mw-list-item"><a href="/w/index.php?title=Diskussion:Intel_ICH&action=edit&redlink=1" rel="discussion" class="new" title="Diskussion zum Seiteninhalt (Seite nicht vorhanden) [t]" accesskey="t"><span>Diskussion</span></a></li> </ul> </div> </nav> <nav id="p-variants" class="mw-portlet mw-portlet-variants emptyPortlet vector-menu-dropdown vector-menu" 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class="wb-otherproject-link wb-otherproject-wikibase-dataitem mw-list-item"><a href="https://www.wikidata.org/wiki/Special:EntityPage/Q657492" title="Link zum verbundenen Objekt im Datenrepositorium [g]" accesskey="g"><span>Wikidata-Datenobjekt</span></a></li> </ul> </div> </nav> <nav id="p-lang" class="mw-portlet mw-portlet-lang vector-menu-portal portal vector-menu" aria-labelledby="p-lang-label" > <h3 id="p-lang-label" class="vector-menu-heading " > <span class="vector-menu-heading-label">In anderen Sprachen</span> </h3> <div class="vector-menu-content"> <ul class="vector-menu-content-list"> <li class="interlanguage-link interwiki-en mw-list-item"><a href="https://en.wikipedia.org/wiki/I/O_Controller_Hub" title="I/O Controller Hub – Englisch" lang="en" hreflang="en" data-title="I/O Controller Hub" data-language-autonym="English" data-language-local-name="Englisch" class="interlanguage-link-target"><span>English</span></a></li><li class="interlanguage-link interwiki-fr mw-list-item"><a href="https://fr.wikipedia.org/wiki/Intel_I/O_Controller_Hub" title="Intel I/O Controller Hub – Französisch" lang="fr" hreflang="fr" data-title="Intel I/O Controller Hub" data-language-autonym="Français" data-language-local-name="Französisch" class="interlanguage-link-target"><span>Français</span></a></li><li class="interlanguage-link interwiki-ja mw-list-item"><a href="https://ja.wikipedia.org/wiki/I/O_%E3%82%B3%E3%83%B3%E3%83%88%E3%83%AD%E3%83%BC%E3%83%A9%E3%83%BC%E3%83%BB%E3%83%8F%E3%83%96" title="I/O コントローラー・ハブ – Japanisch" lang="ja" hreflang="ja" data-title="I/O コントローラー・ハブ" data-language-autonym="日本語" data-language-local-name="Japanisch" class="interlanguage-link-target"><span>日本語</span></a></li><li class="interlanguage-link interwiki-ko mw-list-item"><a href="https://ko.wikipedia.org/wiki/I/O_%EC%BB%A8%ED%8A%B8%EB%A1%A4%EB%9F%AC_%ED%97%88%EB%B8%8C" title="I/O 컨트롤러 허브 – Koreanisch" lang="ko" hreflang="ko" data-title="I/O 컨트롤러 허브" data-language-autonym="한국어" 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